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1. (WO2019048984) SEMICONDUCTOR DEVICE, AND MANUFACTURING METHOD FOR SEMICONDUCTOR DEVICE
国际局存档的最新著录项目数据提交意见

公布号: WO/2019/048984 国际申请号: PCT/IB2018/056535
公布日: 14.03.2019 国际申请日: 28.08.2018
国际专利分类:
H01L 29/786 (2006.01) ,H01L 21/336 (2006.01) ,H01L 21/8234 (2006.01) ,H01L 21/8242 (2006.01) ,H01L 27/06 (2006.01) ,H01L 27/088 (2006.01) ,H01L 27/108 (2006.01) ,H01L 27/1156 (2017.01) ,H01L 29/788 (2006.01) ,H01L 29/792 (2006.01)
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
29
专门适用于整流、放大、振荡或切换,并具有至少一个电位跃变势垒或表面势垒的半导体器件;具有至少一个电位跃变势垒或表面势垒,例如PN结耗尽层或载流子集结层的电容器或电阻器;半导体本体或其电极的零部件
66
按半导体器件的类型区分的
68
只能通过对一个不通有待整流、放大或切换的电流的电极供给电流或施加电位方可进行控制的
76
单极器件
772
场效应晶体管
78
由绝缘栅产生场效应的
786
薄膜晶体管
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
02
半导体器件或其部件的制造或处理
04
至少具有一个跃变势垒或表面势垒的器件,例如PN结、耗尽层、载体集结层
18
器件有由周期表第Ⅳ族元素或含有/不含有杂质的AⅢBⅤ族化合物构成的半导体,如掺杂材料
334
制造单极型器件的台阶式工艺
335
场效应晶体管
336
带有绝缘栅的
H ELECTRICITY
01
BASIC ELECTRIC ELEMENTS
L
SEMICONDUCTOR DEVICES; ELECTRIC SOLID STATE DEVICES NOT OTHERWISE PROVIDED FOR
21
Processes or apparatus specially adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
70
Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in or on a common substrate or of specific parts thereof; Manufacture of integrated circuit devices or of specific parts thereof
77
Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
78
with subsequent division of the substrate into plural individual devices
82
to produce devices, e.g. integrated circuits, each consisting of a plurality of components
822
the substrate being a semiconductor, using silicon technology
8232
Field-effect technology
8234
MIS technology
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
70
由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
77
在公共衬底中或上面形成的由许多固态元件或集成电路组成的器件的制造或处理
78
把衬底连续地分成多个独立的器件
82
制造器件,例如每一个由许多元件组成的集成电路
822
衬底是采用硅工艺的半导体的
8232
场效应工艺
8234
MIS technology
8239
存储器结构
8242
动态随机存取存储结构(DRAM)
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
27
由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
02
包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
04
其衬底为半导体的
06
在非重复结构中包括有多个单个组件的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
27
由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
02
包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
04
其衬底为半导体的
08
只包括有一种半导体组件的
085
只包含场效应的组件
088
有绝缘栅场效应晶体管的组件
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
27
由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
02
包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
04
其衬底为半导体的
10
在重复结构中包括有多个独立组件的
105
包含场效应组件的
108
动态随机存取存储结构的
[IPC code unknown for H01L 27/1156]
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
29
专门适用于整流、放大、振荡或切换,并具有至少一个电位跃变势垒或表面势垒的半导体器件;具有至少一个电位跃变势垒或表面势垒,例如PN结耗尽层或载流子集结层的电容器或电阻器;半导体本体或其电极的零部件
66
按半导体器件的类型区分的
68
只能通过对一个不通有待整流、放大或切换的电流的电极供给电流或施加电位方可进行控制的
76
单极器件
772
场效应晶体管
78
由绝缘栅产生场效应的
788
带有浮栅的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
29
专门适用于整流、放大、振荡或切换,并具有至少一个电位跃变势垒或表面势垒的半导体器件;具有至少一个电位跃变势垒或表面势垒,例如PN结耗尽层或载流子集结层的电容器或电阻器;半导体本体或其电极的零部件
66
按半导体器件的类型区分的
68
只能通过对一个不通有待整流、放大或切换的电流的电极供给电流或施加电位方可进行控制的
76
单极器件
772
场效应晶体管
78
由绝缘栅产生场效应的
792
带有电荷捕获栅绝缘体,例如MNOS存储晶体管
申请人:
株式会社半導体エネルギー研究所 SEMICONDUCTOR ENERGY LABORATORY CO., LTD. [JP/JP]; 神奈川県厚木市長谷398 398, Hase, Atsugi-shi, Kanagawa 2430036, JP
发明人:
山崎舜平 YAMAZAKI, Shunpei; JP
竹内敏彦 TAKEUCHI, Toshihiko; JP
村川努 MURAKAWA, Tsutomu; JP
駒形大樹 KOMAGATA, Hiroki; JP
奥野直樹 OKUNO, Naoki; JP
石原典隆 ISHIHARA, Noritaka; --
野中裕介 NONAKA, Yusuke; --
优先权数据:
2017-17005605.09.2017JP
2017-17006005.09.2017JP
2017-23820913.12.2017JP
标题 (EN) SEMICONDUCTOR DEVICE, AND MANUFACTURING METHOD FOR SEMICONDUCTOR DEVICE
(FR) DISPOSITIF À SEMI-CONDUCTEUR ET PROCÉDÉ DE FABRICATION DE DISPOSITIF À SEMI-CONDUCTEUR
(JA) 半導体装置、および半導体装置の作製方法
摘要:
(EN) Provided is a reliable semiconductor device having excellent electrical characteristics. In the present invention: a first insulating body is formed, a second insulating body is formed on the first insulating body, an island-like oxide is formed on the second insulating body, a third insulating body and conducting body laminate is formed on the oxide, and a film comprising a metal element is formed on the oxide and the conducting body, thus selectively providing the oxide with low resistance; after the second insulating body, the oxide, and a fourth insulating body is formed on the laminate, an opening exposing the second insulating body is formed in the fourth insulating body, a fifth insulating body is formed on the second insulating body and the fourth insulating body, and oxygen introduction treatment is performed on the fifth insulating body.
(FR) L'invention concerne un dispositif à semi-conducteur fiable présentant d'excellentes caractéristiques électriques. Dans la présente invention : un premier corps isolant est formé, un deuxième corps isolant est formé sur le premier corps isolant, un oxyde de type îlot est formé sur le deuxième corps isolant, un troisième corps isolant et un stratifié de corps conducteur est formé sur l'oxyde, et un film comprenant un élément métallique est formé sur l'oxyde et le corps conducteur, permettant ainsi de fournir sélectivement à l'oxyde une faible résistance; après que le deuxième corps isolant, l'oxyde et un quatrième corps isolant sont formés sur le stratifié, une ouverture faisant apparaître le deuxième corps isolant est formée dans le quatrième corps isolant, un cinquième corps isolant est formé sur le deuxième corps isolant et le quatrième corps isolant, et un traitement d'introduction d'oxygène est réalisé sur le cinquième corps isolant.
(JA) 要約書 良好な電気特性、および信頼性を有する半導体装置を提供する。 第1の絶縁体を形成し、 第1の絶縁体上に第2の絶縁体を形成し、 第2の絶縁体上に島状の酸化物を 形成し、 酸化物上に、 第3の絶縁体と導電体の積層体を形成し、 酸化物、 および積層体上に金属元素 を有する膜を形成することにより、 酸化物を選択的に低抵抗化し、 第2の絶縁体と、 酸化物と、 およ び積層体上に第4の絶縁体を形成した後、第4の絶縁体に、第2の絶縁体を露出する開口部を形成し、 第2の絶縁体、 および第4の絶縁体上に、 第5の絶縁体を形成し、 第5の絶縁体に対して、 酸素導入 処理を行う。
front page image
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
非洲地区知识产权组织 (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
欧亚专利局 (EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧洲专利局 (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
非洲知识产权组织 (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
公布语言: 日语 (JA)
申请语言: 日语 (JA)