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1. WO2020108778 - DISPOSITIF ÉLECTRONIQUE POUR UNE COMMANDE D'ACCÈS À UNE MÉMOIRE ET SON PROCÉDÉ DE FONCTIONNEMENT

Numéro de publication WO/2020/108778
Date de publication 04.06.2020
N° de la demande internationale PCT/EP2018/083177
Date du dépôt international 30.11.2018
CIB
G06F 13/16 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
14Traitement de demandes d'interconnexion ou de transfert
16pour l'accès au bus de mémoire
CPC
G06F 13/1663
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
13Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
14Handling requests for interconnection or transfer
16for access to memory bus
1605based on arbitration
1652in a multiprocessor architecture
1663Access to shared memory
Déposants
  • HUAWEI TECHNOLOGIES CO., LTD. [CN]/[CN]
  • LASSERRE, Serge [FR]/[DE] (US)
Inventeurs
  • LASSERRE, Serge
  • BUSCH, Stephen
  • SIXTA, Anthony
Mandataires
  • KREUZ, Georg
Données relatives à la priorité
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) ELECTRONIC DEVICE FOR MEMORY ACCESS CONTROL AND METHOD OF OPERATING SAME
(FR) DISPOSITIF ÉLECTRONIQUE POUR UNE COMMANDE D'ACCÈS À UNE MÉMOIRE ET SON PROCÉDÉ DE FONCTIONNEMENT
Abrégé
(EN)
The invention relates to an electronic device (100) comprising: a memory (103) configured to be accessed by at least one data processing circuit (101), wherein the memory (103) is associated with an access load. The at least one data processing circuit (101) is allocated a data throughput for accessing the memory (103) is configured to be controlled to adjust a data throughput on the basis of the access load of the memory (103) and the respective data throughput. Moreover, the invention relates to a corresponding method.
(FR)
L'invention concerne un dispositif électronique (100) comprenant : une mémoire (103) configurée pour être accessible par au moins un circuit de traitement de données (101), la mémoire (103) étant associée à une charge d'accès. Le ou les circuits de traitement de données (101) reçoivent un débit de données pour accéder à la mémoire (103) et sont configurés pour être commandés afin d'ajuster un débit de données sur la base de la charge d'accès de la mémoire (103) et du débit de données respectif. L'invention concerne en outre un procédé correspondant.
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