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1. WO2020090009 - DISPOSITIF DE TRAITEMENT ARITHMÉTIQUE ET SON PROCÉDÉ DE COMMANDE

Numéro de publication WO/2020/090009
Date de publication 07.05.2020
N° de la demande internationale PCT/JP2018/040345
Date du dépôt international 30.10.2018
CIB
G06F 9/34 2018.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
34Adressage de l'opérande d'instruction ou du résultat ou accès à l'opérande d'instruction ou au résultat
G06F 12/00 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
G06F 13/18 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
14Traitement de demandes d'interconnexion ou de transfert
16pour l'accès au bus de mémoire
18avec commande prioritaire
G06F 15/167 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
15Calculateurs numériques en général; Équipement de traitement de données en général
16Associations de plusieurs calculateurs numériques comportant chacun au moins une unité arithmétique, une unité programme et un registre, p.ex. pour le traitement simultané de plusieurs programmes
163Communication entre processeurs
167utilisant une mémoire commune, p.ex. boîte aux lettres électronique
Déposants
  • 富士通株式会社 FUJITSU LIMITED [JP]/[JP]
Inventeurs
  • 永野 朋広 NAGANO, Tomohiro
Mandataires
  • 真田 有 SANADA, Tamotsu
  • 山本 雅久 YAMAMOTO, Masahisa
Données relatives à la priorité
Langue de publication japonais (JA)
Langue de dépôt japonais (JA)
États désignés
Titre
(EN) ARITHMETIC PROCESSING DEVICE AND CONTROL METHOD THEREOF
(FR) DISPOSITIF DE TRAITEMENT ARITHMÉTIQUE ET SON PROCÉDÉ DE COMMANDE
(JA) 演算処理装置及びその制御方法
Abrégé
(EN)
The present invention comprises: a determination circuit (1221) that, for first to third chain groups to be respectively subjected to first to third arithmetic processes, sets, as a first determined chain group, the first chain group having a relationship in which a second arithmetic process is continuously performed after a first arithmetic process, sets, as a second determined chain group, a chain group which is obtained by calculating the third chain group in a certain manner with respect to the first chain group, and which has a relationship in which after the first arithmetic process, one or more third arithmetic processes are executed, and then the second arithmetic process is executed, and that determines whether the first or second determined chain group includes a second chain group to be subjected to the second arithmetic process; a generation circuit (1222) which generates an initialization instruction of an identifier of the second arithmetic process, when the first and second determined chain groups do not include the second chain group; and an acquisition circuit (322) which acquires an initialized identifier for the second arithmetic process when the initialization instruction is issued, and acquires an identifier that is continuous with the identifier of the first arithmetic process, for the second arithmetic process, when the initialization instruction is not issued.
(FR)
La présente invention comprend : un circuit de détermination (1221) qui, pour des premier à troisième groupes de chaîne devant être respectivement soumis à des premier à troisième processus arithmétiques, définit, en tant que premier groupe de chaînes déterminé, le premier groupe de chaînes ayant une relation dans laquelle un second processus arithmétique est exécuté en continu après un premier processus arithmétique ; définit, en tant que deuxième groupe de chaînes déterminé, un groupe de chaînes qui est obtenu par calcul du troisième groupe de chaînes d'une certaine manière par rapport au premier groupe de chaînes, et qui a une relation dans laquelle, après le premier processus arithmétique, un ou plusieurs troisièmes processus arithmétiques sont exécutés, puis le second processus arithmétique est exécuté, et qui détermine si le premier ou le second groupe de chaînes déterminé comprend un second groupe de chaînes devant être soumis au second processus arithmétique ; un circuit de génération (1222) qui génère une instruction d'initialisation d'un identifiant du second processus arithmétique, lorsque les premier et second groupes de chaînes déterminés ne comprennent pas le second groupe de chaînes ; et un circuit d'acquisition (322) qui acquiert un identifiant initialisé pour le second processus arithmétique lorsque l'instruction d'initialisation est émise, et acquiert un identifiant qui est continu avec l'identifiant du premier processus arithmétique, pour le second processus arithmétique, lorsque l'instruction d'initialisation n'est pas émise.
(JA)
それぞれ第1~第3演算処理の対象である第1~第3チェーン群において、第1演算処理後に連続して第2演算処理が実行される関係の、第1チェーン群を第1被判定チェーン群とし、第1演算処理後に、1以上の第3演算処理が実行された後に第2演算処理が実行される関係の、第1チェーン群に対して第3チェーン群を一定方式で計算したものを第2被判定チェーン群とし、第1又は第2被判定チェーン群が、第2演算処理の対象である第2チェーン群を包含するかを判定する判定回路(1221)と、第1及び第2被判定チェーン群が第2チェーン群を包含しない場合に、第2演算処理の識別子の初期化指示を生成する生成回路(1222)と、初期化指示が発行された場合に第2演算処理に対して初期化した識別子を獲得する一方、初期化指示が発行されなかった場合に第2演算処理に対して第1演算処理の識別子に連続する識別子を獲得する獲得回路(322)と、を備える。
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