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1. (WO2018141663) CIRCUIT POUR GÉNÉRER UN SIGNAL DE BALAYAGE POUR UNE INTERFACE UART ET INTERFACE UART

Pub. No.:    WO/2018/141663    International Application No.:    PCT/EP2018/052036
Publication Date: Fri Aug 10 01:59:59 CEST 2018 International Filing Date: Tue Jan 30 00:59:59 CET 2018
IPC: G06F 1/08
Applicants: LENZE AUTOMATION GMBH
Inventors: DÜSTERBERG, Dirk
Title: CIRCUIT POUR GÉNÉRER UN SIGNAL DE BALAYAGE POUR UNE INTERFACE UART ET INTERFACE UART
Abstract:
La présente invention concerne un circuit (1) pour générer un signal de balayage (AS) pour une interface UART (20). Le circuit (1) comprend : - un raccordement d’entrée (2) qui est conçu pour recevoir une fréquence d’horloge de périphérique (PT) ; - un raccordement de sortie (3) qui est conçu pour délivrer le signal de balayage (AS) ; - une mémoire de débit binaire (4) qui est conçue pour stocker une valeur qui correspond à un débit binaire souhaité de l’interface UART ; - une mémoire de fréquence d’horloge de périphérique (5) qui est conçue pour stocker une valeur qui correspond à une fréquence de l’horloge de périphérique ; une mémoire de somme (6) qui est conçue pour stocker une valeur de somme ; et - une unité de calcul (7) qui est conçue pour : - comparer une valeur de comparaison (VW), qui dépend de la valeur de somme stockée dans la mémoire de somme (6), à une valeur de seuil (SW) qui dépend de la valeur stockée dans la mémoire de fréquence d’horloge de périphérique (5) ; - générer, en fonction du résultat de la comparaison, le signal de balayage (AS) à un premier niveau ou à un second niveau ; et - à la fréquence de l’horloge de périphérique (PT) et en fonction du résultat de la comparaison, soit modifier la valeur de somme, stockée dans la mémoire de somme (6), de la valeur stockée dans la mémoire de débit binaire (4), soit modifier la valeur de somme, stockée dans la mémoire de somme (6), d’une valeur qui dépend de la valeur stockée dans la mémoire de fréquence d’horloge de périphérique (5).