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1. WO2018057273 - RÉUTILISATION DE PRÉ-EXTRACTEURS ENTRAÎNÉS

Numéro de publication WO/2018/057273
Date de publication 29.03.2018
N° de la demande internationale PCT/US2017/049862
Date du dépôt international 01.09.2017
CIB
G06F 12/0862 2016.1
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
0802Adressage d’un niveau de mémoire dans lequel l’accès aux données ou aux blocs de données désirés nécessite des moyens d’adressage associatif, p.ex. mémoires cache
0862avec pré-lecture
G06F 12/0842 2016.1
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
0802Adressage d’un niveau de mémoire dans lequel l’accès aux données ou aux blocs de données désirés nécessite des moyens d’adressage associatif, p.ex. mémoires cache
0806Systèmes de mémoire cache multi-utilisateurs, multiprocesseurs ou multitraitement
0842pour multitraitement ou multitâche
G06F 12/084 2016.1
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
0802Adressage d’un niveau de mémoire dans lequel l’accès aux données ou aux blocs de données désirés nécessite des moyens d’adressage associatif, p.ex. mémoires cache
0806Systèmes de mémoire cache multi-utilisateurs, multiprocesseurs ou multitraitement
084avec mémoire cache partagée
G06F 12/0897 2016.1
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
0802Adressage d’un niveau de mémoire dans lequel l’accès aux données ou aux blocs de données désirés nécessite des moyens d’adressage associatif, p.ex. mémoires cache
0893Mémoires cache caractérisées par leur organisation ou leur structure
0897avec plusieurs niveaux de hiérarchie de mémoire cache
CPC
G06F 12/084
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0806Multiuser, multiprocessor or multiprocessing cache systems
084with a shared cache
G06F 12/0842
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0806Multiuser, multiprocessor or multiprocessing cache systems
0842for multiprocessing or multitasking
G06F 12/0862
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0862with prefetch
G06F 12/0897
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0893Caches characterised by their organisation or structure
0897with two or more cache hierarchy levels
G06F 2212/1016
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
2212Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
10Providing a specific technical effect
1016Performance improvement
G06F 2212/602
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
2212Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
60Details of cache memory
602Details relating to cache prefetching
Déposants
  • QUALCOMM INCORPORATED [US]/[US]
Inventeurs
  • KOTHINTI NARESH, Vignyan Reddy
  • WRIGHT, Gregory Michael
Mandataires
  • CICCOZZI, John L.
  • OLDS, Mark E.
  • PODHAJNY, Daniel
Données relatives à la priorité
15/274,61523.09.2016US
Langue de publication Anglais (en)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) REUSING TRAINED PREFETCHERS
(FR) RÉUTILISATION DE PRÉ-EXTRACTEURS ENTRAÎNÉS
Abrégé
(EN) A proposed prefetcher may operate at a cache level where accesses are conducted using physical addresses. The proposed prefetcher may include one or more prefetch engines. Similar to conventional prefetchers, a prefetch engines of the proposed prefetcher may train on access patterns of a memory page to predict future accesses and perform prefetches based on the training. But unlike the conventional prefetchers, the trained prefetch engine may be reused for prefetching even when a request for a new page is received without requiring the prefetch engine to be newly trained on the new page. This can lower access latencies and lower cumulative training time.
(FR) Un dispositif de pré-extraction proposé peut fonctionner à un niveau de cache où des accès sont effectués à l'aide d'adresses physiques. Le dispositif de pré-extraction proposé peut comprendre un ou plusieurs moteurs de pré-extraction. Des moteurs de pré-extraction du dispositif de pré-extraction proposé peuvent entraîner des modèles d'accès d'une page de mémoire pour prédire des accès futurs et effectuer des pré-extractions sur la base de l'apprentissage. Contrairement aux dispositifs de pré-extraction classiques, le moteur de pré-extraction entraîné peut être réutilisé pour une pré-extraction même lorsqu'une requête pour une nouvelle page est reçue sans nécessiter que le moteur de pré-extraction soit nouvellement formé sur la nouvelle page. Ceci peut réduire les latences d'accès et réduire le temps d'apprentissage cumulatif.
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