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1. (WO2014081949) GESTION À FAIBLE CONSOMMATION D'ÉNERGIE D'UNE ARCHITECTURE DE PUCE INTÉGRÉE À PLUSIEURS CAPTEURS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2014/081949    N° de la demande internationale :    PCT/US2013/071277
Date de publication : 30.05.2014 Date de dépôt international : 21.11.2013
CIB :
G06F 1/32 (2006.01)
Déposants : MOTOROLA MOBILITY LLC [US/US]; 600 North US Highway 45 Libertyville, Illinois 60048 (US)
Inventeurs : LAUTNER, Douglas A.,; (US).
DEBATES, Scott P.,; (US).
HOR-LAO, Mary K.,; (US).
FOREST, Francis W.,; (US).
SHAH, Jagatkumar V.,; (US).
STANDISH, George B.,; (US)
Mandataire : VAAS, Randall S.; 600 North US Highway 45 Libertyville, Illinois 60048 (US)
Données relatives à la priorité :
61/728,921 21.11.2012 US
61/776,868 12.03.2013 US
61/827,458 24.05.2013 US
13/930,567 28.06.2013 US
Titre (EN) LOW POWER MANAGEMENT OF MULTIPLE SENSOR INTEGRATED CHIP ARCHITECTURE
(FR) GESTION À FAIBLE CONSOMMATION D'ÉNERGIE D'UNE ARCHITECTURE DE PUCE INTÉGRÉE À PLUSIEURS CAPTEURS
Abrégé : front page image
(EN)A method, device, system, or article of manufacture is provided for low-power management of multiple sensor chip architecture. In one embodiment, a method comprises, at a computing device that includes a first processor, a second processor and a third processor, performing, by the second processor, a first scan at a first scan rate for first location data using a sensor; receiving, at the second processor, from the sensor, the first location data; determining, by the second processor, a first location using the first location data; receiving, by the second processor, a modality of the computing device; in response to determining the first location, determining, by the second processor, that the modality corresponds to a predetermined state; and in response to determining that the modality corresponds to the predetermined state, performing, by the second processor, a second scan at a second scan rate for second location data using the sensor.
(FR)La présente invention se rapporte à un procédé, à un dispositif, à un système ou à un article de fabrication, adaptés pour exécuter une gestion à faible consommation d'énergie d'une architecture de puce intégrée à plusieurs capteurs. Dans l'un des modes de réalisation de l'invention, un procédé comprend : l'exécution, à un dispositif informatique qui comprend un premier processeur, un deuxième processeur et un troisième processeur, d'un premier balayage en rapport avec des premières données de position, à une première vitesse de balayage, au moyen d'un capteur; la réception des premières données de position, au deuxième processeur, en provenance du capteur; la détermination d'une première position, par le deuxième processeur, au moyen des premières données de position; la réception d'une modalité du dispositif informatique, par le deuxième processeur; en réponse à la détermination de la première position, la détermination, par le deuxième processeur, que la modalité correspond à un prédéterminé état; et, en réponse à la détermination selon laquelle la modalité correspond à l'état prédéterminé, l'exécution, par le deuxième processeur, d'un second balayage en rapport avec des secondes données de position, à une seconde vitesse de balayage, au moyen du capteur.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Office européen des brevets (OEB) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)