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1. WO2012131920 - CIRCUIT DE CORRECTION DE PHASE ET PROCÉDÉ DE CORRECTION DE PHASE

Numéro de publication WO/2012/131920
Date de publication 04.10.2012
N° de la demande internationale PCT/JP2011/057891
Date du dépôt international 29.03.2011
CIB
H03K 5/22 2006.01
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
KTECHNIQUE DE L'IMPULSION
5Manipulation d'impulsions non couvertes par l'un des autres groupes principaux de la présente sous-classe
22Circuits présentant plusieurs entrées et une sortie pour comparer des impulsions ou des trains d'impulsions entre eux en ce qui concerne certaines caractéristiques du signal d'entrée, p.ex. la pente, l'intégrale
H03K 5/00 2006.01
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
KTECHNIQUE DE L'IMPULSION
5Manipulation d'impulsions non couvertes par l'un des autres groupes principaux de la présente sous-classe
CPC
H03K 2005/00026
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
5Manipulating of pulses not covered by one of the other main groups of this subclass
00013Delay, i.e. output pulse is delayed after input pulse and pulse length of output pulse is dependent on pulse length of input pulse
00019Variable delay
00026controlled by an analog electrical signal, e.g. obtained after conversion by a D/A converter
H03K 5/1532
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
5Manipulating of pulses not covered by one of the other main groups of this subclass
153Arrangements in which a pulse is delivered at the instant when a predetermined characteristic of an input signal is present or at a fixed time interval after this instant
1532Peak detectors
H03K 5/249
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
5Manipulating of pulses not covered by one of the other main groups of this subclass
22Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral
24the characteristic being amplitude
2472using field effect transistors
249using clock signals
H04L 7/02
HELECTRICITY
04ELECTRIC COMMUNICATION TECHNIQUE
LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
7Arrangements for synchronising receiver with transmitter
02Speed or phase control by the received code signals, the signals containing no special synchronisation information
Déposants
  • 富士通株式会社 FUJITSU LIMITED [JP]/[JP] (AllExceptUS)
  • 鈴木 康一 SUZUKI, Kouichi [JP]/[JP] (UsOnly)
Inventeurs
  • 鈴木 康一 SUZUKI, Kouichi
Mandataires
  • 酒井 宏明 SAKAI, Hiroaki
Données relatives à la priorité
Langue de publication japonais (JA)
Langue de dépôt japonais (JA)
États désignés
Titre
(EN) PHASE CORRECTION CIRCUIT AND PHASE CORRECTION METHOD
(FR) CIRCUIT DE CORRECTION DE PHASE ET PROCÉDÉ DE CORRECTION DE PHASE
(JA) 位相補正回路及び位相補正方法
Abrégé
(EN)
Variable delay circuits (111, 112) output a first delay signal to which a delay value has been variably added to a first signal having a predetermined phase. A mixer (130) receives input of a first signal to which a delay has been added by the variable delay circuits (111, 112) and a second signal having a phase that is different from the predetermined phase, and outputs a combined signal of the first signal and the second signal. A peak voltage detector (140) detects the maximum value of the amplitude voltage of the combined signal outputted from the mixer (130). A comparator (150) controls the delay value added by the variable delay circuits (111, 112) so that the maximum value detected by the peak voltage detector (140) matches a predetermined voltage.
(FR)
Des circuits à retard variable (111, 112) délivrent en sortie un premier signal de retard auquel une valeur de retard a été ajoutée de manière variable à un premier signal qui présente une phase prédéterminée. Un mélangeur (130) reçoit en entrée un premier signal auquel un retard a été ajouté par les circuits à retard variable (111, 112) et un second signal qui présente une phase qui est différente de la phase prédéterminée, et délivre en sortie un signal combiné du premier signal et du second signal. Un détecteur de tension de crête (140) détecte la valeur maximale de la tension d'amplitude du signal combiné délivré en sortie par le mélangeur (130). Un comparateur (150) commande la valeur de retard ajoutée par les circuits à retard variable (111, 112) de telle sorte que la valeur maximale détectée par le détecteur de tension de crête (140) corresponde à une tension prédéterminée.
(JA)
 可変遅延回路(111、112)は、所定の位相を有する第1信号に対して遅延値を可変に付加した第1遅延信号を出力する。ミキサ(130)は、可変遅延回路(111,112)により遅延が付加された第1信号及び所定の位相と異なる位相を有する第2信号の入力を受け、第1信号と第2信号の合成信号を出力する。ピーク電圧検出部(140)は、ミキサ(130)から出力された合成信号の振幅電圧の最大値を検出する。コンパレータ(150)は、ピーク電圧検出部(140)が検出した最大値が所定の電圧に一致するように可変遅延回路(111、112)が付加する遅延値を制御する。
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