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1. WO2009140707 - ARCHITECTURE INTER-DOMAINE DE SYSTÈME-SUR-PUCE POUR APPLICATIONS INTÉGRÉES FIABLES

Numéro de publication WO/2009/140707
Date de publication 26.11.2009
N° de la demande internationale PCT/AT2009/000207
Date du dépôt international 20.05.2009
CIB
G06F 15/78 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
15Calculateurs numériques en général; Équipement de traitement de données en général
76Architectures de calculateurs universels à programmes enregistrés
78comprenant une seule unité centrale
G06F 11/07 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
11Détection d'erreurs; Correction d'erreurs; Contrôle de fonctionnement
07Réaction à l'apparition d'un défaut, p.ex. tolérance de certains défauts
CPC
G06F 11/3636
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
36Preventing errors by testing or debugging software
362Software debugging
3636by tracing the execution of the program
G06F 15/7825
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
15Digital computers in general
76Architectures of general purpose stored program computers
78comprising a single central processing unit
7807System on chip, i.e. computer system on a single chip; System in package, i.e. computer system on one or more chips in a single package
7825Globally asynchronous, locally synchronous, e.g. network on chip
Déposants
  • TECHNISCHE UNIVERSITÄT WIEN [AT]/[AT] (AllExceptUS)
  • INTERUNIVERSITAIR MICRO-ELECTRONICA CENTRUM VZW PARTY'S [BE]/[BE] (AllExceptUS)
  • EL SALLOUM, Christian [AT]/[AT] (UsOnly)
  • HUBER, Bernhard [AT]/[AT] (UsOnly)
  • KOPETZ, Hermann [AT]/[AT] (UsOnly)
  • OBERMAISSER, Roman [AT]/[AT] (UsOnly)
  • ZAFALON, Roberto [IT]/[IT] (UsOnly)
  • GHERMAN, Valentin [RO]/[FR] (UsOnly)
  • KRONLOEF, Klaus [FI]/[FI] (UsOnly)
  • WARIS, Heikki [FI]/[FI] (UsOnly)
  • LENORMAND, Eric [FR]/[FR] (UsOnly)
  • MILLET, Philippe [FR]/[FR] (UsOnly)
  • BORTH, Michael [DE]/[NL] (UsOnly)
  • COUVREUR, Chantal [BE]/[BE] (UsOnly)
  • SURI, Neeraj [US]/[DE] (UsOnly)
  • CAMPOS, Sergio [ES]/[ES] (UsOnly)
  • OVASKA, Eila [FI]/[FI] (UsOnly)
  • TIENSYRJÄ, Kari [FI]/[FI] (UsOnly)
  • GOEDECKE, Michael [DE]/[DE] (UsOnly)
  • HUFELD, Knut [DE]/[DE] (UsOnly)
  • TAZARI, Mohammad-Reza [DE]/[DE] (UsOnly)
  • PEREZ BERDUD, Antonio [ES]/[ES] (UsOnly)
  • PEREZ CERROLAZA, Juan Martin [ES]/[ES] (UsOnly)
Inventeurs
  • EL SALLOUM, Christian
  • HUBER, Bernhard
  • KOPETZ, Hermann
  • OBERMAISSER, Roman
  • ZAFALON, Roberto
  • GHERMAN, Valentin
  • KRONLOEF, Klaus
  • WARIS, Heikki
  • LENORMAND, Eric
  • MILLET, Philippe
  • BORTH, Michael
  • COUVREUR, Chantal
  • SURI, Neeraj
  • CAMPOS, Sergio
  • OVASKA, Eila
  • TIENSYRJÄ, Kari
  • GOEDECKE, Michael
  • HUFELD, Knut
  • TAZARI, Mohammad-Reza
  • PEREZ BERDUD, Antonio
  • PEREZ CERROLAZA, Juan Martin
Mandataires
  • MATSCHNIG & FORSTHUBER
Données relatives à la priorité
A 819/200821.05.2008AT
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) CROSS-DOMAIN SOC ARCHITECTURE FOR DEPENDABLE EMBEDDED APPLICATIONS
(FR) ARCHITECTURE INTER-DOMAINE DE SYSTÈME-SUR-PUCE POUR APPLICATIONS INTÉGRÉES FIABLES
Abrégé
(EN)
A computer architecture for dependable distributed embedded systems is presented. This architecture consists of a plurality of computational units that are interconnected by a hierarchy of heterogeneous communication networks. At the lowest level, one or more functional units, at least one diagnostic unit and at least one security unit are allocated to a single MPSoC in order to support the dependable operation. These units interact via a deterministic network-on-chip. The unique integration of functionality, dependability and security concerns in a single deterministic SoC is an important innovative aspect of this new architecture.
(FR)
La présente invention concerne une architecture d'ordinateur pour des systèmes distribués intégrés fiables. Cette architecture comporte une pluralité d'unités de calcul qui sont interconnectées par une hiérarchie de réseaux de communication hétérogènes. Au niveau le plus bas, une ou plusieurs unités fonctionnelles, au moins une unité de diagnostic, et au moins une unité de sécurité sont affectées à un seul système-sur-puce multiprocesseur de façon à assurer le fonctionnement fiable. Ces unités sont en interaction par l'intermédiaire d'un réseau-sur-puce déterministique. L'intégration unique dans un seul système-sur-puce déterministique des sujets concernant les fonctionnalités, la fiabilité et la sécurité constitue un aspect innovant important de cette nouvelle architecture.
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