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1. WO2008008546 - ARCHITECTURE DE BALAYAGE RECONFIGURABLE UNIVERSELLE

Numéro de publication WO/2008/008546
Date de publication 17.01.2008
N° de la demande internationale PCT/US2007/016088
Date du dépôt international 16.07.2007
CIB
G01R 31/28 2006.01
GPHYSIQUE
01MÉTROLOGIE; TESTS
RMESURE DES VARIABLES ÉLECTRIQUES; MESURE DES VARIABLES MAGNÉTIQUES
31Dispositions pour tester les propriétés électriques; Dispositions pour la localisation des pannes électriques; Dispositions pour tests électriques caractérisées par ce qui est testé, non prévues ailleurs
28Test de circuits électroniques, p.ex. à l'aide d'un traceur de signaux
G11C 19/00 2006.01
GPHYSIQUE
11ENREGISTREMENT DE L'INFORMATION
CMÉMOIRES STATIQUES
19Mémoires numériques dans lesquelles l'information est déplacée par échelons, p.ex. registres à décalage
CPC
G01R 31/318536
GPHYSICS
01MEASURING; TESTING
RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
31Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
28Testing of electronic circuits, e.g. by signal tracer
317Testing of digital circuits
3181Functional testing
3185Reconfiguring for testing, e.g. LSSD, partitioning
318533using scanning techniques, e.g. LSSD, Boundary Scan, JTAG
318536Scan chain arrangements, e.g. connections, test bus, analog signals
Déposants
  • CHEN, Xinghao [US]/[US]
Inventeurs
  • CHEN, Xinghao
Mandataires
  • HOFFMAN, Bernard, S.
Données relatives à la priorité
60/831,26114.07.2006US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) UNIVERSAL RECONFIGURABLE SCAN ARCHITECTURE
(FR) ARCHITECTURE DE BALAYAGE RECONFIGURABLE UNIVERSELLE
Abrégé
(EN)
Universal reconfigurable scan architecture reconfigures scan structures via scan-load operation, thereby eliminating interconnect network distributing configuration signals, and employs common scan circuitry identical for designs at mask level and is suitable for ASIC implementations. The architecture includes reconfigurable scan cells, apparatus for distributing configuration data to the reconfigurable scan cells and for determining desired reconfiguration data for each of the reconfigurable scan cells, and a configuration-set (CS) signal. Each of the reconfigurable scan cells has a pass- through (PT) mode in which data input, either a scan-in (Sl) or a system-data (SD) of the scan cell, is transparently passed to a scan-out (SO) terminal of the scan cell without requiring a pulse on a shift clock (SC). The configuration-set (CS) signal communicates with each of the reconfigurable scan cells. A pulse on the configuration-set (CS) signal triggers PT Hold latches to capture configuration data from corresponding slave latches, which in turn set configurations of each of the reconfigurable scan cells.
(FR)
L'invention porte sur une architecture de balayage reconfigurable universelle qui permet de reconfigurer des structures de balayage par une opération de chargement de balayage, éliminant de la sorte le réseau d'interconnexion distribuant les signaux de configuration, laquelle architecture fait appel à des circuits de balayage courants identiques pour les modèles au niveau du masque et convient à la mise en oeuvre d'ASIC. L'architecture de l'invention comprend des cellules de balayage reconfigurables, un appareil qui permet de distribuer des données de configuration aux cellules de balayage reconfigurables et de déterminer des données de reconfiguration désirées pour chacune des cellules de balayage reconfigurables, et un signal de réglage de configuration ('configuration- set' ou CS). Chaque cellule de balayage reconfigurable possède un mode de passage ('pass-through' ou PT) dans lequel l'entrée de données, à savoir un balayage d'entrée ('scan-in' ou SI) ou des données système ('system-data' ou SD) de la cellule de balayage, est transmise de manière transparente à un terminal de balayage de sortie ('scan-out' ou SO) de la cellule de balayage sans nécessité d'une impulsion sur une horloge de décalage ('shift clock' ou SC). Le signal de réglage de configuration (CS) communique avec chacune des cellules de balayage reconfigurables. Une impulsion sur le signal de réglage de configuration CS déclenche des verrous PT Hold qui capturent les données de configuration en provenance de verrous esclaves correspondants, qui, à leur tour, règlent les configurations de chacune des cellules de balayage reconfigurables.
Également publié en tant que
US12321170
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