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1. (WO2007145034) PROCÉDÉ ET DISPOSITIF D'ENTRÉE SYNCHRONE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/145034    N° de la demande internationale :    PCT/JP2007/058979
Date de publication : 21.12.2007 Date de dépôt international : 25.04.2007
CIB :
H02J 3/42 (2006.01)
Déposants : YANMAR CO., LTD. [JP/JP]; 1-32, Chayamachi, Kita-ku, Osaka-shi, Osaka 5300013 (JP) (Tous Sauf US).
KIOI, Kazuchika [JP/JP]; (JP) (US Seulement).
TANIGUCHI, Tatsuo [JP/JP]; (JP) (US Seulement).
SATO, Masaharu [JP/JP]; (JP) (US Seulement).
NAKAGAWA, Tukasa [JP/JP]; (JP) (US Seulement).
AOKI, Kazuhira [JP/JP]; (JP) (US Seulement)
Inventeurs : KIOI, Kazuchika; (JP).
TANIGUCHI, Tatsuo; (JP).
SATO, Masaharu; (JP).
NAKAGAWA, Tukasa; (JP).
AOKI, Kazuhira; (JP)
Mandataire : YANO, Juichiro; YANO INTERNATIONAL PATENT OFFICE Twin 21 MID Tower 34th Floor, 1-61, Shiromi 2-chome, Chuo-ku, Osaka-shi, Osaka 5406134 (JP)
Données relatives à la priorité :
2006-165920 15.06.2006 JP
Titre (EN) SYNCHRONOUS INPUT METHOD AND SYNCHRONOUS INPUT DEVICE
(FR) PROCÉDÉ ET DISPOSITIF D'ENTRÉE SYNCHRONE
(JA) 同期投入方法及び同期投入装置
Abrégé : front page image
(EN)A synchronous input device (10) comprises means (11, 15) for detecting the voltage difference between the bus side and the input side, means (12, 14) for detecting the frequency difference between the bus side and the input side, a means (13) for detecting the phase difference between the bus side and the input side, a setter (25) for storing the input time difference from a input command to the arrival as a delay phase difference for every preset frequency difference, and an operating circuit (20) which can select a delay phase difference from the storage means depending on the bus side frequency at the time of synchronous input.
(FR)La présente invention concerne un dispositif d'entrée synchrone (10) qui comprend : des moyens (11, 15) permettant de détecter la différence de tension entre le côté bus et le côté entrée ; des moyens (12, 14) permettant de détecter la différence de fréquence entre le côté bus et le côté entrée ; des moyens (13) permettant de détecter le déphasage entre le côté bus et le côté entrée ; un organe de réglage (25) permettant de stocker la différence de temps de l'entrée, de la commande de l'entrée à son arrivée, en tant que différence de phase de délai pour chaque différence de fréquence préétablie ; et un circuit de fonctionnement (20) qui peut sélectionner une différence de phase de délai provenant des moyens de stockage en fonction de la fréquence côté bus au moment de l'entrée synchrone.
(JA) 母線側と投入側との電圧差を検知する電圧差検知手段11・15と、母線側と投入側との周波数差を検知する周波数差検知手段12・14と、母線側と投入側との位相差を検知する位相差検知手段13と、投入指令から到達までの投入時間差を、予め設定した周波数差毎の遅れ位相差として記憶する設定器25と、同期投入時に母線側周波数に応じて前記遅れ位相差を前記記憶手段から選択可能な演算回路20を備えた同期投入装置10を提供する。  
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)