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Paramétrages

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1. WO2007138124 - PROCÉDÉ, APPAREIL ET SYSTÈME APPLIQUÉS À UN PROTOCOLE DE COHÉRENCE D'UNE MÉMOIRE CACHE

Numéro de publication WO/2007/138124
Date de publication 06.12.2007
N° de la demande internationale PCT/ES2006/070074
Date du dépôt international 30.05.2006
CIB
G06F 12/08 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
CPC
G06F 12/0831
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0806Multiuser, multiprocessor or multiprocessing cache systems
0815Cache consistency protocols
0831using a bus scheme, e.g. with bus monitoring or watching means
G06F 2212/507
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
2212Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
50Control mechanisms for virtual memory, cache or TLB
507using speculative control
Déposants
  • INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95052, US (AllExceptUS)
  • MADRILES GIMENO, Carlos [ES/ES]; ES (UsOnly)
  • GARCIA QUIÑONES, Carlos [ES/ES]; ES (UsOnly)
  • MARCUELLO, Pedro [ES/ES]; ES (UsOnly)
  • SANCHEZ, Jesús [ES/ES]; ES (UsOnly)
  • LATORRE, Fernando [ES/ES]; ES (UsOnly)
  • GONZALEZ, Antonio [ES/ES]; ES (UsOnly)
Inventeurs
  • MADRILES GIMENO, Carlos; ES
  • GARCIA QUIÑONES, Carlos; ES
  • MARCUELLO, Pedro; ES
  • SANCHEZ, Jesús; ES
  • LATORRE, Fernando; ES
  • GONZALEZ, Antonio; ES
Mandataires
  • DE ELZABURU MARQUEZ, Alberto; Calle Miguel Ángel, 21 E-28010 Madrid, ES
Données relatives à la priorité
Langue de publication espagnol (ES)
Langue de dépôt espagnol (ES)
États désignés
Titre
(EN) METHOD, APPARATUS AND SYSTEM APPLIED IN A CACHE MEMORY COHERENCE PROTOCOL
(ES) MÉTODO APARATO Y SISTEMA APLICADO EN UN PROTOCOLO DE COHERENCIA DE UNA MEMORIA CACHE
(FR) PROCÉDÉ, APPAREIL ET SYSTÈME APPLIQUÉS À UN PROTOCOLE DE COHÉRENCE D'UNE MÉMOIRE CACHE
Abrégé
(EN)
In one embodiment, the present invention includes a method for receiving a bus message in a first cache memory corresponding to a speculative access to a portion of a second cache memory by a second wire and dynamically determining in the first cache memory whether there is a dependency between wires, between the second wire and a first wire associated with the first cache memory with respect to said portion. Further embodiments are described and claimed.
(ES)
En una realización, el presente invento incluye un método para recibir un mensaje de bus en una primera memoria cache correspondiente a un acceso especulativo a una parte de una segunda memoria cache por un segundo hilo, y determinar dinámicamente en la primera memoria cache si existe una dependencia entre hilos, entre el segundo hilo y un primer hilo asociado con la primera memoria cache con respecto a esa una parte. Se describen y se reivindican otras realizaciones.
(FR)
L'un des mode de réalisation de cette invention comprend un procédé destiné à recevoir un message de bus dans une première mémoire cache correspondant à un accès spéculatif à une partie d'une seconde mémoire cache par un second fil, et à déterminer de façon dynamique dans la première mémoire cache s'il existe une dépendance entre les fils, entre le second et un premier fil associé à la première mémoire cache par rapport à cette partie. D'autres modes de réalisation sont également décrits et revendiqués.
Également publié en tant que
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