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1. (WO2007138124) PROCÉDÉ, APPAREIL ET SYSTÈME APPLIQUÉS À UN PROTOCOLE DE COHÉRENCE D'UNE MÉMOIRE CACHE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/138124    N° de la demande internationale :    PCT/ES2006/070074
Date de publication : 06.12.2007 Date de dépôt international : 30.05.2006
CIB :
G06F 12/08 (2006.01)
Déposants : INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, California 95052 (US) (Tous Sauf US).
MADRILES GIMENO, Carlos [ES/ES]; (ES) (US Seulement).
GARCIA QUIÑONES, Carlos [ES/ES]; (ES) (US Seulement).
MARCUELLO, Pedro [ES/ES]; (ES) (US Seulement).
SANCHEZ, Jesús [ES/ES]; (ES) (US Seulement).
LATORRE, Fernando [ES/ES]; (ES) (US Seulement).
GONZALEZ, Antonio [ES/ES]; (ES) (US Seulement)
Inventeurs : MADRILES GIMENO, Carlos; (ES).
GARCIA QUIÑONES, Carlos; (ES).
MARCUELLO, Pedro; (ES).
SANCHEZ, Jesús; (ES).
LATORRE, Fernando; (ES).
GONZALEZ, Antonio; (ES)
Mandataire : DE ELZABURU MARQUEZ, Alberto; Calle Miguel Ángel, 21, E-28010 Madrid (ES)
Données relatives à la priorité :
Titre (EN) METHOD, APPARATUS AND SYSTEM APPLIED IN A CACHE MEMORY COHERENCE PROTOCOL
(ES) MÉTODO APARATO Y SISTEMA APLICADO EN UN PROTOCOLO DE COHERENCIA DE UNA MEMORIA CACHE
(FR) PROCÉDÉ, APPAREIL ET SYSTÈME APPLIQUÉS À UN PROTOCOLE DE COHÉRENCE D'UNE MÉMOIRE CACHE
Abrégé : front page image
(EN)In one embodiment, the present invention includes a method for receiving a bus message in a first cache memory corresponding to a speculative access to a portion of a second cache memory by a second wire and dynamically determining in the first cache memory whether there is a dependency between wires, between the second wire and a first wire associated with the first cache memory with respect to said portion. Further embodiments are described and claimed.
(ES)En una realización, el presente invento incluye un método para recibir un mensaje de bus en una primera memoria cache correspondiente a un acceso especulativo a una parte de una segunda memoria cache por un segundo hilo, y determinar dinámicamente en la primera memoria cache si existe una dependencia entre hilos, entre el segundo hilo y un primer hilo asociado con la primera memoria cache con respecto a esa una parte. Se describen y se reivindican otras realizaciones.
(FR)L'un des mode de réalisation de cette invention comprend un procédé destiné à recevoir un message de bus dans une première mémoire cache correspondant à un accès spéculatif à une partie d'une seconde mémoire cache par un second fil, et à déterminer de façon dynamique dans la première mémoire cache s'il existe une dépendance entre les fils, entre le second et un premier fil associé à la première mémoire cache par rapport à cette partie. D'autres modes de réalisation sont également décrits et revendiqués.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : espagnol (ES)
Langue de dépôt : espagnol (ES)