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Paramétrages

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1. WO2005006185 - TECHNIQUE DE PARTAGE DE REGISTRES PAR FILIERES CROISEES

Numéro de publication WO/2005/006185
Date de publication 20.01.2005
N° de la demande internationale PCT/US2004/018419
Date du dépôt international 09.06.2004
CIB
G06F 9/30 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
G06F 9/38 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
38Exécution simultanée d'instructions
G06F 9/46 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
46Dispositions pour la multiprogrammation
CPC
G06F 9/30181
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
30181Instruction operation extension or modification
G06F 9/384
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
38Concurrent instruction execution, e.g. pipeline, look ahead
3836Instruction issuing, e.g. dynamic instruction scheduling, out of order instruction execution
3838Dependency mechanisms, e.g. register scoreboarding
384Register renaming
G06F 9/3851
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
38Concurrent instruction execution, e.g. pipeline, look ahead
3836Instruction issuing, e.g. dynamic instruction scheduling, out of order instruction execution
3851from multiple instruction streams, e.g. multistreaming
Déposants
  • INTEL CORPORATION [US/US]; (a Delaware corporation) 2200 Mission College Boulevard Santa Clara, CA 95052, US (AllExceptUS)
Inventeurs
  • SAMRA, Nicholas; US
  • HUANG, Andrew; US
Mandataires
  • VINCENT, Lester, J. ; BLAKELY SOKOLOFF TAYOR & ZAFMAN 12400 Wilshire Boulevard, 7th Floor Los Angeles, CA 90025, US
Données relatives à la priorité
10/609,26426.06.2003US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) CROSS-THREAD REGISTER SHARING TECHNIQUE
(FR) TECHNIQUE DE PARTAGE DE REGISTRES PAR FILIERES CROISEES
Abrégé
(EN)
A technique for sharing register resources within a mücroprocessor. Embodiments of the invention pertain to a register sharing technique within a microprocessor for rnultiple-threads of instructions that facilitates an optimal number of physical registers to be mapped to a desired numiber of logical registers without incurring significant hardware overhead.
(FR)
L'invention se rapporte à une technique permettant de partager des ressources de registres au sein d'un microprocesseur. Dans certains modes de réalisation, cette invention concerne une technique de partage de registres au sein d'un microprocesseur pour des filières d'instructions multiples, qui facilite l'association d'un nombre optimal de registres physiques avec un nombre souhaité de registres logiques, sans engendrer de surcharge matérielle significative.
Également publié en tant que
Dernières données bibliographiques dont dispose le Bureau international