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1. WO2004099995 - ACCES MEMOIRE HIERARCHIQUE PAR TRAITEMENT EN PIPELINE

Numéro de publication WO/2004/099995
Date de publication 18.11.2004
N° de la demande internationale PCT/IB2004/001397
Date du dépôt international 06.05.2004
CIB
G06F 12/08 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
02Adressage ou affectation; Réadressage
08dans des systèmes de mémoires hiérarchiques, p.ex. des systèmes de mémoire virtuelle
G06F 13/16 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
14Traitement de demandes d'interconnexion ou de transfert
16pour l'accès au bus de mémoire
CPC
G06F 13/1615
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
13Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
14Handling requests for interconnection or transfer
16for access to memory bus
1605based on arbitration
161with latency improvement
1615using a concurrent pipeline structrure
G06F 13/1663
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
13Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
14Handling requests for interconnection or transfer
16for access to memory bus
1605based on arbitration
1652in a multiprocessor architecture
1663Access to shared memory
Déposants
  • KONINKLIJKE PHILIPS ELECTRONICS N.V. [NL]/[NL] (AllExceptUS)
  • U.S. PHILIPS CORPORATION [US]/[US] (AE)
  • ROEVER, Jens A. [DE]/[US] (UsOnly)
Inventeurs
  • ROEVER, Jens A.
Mandataires
  • KONINKLIJKE PHILIPS ELECTRONICS N.V.
Données relatives à la priorité
60/469,60709.05.2003US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) HIERARCHICAL MEMORY ACCESS VIA PIPELINING
(FR) ACCES MEMOIRE HIERARCHIQUE PAR TRAITEMENT EN PIPELINE
Abrégé
(EN)
A memory access system (100) transfers data to and from a shared memory via a pipeline architecture. The granting of a memory access request effects a substantially direct connection between the requesting process and the pipeline. During a write operation, the requesting process (P1-Pn) pipes the data into the pipeline, and is assured that the data will eventually arrive at the target memory (180) in the order in which it was provided to the pipe. During a read operation, the memory (180) pipes the data into the pipeline, and is assured that the appropriate requesting process (P1-Pn) will be connected to the pipe to receive its data at the other end of the pipe. The sequencing of processes onto the pipe is controlled by a flag that is attached to the last element of each data block in the pipe.
(FR)
Système (100) permettant l'accès à une mémoire et assurant le transfert de données de et vers une mémoire commune par l'intermédiaire d'une architecture en pipeline. L'accession à une demande d'accès mémoire crée une connexion sensiblement directe entre le processus de demande et le pipeline. Lors d'une opération d'écriture, le processus de demande (P1-Pn) introduit les données dans le pipeline, et reçoit l'assurance que les données arriveront dans la mémoire cible (180) dans l'ordre dans lequel elles ont été introduites dans le pipeline. Lors d'une opération de lecture, la mémoire (180) introduit les données dans le pipeline, et reçoit l'assurance que les processus de demande appropriés (P1-Pn) seront connectés au pipeline afin de recevoir ces données à l'autre extrémité du pipeline. L'introduction séquencée des processus dans le pipeline est commandée par un drapeau fixé aux dernier élément de chaque bloc de données dans le pipeline.
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