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Paramétrages

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1. WO2003009551 - RECEPTEUR DE SIGNAUX NUMERIQUES OPERANT AU-DELA DE LA FREQUENCE 3DB

Numéro de publication WO/2003/009551
Date de publication 30.01.2003
N° de la demande internationale PCT/BE2002/000124
Date du dépôt international 17.07.2002
Demande présentée en vertu du Chapitre 2 07.02.2003
CIB
H04L 25/02 2006.01
HÉLECTRICITÉ
04TECHNIQUE DE LA COMMUNICATION ÉLECTRIQUE
LTRANSMISSION D'INFORMATION NUMÉRIQUE, p.ex. COMMUNICATION TÉLÉGRAPHIQUE
25Systèmes à bande de base
02Détails
CPC
H04L 25/0272
HELECTRICITY
04ELECTRIC COMMUNICATION TECHNIQUE
LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
25Baseband systems
02Details
0264Arrangements for coupling to transmission lines
0272Arrangements for coupling to multiple lines, e.g. for differential transmission
H04L 25/0292
HELECTRICITY
04ELECTRIC COMMUNICATION TECHNIQUE
LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
25Baseband systems
02Details
0264Arrangements for coupling to transmission lines
0292Arrangements specific to the receiver end
H04L 25/03878
HELECTRICITY
04ELECTRIC COMMUNICATION TECHNIQUE
LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
25Baseband systems
02Details
03Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
03878Line equalisers; line build-out devices
Déposants
  • VRIJE UNIVERSITEIT BRUSSEL (VUB) [BE/BE]; Pleinlaan 2 B-1050 BRUSSELS, BE (AllExceptUS)
  • KUIJK, Maarten [BE/BE]; BE (UsOnly)
Inventeurs
  • KUIJK, Maarten; BE
Mandataires
  • VAN MALDEREN, Joëlle ; Office Van Malderen Place Reine Fabiola 6/1 B-1083 Brussels, BE
Données relatives à la priorité
60/306,22318.07.2001US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) LINE EQUALIZER WITH DIFFERENTIATING CIRCUIT AND HYSTERESIS DECODER
(FR) RECEPTEUR DE SIGNAUX NUMERIQUES OPERANT AU-DELA DE LA FREQUENCE 3DB
Abrégé
(EN)
The present invention concerns a receiver (40) for digital data for connection to a preceding signal path, said digital data having a lower to upper data frequency range, comprising. A received signal input terminal Vin connected to a higher frequency gain circuit (43) that shows highest transfer amplitude at said upper data frequency within said lower to upper data frequency range where the signal has been attenuated in its higher frequency components in said preceding signal path and providing an amplified signal at an amplified signal output terminal. A latching circuit (45) with two threshold levels, said latching structure being connected with an input terminal to said amplified signal output terminal and an output terminal providing a digital output signal.
(FR)
L'invention concerne un récepteur de données numériques pour connexion à un parcours du signal qui précède. Les données numériques présentent une gamme de fréquences inférieures à supérieures comprenant un terminal d'entrée du signal reçu relié à un circuit à gain haute fréquence présentant une très haute amplitude de transfert au niveau de ladite fréquence supérieure de données à l'intérieur de ladite gamme de fréquence de données inférieures à supérieures, le signal ayant été atténué au niveau de ses composants haute fréquence dans le parcours du signal qui précède, et un signal amplifié fourni au niveau d'un terminal de sortie du signal amplifié; et un circuit de verrouillage à deux seuils, la structure de verrouillage étant connectée avec un terminal d'entrée audit terminal de sortie du signal amplifié, un signal de sortie numérique étant fourni par un terminal de sortie.
Également publié en tant que
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