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1. WO1999060471 - CONTROLEUR DE PILE DE DISQUES

Numéro de publication WO/1999/060471
Date de publication 25.11.1999
N° de la demande internationale PCT/JP1998/002176
Date du dépôt international 18.05.1998
Demande présentée en vertu du Chapitre 2 03.07.1998
CIB
G06F 3/06 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
3Dispositions d'entrée pour le transfert de données à traiter pour leur donner une forme utilisable par le calculateur; Dispositions de sortie pour le transfert de données de l'unité de traitement à l'unité de sortie, p.ex. dispositions d'interface
06Entrée numérique à partir de, ou sortie numérique vers des supports d'enregistrement
G06F 12/00 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12Accès à, adressage ou affectation dans des systèmes ou des architectures de mémoires
CPC
G06F 11/1666
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
16Error detection or correction of the data by redundancy in hardware
1666where the redundant component is memory or memory area
G06F 11/2007
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
16Error detection or correction of the data by redundancy in hardware
20using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
2002where interconnections or communication control functionality are redundant
2007using redundant communication media
G06F 11/201
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
16Error detection or correction of the data by redundancy in hardware
20using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
2002where interconnections or communication control functionality are redundant
2007using redundant communication media
201between storage system components
G06F 12/084
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0806Multiuser, multiprocessor or multiprocessing cache systems
084with a shared cache
G06F 12/0866
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
12Accessing, addressing or allocating within memory systems or architectures
02Addressing or allocation; Relocation
08in hierarchically structured memory systems, e.g. virtual memory systems
0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
0866for peripheral storage systems, e.g. disk cache
G06F 3/061
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
3Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
06Digital input from or digital output to record carriers ; , e.g. RAID, emulated record carriers, networked record carriers
0601Dedicated interfaces to storage systems
0602specifically adapted to achieve a particular effect
061Improving I/O performance
Déposants
  • HITACHI, LTD. [JP]/[JP] (AllExceptUS)
  • FUJIMOTO, Kazuhisa [JP]/[JP] (UsOnly)
  • FUJIBAYASHI, Akira [JP]/[JP] (UsOnly)
  • MINOWA, Nobuyuki [JP]/[JP] (UsOnly)
Inventeurs
  • FUJIMOTO, Kazuhisa
  • FUJIBAYASHI, Akira
  • MINOWA, Nobuyuki
Mandataires
  • OGAWA, Katsuo
Données relatives à la priorité
Langue de publication japonais (JA)
Langue de dépôt japonais (JA)
États désignés
Titre
(EN) DISC ARRAY CONTROLLER
(FR) CONTROLEUR DE PILE DE DISQUES
Abrégé
(EN)
It has been demanded to develop a large scale memory device system operable without interruption. Further, in order to cope with the recent trend toward open systems, scalability of performance and capacity is needed. Conventionally, internal buses, such as the ones which connect the channel I/F section to the shared memory section and the disc I/F section to the shared memory section, are mounted on one platter, and the package of the channel I/F and so forth are mounted thereon. When the internal buses have failed, the operation of the whole system must be stopped. There is another problem that the performance of the internal buses is fixed. A disc array controller according to the invention comprises an interface platter on which a channel interface section and a disc interface section are mounted, a memory platter on which a shared memory section is mounted, and a cable which connects the interface platter to the memory platter in order to solve the above problems.
(FR)
L'invention répond à une demande de mettre au point un système de mémoire à grande échelle pouvant fonctionner sans interruption. La tendance actuelle des systèmes ouverts, demande en outre des possibilités d'échelonnement de la performance et de la capacité. Dans les modèles conventionnels, les bus internes tels que ceux qui connectent la section d'interface de canal à la section mémoire commune et la section d'interface de disque avec la section mémoire commune, sont montés sur une platine unique et l'ensemble de l'interface de canal etc. est monté là-dessus. En cas de panne des bus internes, le fonctionnement de l'ensemble du système doit être interrompu. Un autre problème découle du fait que la performance des bus est fixe. Le présent contrôleur de pile de disques comprend une platine d'interface qui présente une section d'interface de canal et une section d'interface de disque, une platine mémoire qui comprend une section mémoire commune, et un câble qui connecte le plateau d'interface au disque mémoire ce qui permet de résoudre les problèmes évoqués ci-dessus.
Également publié en tant que
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