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1. (WO1986003608) PROCEDE ET APPAREIL DE GESTION DE FILES D'ATTENTE
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/1986/003608 N° de la demande internationale : PCT/US1985/002364
Date de publication : 19.06.1986 Date de dépôt international : 27.11.1985
CIB :
G06F 13/16 (2006.01) ,G06F 5/10 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13
Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
14
Traitement de demandes d'interconnexion ou de transfert
16
pour l'accès au bus de mémoire
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
5
Procédés ou dispositions pour la conversion de données, sans modification de l'ordre ou du contenu des données manipulées
06
pour modifier la vitesse de débit des données, c. à d. régularisation de la vitesse
10
ayant une séquence d'emplacements d'emmagasinage, chacun étant individuellement accessible à la fois pour des opérations de mise en file d'attente et pour des opérations de retrait de file d'attente, p.ex. utilisant une mémoire à accès aléatoire
Déposants :
AMERICAN TELEPHONE & TELEGRAPH COMPANY [US/US]; 550 Madison Avenue New York, NY 10022, US
Inventeurs :
SCHROFER, Eldred, Peter; US
Mandataire :
HIRSCH, A., E., Jr. @; Post Office Box 901 Princeton, NJ 08540, US
Données relatives à la priorité :
678,89806.12.1984US
Titre (EN) QUEUE ADMINISTRATION METHOD AND APPARATUS
(FR) PROCEDE ET APPAREIL DE GESTION DE FILES D'ATTENTE
Abrégé :
(EN) A memory subcontroller (203) of a computer (100) includes a queue (301) for storing read and write requests issued by memory using units (101-103) to a memory (104), apparatus (303, 304) for executing requests on the memory, and a circuit (302) for administering the queue. When the queue is empty and the executing apparatus is ready to receive a request for execution, a request incoming from a using unit bypasses the queue: it is received by the executing apparatus directly and is not stored in the queue. Otherwise, the queue administration circuit stores the request in the queue and then awaits results of validity checks on the stored request. If the request is found to be invalid, generally the administration circuit discards the request from the queue by freeing the queue location (210) or locations that store the invalid request to store the next received request. The invalid request is then overwritten by the next received request.
(FR) Un sous-contrôleur (203) de la mémoire d'un ordinateur (100) comprend une file d'attente (301) pour enregistrer les demandes de lecture et d'écriture transmises à une mémoire (104) par des unités (101-103) utilisatrices de la mémoire, un appareil (303, 304) pour exécuter les demandes faites à la mémoire, et un circuit (302) pour gérer la file d'attente. Lorsque la file d'attente est vide et l'appareil d'exécution est prêt à recevoir une demande d'exécution, une demande arrivant d'une unité utilisatrice contourne la file d'attente; elle est directement reçue par l'appareil d'exécution et n'est pas enregistrée dans la file d'attente. Autrement, le circuit de gestion de la file d'attente enregistre la demande dans la file d'attente et attend ensuite le resultat d'une vérification de la validité de la demande enregistrée. Si la demande se révèle erronée, en général le circuit de gestion élimine la demande de la file d'attente en libérant l'emplacement (210) ou les emplacements où est enregistrée la demande erronée afin de pouvoir y enregistrer la prochaine demande reçue. Celle-ci se superpose ensuite à la demande erronée.
États désignés : JP, KR
Office européen des brevets (OEB) (AT, BE, CH, DE, FR, GB, IT, LU, NL, SE)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)
Also published as:
ES8800767EP0203993ES549614CA1237525KR10199300063843