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1. (WO2019031029) PHOTOELECTRIC CONVERSION ELEMENT PRODUCTION METHOD
国际局存档的最新著录项目数据提交意见

公布号: WO/2019/031029 国际申请号: PCT/JP2018/020598
公布日: 14.02.2019 国际申请日: 29.05.2018
国际专利分类:
H01L 31/18 (2006.01) ,C23C 16/44 (2006.01) ,C23C 16/50 (2006.01) ,H01L 21/205 (2006.01) ,H01L 21/31 (2006.01) ,H01L 21/683 (2006.01) ,H01L 31/0747 (2012.01)
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
31
对红外辐射、光、较短波长的电磁辐射,或微粒辐射敏感的,并且专门适用于把这样的辐射能转换为电能的,或者专门适用于通过这样的辐射进行电能控制的半导体器件;专门适用于制造或处理这些半导体器件或其部件的方法或设备;其零部件
18
专门适用于制造或处理这些器件或其部件的方法或设备
C 化学;冶金
23
对金属材料的镀覆;用金属材料对材料的镀覆;表面化学处理;金属材料的扩散处理;真空蒸发法、溅射法、离子注入法或化学气相沉积法的一般镀覆;金属材料腐蚀或积垢的一般抑制
C
金属材料的表面处理
16
通过气态化合物分解且表面材料的反应产物不留存于镀层中的化学镀覆,例如化学气相沉积(CVD)工艺
44
以镀覆方法为特征的
C 化学;冶金
23
对金属材料的镀覆;用金属材料对材料的镀覆;表面化学处理;金属材料的扩散处理;真空蒸发法、溅射法、离子注入法或化学气相沉积法的一般镀覆;金属材料腐蚀或积垢的一般抑制
C
金属材料的表面处理
16
通过气态化合物分解且表面材料的反应产物不留存于镀层中的化学镀覆,例如化学气相沉积(CVD)工艺
44
以镀覆方法为特征的
50
借助放电的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
02
半导体器件或其部件的制造或处理
04
至少具有一个跃变势垒或表面势垒的器件,例如PN结、耗尽层、载体集结层
18
器件有由周期表第Ⅳ族元素或含有/不含有杂质的AⅢBⅤ族化合物构成的半导体,如掺杂材料
20
半导体材料在基片上的沉积,例如外延生长
205
应用气态化合物的还原或分解产生固态凝结物的,即化学沉积
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
02
半导体器件或其部件的制造或处理
04
至少具有一个跃变势垒或表面势垒的器件,例如PN结、耗尽层、载体集结层
18
器件有由周期表第Ⅳ族元素或含有/不含有杂质的AⅢBⅤ族化合物构成的半导体,如掺杂材料
30
用H01L 21/20至H01L 21/26各组不包含的方法或设备处理半导体材料的
31
在半导体材料上形成绝缘层的,例如用于掩膜的或应用光刻技术的;以及这些层的后处理;这些层的材料的选择
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
67
专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
683
用于支承或夹紧的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
31
对红外辐射、光、较短波长的电磁辐射,或微粒辐射敏感的,并且专门适用于把这样的辐射能转换为电能的,或者专门适用于通过这样的辐射进行电能控制的半导体器件;专门适用于制造或处理这些半导体器件或其部件的方法或设备;其零部件
04
用作转换器件的
06
以至少有一个电位跃变势垒或表面势垒的为特征的
072
只是PN异质结型势垒的
0745
包括AIVBIV的异质结,例如Si/Ge, SiGe/Si 或Si/SiC太阳能电池
0747
包括结晶材料和非晶材料的异质结,例如具有本征薄层的异质结或HIT®太阳能电池
申请人:
株式会社カネカ KANEKA CORPORATION [JP/JP]; 大阪府大阪市北区中之島2-3-18 2-3-18, Nakanoshima, Kita-ku, Osaka-shi, Osaka 5308288, JP
发明人:
福田 将典 FUKUDA, Masanori; JP
波内 俊文 NAMIUCHI, Toshifumi; JP
松田 高洋 MATSUDA, Takahiro; JP
代理人:
特許業務法人はるか国際特許事務所 HARUKA PATENT & TRADEMARK ATTORNEYS; 東京都千代田区六番町3 六番町SKビル5階 Rokubancho SK Bldg. 5th Floor, 3, Rokubancho, Chiyoda-ku, Tokyo 1020085, JP
优先权数据:
2017-15443409.08.2017JP
2017-15443509.08.2017JP
2017-15443609.08.2017JP
标题 (EN) PHOTOELECTRIC CONVERSION ELEMENT PRODUCTION METHOD
(FR) PROCÉDÉ DE FABRICATION D'ÉLÉMENT DE CONVERSION PHOTOÉLECTRIQUE
(JA) 光電変換素子の製造方法
摘要:
(EN) The present invention provides a production method for a photoelectric conversion element having a first and second main surface and including a first thin film formed on the first main surface side of the semiconductor substrate and a second thin film formed on the second main surface side of the semiconductor substrate, the method comprising a first disposition step of disposing, at a first film-forming position (81) in a first film-forming room (61), a first semiconductor substrate whereon no first thin film and no second thin film have been formed, a second disposition step of disposing, at a second film-forming position (82) in the first film-forming room (61), a second semiconductor substrate having at least a first thin film formed on the first main surface side and no second thin film formed on the second main surface side, and a first film-forming step of forming, in the first film-forming room (61) and within the same time period, the first thin film on the first main surface side of the first semiconductor substrate and the second thin film on the second main surface side of the second semiconductor substrate.
(FR) La présente invention concerne un procédé de fabrication d'un élément de conversion photoélectrique possédant une première et une seconde surface principale et comprenant un premier film mince formé du côté première surface principale du substrat semi-conducteur et un second film mince formé du côté seconde surface principale du substrat semi-conducteur, le procédé comprenant une première étape de disposition consistant à disposer, au niveau d'une première position (81) de formation de film dans une première salle (61) de formation de film, un premier substrat semi-conducteur sur lequel aucun premier film mince et aucun second film mince n'ont été formés, une seconde étape de disposition consistant à disposer, au niveau d'une seconde position (82) de formation de film dans la première salle (61) de formation de film, un second substrat semi-conducteur possédant au moins un premier film mince formé du côté première surface principale et aucun second film mince formé du côté seconde surface principale, et une première étape de formation de film consistant à former, dans la première salle (61) de formation de film et dans la même période, le premier film mince du côté première surface principale du premier substrat semi-conducteur et le second film mince du côté seconde surface principale du second substrat semi-conducteur.
(JA) 本開示の光電変換素子の製造方法は、第1、第2の主面を有し、半導体基板の第1の主面側に形成された第1の薄膜と、半導体基板の前記第2の主面側に形成された第2の薄膜と、を含む光電変換素子の製造方法であって、第1の薄膜及び第2の薄膜が形成されていない第1の半導体基板を、第1の製膜室(61)における第1の製膜位置(81)に配置する第1の配置ステップと、第1の主面側には少なくとも第1の薄膜が形成され、第2の主面側には第2の薄膜が形成されていない第2の半導体基板を、第1の製膜室(61)における第2の製膜位置(82)に配置する第2の配置ステップと、第1の製膜室(61)において、第1の半導体基板の第1の主面側には第1の薄膜を、第2の半導体基板の第2の主面側には第2の薄膜を、同一期間内に形成する第1の製膜ステップと、を含む。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
非洲地区知识产权组织 (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
欧亚专利局 (EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧洲专利局 (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
非洲知识产权组织 (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
公布语言: 日语 (JA)
申请语言: 日语 (JA)