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1. (WO2018180022) PULSE POSITION MODULATION CIRCUIT
国际局存档的最新著录项目数据提交意见

公布号: WO/2018/180022 国际申请号: PCT/JP2018/006037
公布日: 04.10.2018 国际申请日: 20.02.2018
国际专利分类:
H04L 25/49 (2006.01) ,H03K 5/134 (2014.01)
H 电学
04
电通信技术
L
数字信息的传输,例如电报通信
25
基带系统
38
同步或起止系统,例如用于波特码
40
发送电路;接收电路
49
在发射机处应用码变换;应用预失真;插入空码以得到所需频谱;应用3个或3个以上的幅度电平
[IPC code unknown for H03K 5/134]
申请人:
富士通株式会社 FUJITSU LIMITED [JP/JP]; 神奈川県川崎市中原区上小田中4丁目1番1号 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588, JP
发明人:
曽我 育生 SOGA, Ikuo; JP
大石 和明 OISHI, Kazuaki; JP
松村 宏志 MATSUMURA, Hiroshi; JP
川野 陽一 KAWANO, Yoichi; JP
中舍 安宏 NAKASHA, Yasuhiro; JP
代理人:
向山 直樹 MUKOUYAMA, Naoki; JP
优先权数据:
2017-06339128.03.2017JP
标题 (EN) PULSE POSITION MODULATION CIRCUIT
(FR) CIRCUIT DE MODULATION DE POSITION D'IMPULSION
(JA) パルス位置変調回路
摘要:
(EN) [Problem] To provide a pulse position modulation circuit capable of suppressing variations in delay time. [Solution] This pulse position modulation circuit is provided with: a delay path that comprises a plurality of delay devices connected in series, wherein a clock passes through the plurality of delay devices; and a switching circuit that, in accordance with input data, switches the time by which the clock is delayed in each of the plurality of delay devices. For example, in accordance with the input data the switching circuit switches a control signal for controlling the time by which the clock is delayed in each of the plurality of delay devices. For example, each of the plurality of delay devices comprises a plurality of control paths, and the switching circuit selects, in accordance with the input data, a path from among the plurality of control paths controlling the time by which the clock is delayed in accordance with the control signal.
(FR) [Problème] Fournir un circuit de modulation de position d'impulsion capable de supprimer les variations de temps de retard. La solution selon l'invention porte sur un circuit de modulation de position d'impulsion qui comprend : un chemin à retard qui comprend une pluralité de dispositifs à retard reliés en série, une horloge passant à travers la pluralité de dispositifs à retard; et un circuit de commutation qui, en fonction de données d'entrée, commute l'heure à laquelle l'horloge est retardée dans chacun de la pluralité de dispositifs à retard. Par exemple, conformément aux données d'entrée, le circuit de commutation commute un signal de commande pour commander l'heure à laquelle l'horloge est retardée dans chacun de la pluralité de dispositifs à retard. Par exemple, chacun de la pluralité de dispositifs à retard comprend une pluralité de chemins de commande, et le circuit de commutation sélectionne, en fonction des données d'entrée, un chemin parmi la pluralité de chemins de commande commandant l'heure à laquelle l'horloge est retardée en fonction du signal de commande.
(JA) 【課題】遅延時間のばらつきを抑制できるパルス位置変調回路を提供すること。 【解決手段】直列に接続された複数の遅延器を有し、クロックが前記複数の遅延器を通過する遅延経路と、前記クロックが前記複数の遅延器のそれぞれで遅延する時間を入力データに応じて切り替える切り替え回路とを備える、パルス位置変調回路。例えば、前記切り替え回路は、前記クロックが前記複数の遅延器のそれぞれで遅延する時間を制御する制御信号を前記入力データに応じて切り替える。例えば、前記複数の遅延器のそれぞれは、複数の制御経路を有し、前記切り替え回路は、前記クロックが遅延する時間を前記制御信号に応じて制御する経路を、前記複数の制御経路の中から前記入力データに応じて選択する。
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公布语言: 日语 (JA)
申请语言: 日语 (JA)