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1. (WO2018166024) TFT的制造方法及阵列基板的制造方法
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公布号: WO/2018/166024 国际申请号: PCT/CN2017/080406
公布日: 20.09.2018 国际申请日: 13.04.2017
国际专利分类:
H01L 21/336 (2006.01) ,H01L 21/28 (2006.01) ,H01L 29/786 (2006.01) ,H01L 21/77 (2017.01) ,H01L 27/12 (2006.01)
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
02
半导体器件或其部件的制造或处理
04
至少具有一个跃变势垒或表面势垒的器件,例如PN结、耗尽层、载体集结层
18
器件有由周期表第Ⅳ族元素或含有/不含有杂质的AⅢBⅤ族化合物构成的半导体,如掺杂材料
334
制造单极型器件的台阶式工艺
335
场效应晶体管
336
带有绝缘栅的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
02
半导体器件或其部件的制造或处理
04
至少具有一个跃变势垒或表面势垒的器件,例如PN结、耗尽层、载体集结层
18
器件有由周期表第Ⅳ族元素或含有/不含有杂质的AⅢBⅤ族化合物构成的半导体,如掺杂材料
28
用H01L 21/20至H01L 21/268各组不包含的方法或设备在半导体材料上制造电极的
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
29
专门适用于整流、放大、振荡或切换,并具有至少一个电位跃变势垒或表面势垒的半导体器件;具有至少一个电位跃变势垒或表面势垒,例如PN结耗尽层或载流子集结层的电容器或电阻器;半导体本体或其电极的零部件
66
按半导体器件的类型区分的
68
只能通过对一个不通有待整流、放大或切换的电流的电极供给电流或施加电位方可进行控制的
76
单极器件
772
场效应晶体管
78
由绝缘栅产生场效应的
786
薄膜晶体管
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
21
专门适用于制造或处理半导体或固体器件或其部件的方法或设备
70
由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
77
在公共衬底中或上面形成的由许多固态元件或集成电路组成的器件的制造或处理
H 电学
01
基本电气元件
L
半导体器件;其他类目中不包括的电固体器件
27
由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
02
包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
12
其衬底为非半导体的,例如为绝缘体的
申请人:
深圳市华星光电技术有限公司 SHENZHEN CHINA STAR OPTOELECTRONICS TECHNOLOGY CO., LTD. [CN/CN]; 中国广东省深圳市 光明新区塘明大道9-2号 No. 9-2, Tangming Rd, Guangming New District Shenzhen, Guangdong 518132, CN
发明人:
蔡小龙 CAI, Xiaolong; CN
代理人:
深圳市威世博知识产权代理事务所(普通合伙) CHINA WISPRO INTELLECTUAL PROPERTY LLP.; 中国广东省深圳市 南山区高新区粤兴三道8号中国地质大学产学研基地中地大楼A806 Room A806 Zhongdi Building, China University of Geosciences Base, No. 8 Yuexing 3rd Road, High-Tech Industrial Estate, Nanshan District Shenzhen, Guangdong 518057, CN
优先权数据:
201710153568.015.03.2017CN
标题 (EN) METHOD FOR MANUFACTURING TFT AND METHOD FOR MANUFACTURING ARRAY SUBSTRATE
(FR) PROCÉDÉ DE FABRICATION DE TRANSISTOR À COUCHES MINCES ET PROCÉDÉ DE FABRICATION DE SUBSTRAT DE MATRICE
(ZH) TFT的制造方法及阵列基板的制造方法
摘要:
(EN) A method for manufacturing a TFT and a method for manufacturing an array substrate. The method comprises: forming, on a base substrate (20), transfer layers (212) that are provided alternately at intervals; forming, on the transfer layers, a metal layer (22) covering the base substrate; and carrying out a DIW demoulding process on the transfer layers, so as to strip the transfer layers and the metal layer above same from the base substrate, and keeping the metal layer, not provided above the transfer layers, on the base substrate, so as to form a metal electrode (23) of the TFT.
(FR) L’invention concerne un procédé de fabrication d’un transistor à couches minces et un procédé de fabrication d’un substrat de matrice. Le procédé consiste à : former, sur un substrat de base (20), des couches de transfert (212) qui sont disposées en alternance à intervalles ; former, sur les couches de transfert, d'une couche métallique (22) recouvrant le substrat de base ; et réaliser un processus de démoulage DIW sur les couches de transfert, de manière à dénuder les couches de transfert et la couche métallique au-dessus de celles-ci à partir du substrat de base, et conserver la couche métallique, non disposée au-dessus des couches de transfert, sur le substrat de base, de manière à former une électrode métallique (23) du transistor à couches minces.
(ZH) 一种TFT的制造方法及阵列基板的制造方法。在衬底基材(20)上形成交错间隔设置的中转层(212);在中转层上形成覆盖衬底基材的金属层(22);对中转层进行DIW脱膜制程,以将中转层及其上方的金属层从衬底基材上剥离,而未设置在中转层上方的金属层保留在衬底基材上而形成TFT的金属电极(23)。
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公布语言: 中文 (ZH)
申请语言: 中文 (ZH)