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1. (WO2019066880) GROUP III-V SEMICONDUCTOR DEVICES HAVING ASYMMETRIC SOURCE AND DRAIN STRUCTURES
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№ de pub.: WO/2019/066880 № do pedido internacional: PCT/US2017/054193
Data de publicação: 04.04.2019 Data de depósito internacional: 28.09.2017
CIP:
H01L 29/78 (2006.01) ,H01L 29/423 (2006.01) ,H01L 29/66 (2006.01)
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
29
Dispositivos semicondutores adaptados para retificação, amplificação, oscilação ou comutação ou capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície; Capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície, p. ex., camada de depleção da junção PN ou camada de concentração de portadores; Detalhes de corpos de semicondutores ou de eletrodos dos mesmos
66
Tipos de dispositivo semicondutor
68
controláveis unicamente pela corrente elétrica fornecida ou pelo potencial elétrico aplicado a um eletrodo que não conduz a corrente a ser retificada, amplificada ou comutada
76
Dispositivos unipolares
772
Transistores de efeito de campo
78
com o efeito de campo produzido por uma porta isolada
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
29
Dispositivos semicondutores adaptados para retificação, amplificação, oscilação ou comutação ou capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície; Capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície, p. ex., camada de depleção da junção PN ou camada de concentração de portadores; Detalhes de corpos de semicondutores ou de eletrodos dos mesmos
40
Eletrodos
41
caracterizados por seus formatos, tamanhos relativos ou disposições
423
não transportando a corrente a ser retificada, amplificada ou comutada
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
29
Dispositivos semicondutores adaptados para retificação, amplificação, oscilação ou comutação ou capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície; Capacitores ou resistores com pelo menos uma barreira de potencial ou barreira de superfície, p. ex., camada de depleção da junção PN ou camada de concentração de portadores; Detalhes de corpos de semicondutores ou de eletrodos dos mesmos
66
Tipos de dispositivo semicondutor
Requerentes:
MA, Sean T. [US/US]; US
DEWEY, Gilbert [US/US]; US
RACHMADY, Willy [ID/US]; US
KENNEL, Harold W. [US/US]; US
HUANG, Cheng-Ying; US
METZ, Matthew V. [US/US]; US
MINUTILLO, Nicholas G. [US/US]; US
KAVALIEROS, Jack T. [US/US]; US
MURTHY, Anand S. [US/US]; US
INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventores:
MA, Sean T.; US
DEWEY, Gilbert; US
RACHMADY, Willy; US
KENNEL, Harold W.; US
HUANG, Cheng-Ying; US
METZ, Matthew V.; US
MINUTILLO, Nicholas G.; US
KAVALIEROS, Jack T.; US
MURTHY, Anand S.; US
Mandatário:
BRASK, Justin K.; US
AUYEUNG, Al; US
BERNADICOU, Michael A.; US
BLAIR, Steven R.; US
BLANK, Eric S.; US
COFIELD, Michael A.; US
DANSKIN, Timothy A.; US
HALEVA, Aaron S.; US
MAKI, Nathan R.; US
MARLINK, Jeffrey S.; US
MOORE, Michael S.; US
PARKER, Wesley E.; US
PUGH, Joseph A.; US
RASKIN, Vladimir; US
STRAUSS, Ryan N.; US
WANG, Yuke; US
YATES, Steven D.; US
SULLIVAN, Stephen G.; US
ROJO, Estiven; US
Dados da prioridade:
Título (EN) GROUP III-V SEMICONDUCTOR DEVICES HAVING ASYMMETRIC SOURCE AND DRAIN STRUCTURES
(FR) DISPOSITIFS À SEMI-CONDUCTEUR DU GROUPE III-V AYANT DES STRUCTURES DE SOURCE ET DE DRAIN ASYMÉTRIQUES
Resumo:
(EN) Group III-V semiconductor devices having asymmetric source and drain structures and their methods of fabrication are described. In an example, an integrated circuit structure includes a gallium arsenide layer on a substrate. A channel structure is on the gallium arsenide layer. The channel structure includes indium, gallium and arsenic. A source structure is at a first end of the channel structure and a drain structure is at a second end of the channel structure. The drain structure has a wider band gap than the source structure. A gate structure is over the channel structure.
(FR) L'invention porte sur des dispositifs à semi-conducteur du groupe III-V ayant des structures de source et de drain asymétriques, et sur leurs procédés de fabrication. Dans un exemple, une structure de circuit intégré comprend une couche d'arséniure de gallium sur un substrat. Une structure de canal se trouve sur la couche d'arséniure de gallium. La structure de canal comprend de l'indium, du gallium et de l'arsenic. Une structure de source se trouve à une première extrémité de la structure de canal et une structure de drain se trouve à une seconde extrémité de la structure de canal. La structure de drain a une bande interdite plus large que celle de la structure de source. Une structure de grille se trouve au-dessus de la structure de canal.
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Organização Regional Africana da Propriedade Intelectual (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Instituto Eurasiático de Patentes (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Instituto Europeu de Patentes (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organização Africana da Propriedade Intelectual (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Língua de publicação: inglês (EN)
Língua de depósito: inglês (EN)