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1. (WO2018235843) SEMICONDUCTOR DEVICE MANUFACTURING METHOD AND WAFER-ATTACHED STRUCTURE
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№ de pub.: WO/2018/235843 № do pedido internacional: PCT/JP2018/023373
Data de publicação: 27.12.2018 Data de depósito internacional: 19.06.2018
CIP:
H01L 21/304 (2006.01) ,B23K 26/53 (2014.01) ,B28D 5/04 (2006.01) ,H01L 21/02 (2006.01) ,H01L 21/683 (2006.01)
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
21
Processos ou aparelhos especialmente adaptados para a manufatura ou tratamento dos dispositivos semicondutores ou de dispositivos de estado sólido ou de partes dos mesmos
02
Fabricação ou tratamento de dispositivos semicondutores ou de partes dos mesmos
04
tendo o dispositivo, pelo menos, uma barreira de potencial ou uma barreira de superfície, p. ex., junção PN, camada de depleção, camada de concentração de portadores de carga
18
tendo os dispositivos corpos semicondutores constituídos de elementos do quarto grupo do Sistema periódico ou compostos AIIIBV com ou sem impurezas, p. ex., materiais de dopagem
30
Tratamento de corpos semicondutores usando processos ou aparelhos não incluídos nos grupos H01L21/20-H01L21/26142
302
para mudar as características físicas ou a forma de sua superfície, p. ex., gravação, polimento, recorte
304
Tratamento mecânico, p. ex., esmerilhamento, polimento, recorte
[IPC code unknown for B23K 26/53]
B OPERAÇÕES DE PROCESSAMENTO; TRANSPORTE
28
MANIPULAÇÃO DE CIMENTO, ARGILA OU PEDRA
D
TRABALHO DE PEDRA OU MATERIAIS ANÁLOGOS À PEDRA
5
Trabalho fino de pedras preciosas, joias, cristais, p. ex., de material semicondutor; Aparelho para esse fins
04
por ferramentas outras que não do tipo rotativo, p. ex., ferramentas de movimento alternado
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
21
Processos ou aparelhos especialmente adaptados para a manufatura ou tratamento dos dispositivos semicondutores ou de dispositivos de estado sólido ou de partes dos mesmos
02
Fabricação ou tratamento de dispositivos semicondutores ou de partes dos mesmos
H ELECTRICIDADE
01
ELEMENTOS ELÉTRICOS BÁSICOS
L
DISPOSITIVOS SEMICONDUTORES; DISPOSITIVOS ELÉTRICOS DE ESTADO SÓLIDO NÃO INCLUÍDOS EM OUTRO LOCAL
21
Processos ou aparelhos especialmente adaptados para a manufatura ou tratamento dos dispositivos semicondutores ou de dispositivos de estado sólido ou de partes dos mesmos
67
Aparelhos especialmente adaptados para manipulação de dispositivos semicondutores ou de dispositivos elétricos de estado sólido durante a fabricação ou tratamento dos mesmos; Aparelhos especialmente adaptados para manipulação de pastilhas ("wafers") durante a fabricação ou tratamento de dispositivos semicondutores ou dispositivos elétricos de estado sólido ou componentes
683
para sustentação ou aderência
Requerentes:
ローム株式会社 ROHM CO., LTD. [JP/JP]; 京都府京都市右京区西院溝崎町21番地 21, Saiin Mizosaki-cho, Ukyo-ku, Kyoto-shi, Kyoto 6158585, JP
Inventores:
明田 正俊 AKETA, Masatoshi; JP
富士 和則 FUJI, Kazunori; JP
Mandatário:
特許業務法人あい特許事務所 AI ASSOCIATION OF PATENT AND TRADEMARK ATTORNEYS; 大阪府大阪市中央区南本町二丁目6番12号 サンマリオンNBFタワー21階 Sun Mullion NBF Tower, 21st Floor, 6-12, Minamihommachi 2-chome, Chuo-ku, Osaka-shi, Osaka 5410054, JP
Dados da prioridade:
2017-11970419.06.2017JP
Título (EN) SEMICONDUCTOR DEVICE MANUFACTURING METHOD AND WAFER-ATTACHED STRUCTURE
(FR) PROCÉDÉ DE FABRICATION D'UN DISPOSITIF À SEMI-CONDUCTEURS ET STRUCTURE FIXÉE À UNE TRANCHE
(JA) 半導体装置の製造方法およびウエハ貼着構造体
Resumo:
(EN) A semiconductor device manufacturing method comprises: a step of preparing a semiconductor wafer source including a first major surface on one side, a second major surface on another side, and a side wall connecting the first major surface and the second major surface; an element forming step of setting a plurality of element forming regions on the first major surface of the semiconductor wafer source, and fabricating semiconductor elements respectively in the plurality of element forming regions; and a wafer source separating step of cutting, after the element forming step, the semiconductor wafer source from a midway portion in the thickness direction of the semiconductor wafer source along a horizontal direction parallel with the first major surface, and thereby separating the semiconductor wafer source into an element-formed wafer and an element-unformed wafer.
(FR) La présente invention concerne un procédé de fabrication d'un dispositif à semi-conducteurs, comprenant : une étape de préparation d'une source de semi-conducteur étagé présentant une première surface principale d'un côté, une seconde surface principale d'un autre côté, et une paroi latérale reliant les première et seconde surfaces principales ; une étape de formation d'éléments consistant à délimiter une pluralité de zones de formation d'éléments sur la première surface principale de la source de semi-conducteur étagé, et à fabriquer des éléments semi-conducteurs respectivement dans la pluralité de zones de formation d'éléments ; et une étape de séparation de source de semi-conducteur étagé consistant à découper, après l'étape de formation d'éléments, la source de semi-conducteur étagé depuis une partie centrale dans le sens de l'épaisseur de la source de semi-conducteur étagé le long d'une direction horizontale parallèle à la première surface principale, et ainsi à diviser la source de semi-conducteur étagé en une tranche formée d'éléments et une tranche non formée d'éléments.
(JA) 半導体装置の製造方法は、一方側の第1主面、他方側の第2主面、ならびに、前記第1主面および前記第2主面を接続する側壁を含む半導体ウエハ源を用意する工程と、前記半導体ウエハ源の前記第1主面に複数の素子形成領域を設定し、前記複数の素子形成領域に半導体素子をそれぞれ作り込む素子形成工程と、前記素子形成工程の後、前記半導体ウエハ源の厚さ方向途中部から前記第1主面に平行な水平方向に沿って前記半導体ウエハ源を切断することにより、前記半導体ウエハ源を素子形成ウエハおよび素子未形成ウエハに分離するウエハ源分離工程と、を含む。
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Organização Regional Africana da Propriedade Intelectual (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Instituto Eurasiático de Patentes (AM, AZ, BY, KG, KZ, RU, TJ, TM)
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Organização Africana da Propriedade Intelectual (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Língua de publicação: japonês (JA)
Língua de depósito: japonês (JA)