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1. (WO2017112374) METHOD AND APPARATUS FOR USER-LEVEL THREAD SYNCHRONIZATION WITH A MONITOR AND MWAIT ARCHITECTURE
Dados bibliográficos mais recentes no arquivo da Secretaria Internacional

№ de pub.: WO/2017/112374 № do pedido internacional: PCT/US2016/064114
Data de publicação: 29.06.2017 Data de depósito internacional: 30.11.2016
CIP:
G06F 9/30 (2006.01) ,G06F 12/02 (2006.01) ,G06F 12/0811 (2016.01)
G FÍSICA
06
CÔMPUTO; CÁLCULO; CONTAGEM
F
PROCESSAMENTO ELÉTRICO DE DADOS DIGITAIS
9
Disposições para controle por programas, p. ex., unidade de controle
06
usando programa armazenado, i.e., usando a memória interna do equipamento de processamento para receber e reter programas
30
Disposições para a execução de instruções de máquinas, p. ex., decodificação de instruções
G FÍSICA
06
CÔMPUTO; CÁLCULO; CONTAGEM
F
PROCESSAMENTO ELÉTRICO DE DADOS DIGITAIS
12
Acesso, endereçamento ou alocação dentro dos sistemas ou arquiteturas de memória
02
Endereçamento ou alocação; Reendereçamento
[IPC code unknown for G06F 12/0811]
Requerentes:
INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventores:
CHAFFIN, Benjamin C.; US
KYANKO, Robert J.; US
SODANI, Avinash; US
Mandatário:
VECCHIA, Brent E.; US
Dados da prioridade:
14/998,21724.12.2015US
Título (EN) METHOD AND APPARATUS FOR USER-LEVEL THREAD SYNCHRONIZATION WITH A MONITOR AND MWAIT ARCHITECTURE
(FR) PROCÉDÉ ET APPAREIL DE SYNCHRONISATION DE FILS DE NIVEAU UTILISATEUR AVEC UNE ARCHITECTURE MWAIT ET DE SURVEILLANCE
Resumo:
(EN) Instructions and logic provide user-level thread synchronization with MONITOR and MWAIT instructions. One or more model specific registers (MSRs) in a processor may be configured in a first execution state to specify support of a user-level thread synchronization architecture. Embodiments include multiple hardware threads or processing cores, corresponding monitored address state storage to store a last monitored address for each of a plurality of execution threads that issues a MONITOR request, cache memory to record MONITOR requests and associated states for addresses of memory storage locations, and responsive to receipt of an MWAIT request for the address, to record an associated wait-to-trigger state of monitored addresses for execution cores associated with an MWAIT request; wherein the execution core is to transition a requesting thread to an optimized sleep state responsive to the receipt of said MWAIT request when said one or more MSRs are configured in the first execution state.
(FR) La présente invention concerne des instructions et une logique fournissant une synchronisation de fils de niveau utilisateur avec des instructions MWAIT et de surveillance. Un ou plusieurs registres spécifiques de modèles (MSR) dans un processeur peuvent être configurés dans un premier état d'exécution pour spécifier la prise en charge d'une architecture de synchronisation de fils de niveau utilisateur. Des modes de réalisation comprennent plusieurs fils matériels ou cœurs de traitement, une mémoire d'état d'adresses surveillées correspondantes pour mémoriser une dernière adresse surveillée pour chaque fil d'une pluralité de fils d'exécution qui émet une requête de surveillance, une mémoire cache pour enregistrer des requêtes de surveillance et des états associés pour des adresses d'emplacements de mémoire, et en réponse à la réception d'une requête MWAIT concernant l'adresse, pour enregistrer un état d'attente de déclenchement associé des adresses surveillées pour les cœurs d'exécution associés à une requête MWAIT; le cœur d'exécution doit faire passer un fil de requête dans un état de sommeil optimisé en réponse à la réception de ladite requête MWAIT lorsque ledit ou lesdits MSR sont configurés dans le premier état d'exécution.
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Organização Regional Africana da Propriedade Intelectual (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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Instituto Europeu de Patentes (IEP) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organização Africana da Propriedade Intelectual (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Língua de publicação: inglês (EN)
Língua de depósito: inglês (EN)
Also published as:
CN108351781EP3394732