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1. (WO2019045786) SYSTEMS AND METHODS FOR DATA PATH POWER SAVINGS IN DDR5 MEMORY DEVICES
국제사무국에 기록된 최신 서지정보정보 제출

공개번호: WO/2019/045786 국제출원번호: PCT/US2018/027822
공개일: 07.03.2019 국제출원일: 16.04.2018
IPC:
G11C 7/10 (2006.01) ,G11C 8/12 (2006.01) ,G06F 1/32 (2006.01)
G SECTION G — 물리학
11
정보저장
C
정적기억
7
디지털 기억장치에 정보를 써넣거나 또는 디지털 기억장치로부터 정보를 판독하는 장치
10
입력/출력 데이터 인터페이스 장치, 예. I/O 데이터 제어 회로, I/O 데이터 버퍼 회로
G SECTION G — 물리학
11
정보저장
C
정적기억
8
디지털 기억장치에 있어서 어드레스(address)를 선택 하는 장치
12
그룹 선택 회로, 예. 메모리 블록 선택, 칩 선택, 어레이 선택을 위한 것
G SECTION G — 물리학
06
산술논리연산; 계산; 계수
F
전기에 의한 디지털 데이터처리
1
그룹 G06F 3/00 ~ G06F 13/00 및 G06F 21/00 에 포함되지 않는 세부
26
전력공급수단, 예. 전원의 안정화
32
전력절약을 위한 수단
출원인:
MICRON TECHNOLOGY, INC [US/US]; 8000 South Federal Way Boise, Idaho 83707, US
발명자:
KANDIKONDA, Ravi Kiran; US
대리인:
MANWARE, Robert A.; US
FLETCHER, Michael G.; US
YODER, Patrick S.; US
POWELL, W. Allen; US
RARIDEN, John M.; US
SWANSON, Tait R.; US
BAKKER, Jila; US
SINCLAIR, JR., Steven J.; US
OSTERHAUS, Matthew G.; US
DOOLEY, Matthew C.; US
HENWOOD, Matthew C.; US
KANTOR, Andrew L.; US
WIMMER, Lance G.; US
BELLAH, Sean J.; US
THOMAS, Jim; US
CORLEY, David; US
우선권 정보:
15/693,17331.08.2017US
발명의 명칭: (EN) SYSTEMS AND METHODS FOR DATA PATH POWER SAVINGS IN DDR5 MEMORY DEVICES
(FR) SYSTÈMES ET PROCÉDÉS POUR DES ÉCONOMIES D'ÉNERGIE DE CHEMIN DE DONNÉES DANS DES DISPOSITIFS DE MÉMOIRE DDR5
요약서:
(EN) A memory device includes a data path having a data bus. The memory derive further includes a first one-hot communications interface communicatively coupled to the data bus, and a second one-hot communications interface communicatively coupled to the data bus. The memory device additionally includes at least one memory bank, and an input/output (I/O) interface communicatively coupled to the at least one memory bank via the first one-hot communications interface and the second one-hot communications interface, wherein the first one-hot communications interface is configured to convert a first data pattern received by the I/O interface into one-hot signals transmitted via the data bus to the second one-hot communications interface, and wherein the second one-hot communications interface is configured to convert the one-hot signals into the first data pattern to be stored in the at least one memory bank.
(FR) L'invention concerne un dispositif de mémoire qui comprend un chemin de données comportant un bus de données. Le dispositif de mémoire comprend en outre une première interface de communication 1 parmi n couplée en communication au bus de données, et une seconde interface de communication 1 parmi n couplée en communication au bus de données. Le dispositif de mémoire comprend en outre au moins un bloc mémoire, et une interface d'entrée/sortie (E/S) couplée en communication avec le ou les blocs mémoire par l'intermédiaire de la première interface de communication 1 parmi n et de la seconde interface de communication 1 parmi n, la première interface de communication 1 parmi n étant configurée pour convertir un premier motif de données reçu par l'interface E/S en signaux 1 parmi n transmis par l'intermédiaire du bus de données à la seconde interface de communication 1 parmi n, et la seconde interface de communication 1 parmi n étant configurée pour convertir les signaux 1 parmi n dans le premier motif de données à stocker dans le ou les blocs mémoire.
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아프리카 지식재산권기구(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
공개언어: 영어 (EN)
출원언어: 영어 (EN)