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1. WO2020166159 - マイクロプロセッサ及びその動作方法

公開番号 WO/2020/166159
公開日 20.08.2020
国際出願番号 PCT/JP2019/045385
国際出願日 20.11.2019
IPC
G06F 9/30 2018.01
G物理学
06計算;計数
F電気的デジタルデータ処理
9プログラム制御のための装置,例.制御装置
06プログラム記憶方式を用いるもの,すなわちプログラムを受取りまたは保持するために処理装置の内部記憶装置を用いるもの
30機械語命令を実行するための装置,例.命令のデコード
CPC
G06F 9/30
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
出願人
  • ソニー株式会社 SONY CORPORATION [JP]/[JP]
発明者
  • 中村 祐一 NAKAMURA, Yuuichi
代理人
  • 宮田 正昭 MIYATA, Masaaki
  • 山田 英治 YAMADA, Eiji
  • 佐々木 榮二 SASAKI, Eiji
  • 澤田 俊夫 SAWADA, Toshio
優先権情報
2019-02493714.02.2019JP
公開言語 (言語コード) 日本語 (JA)
出願言語 (言語コード) 日本語 (JA)
指定国 (国コード)
発明の名称
(EN) MICROPROCESSOR AND OPERATION METHOD THEREFOR
(FR) MICROPROCESSEUR ET SON PROCÉDÉ DE FONCTIONNEMENT
(JA) マイクロプロセッサ及びその動作方法
要約
(EN)
Provided is a microprocessor which is provided with a plurality of instruction sets, and which reduces code size. This microprocessor is provided with a plurality of instruction sets, and executes a program while switching between instruction sets on the basis of an instruction set-switching bit that is included in each read instruction code, and that indicates the next instruction set to be executed, during the execution of the program. Each instruction set comprises, for each intermediate language instruction classified according to processing content, a set of instruction codes that are used when executing the instruction. Furthermore, the next instruction set indicated within each instruction code for each instruction set is selected from among certain specific instruction sets.
(FR)
L'invention concerne un microprocesseur qui est pourvu d'une pluralité d'ensembles d'instructions, et qui réduit la taille de code. Ce microprocesseur est pourvu d'une pluralité d'ensembles d'instructions, et exécute un programme tout en commutant entre des ensembles d'instructions sur la base d'un bit de commutation d'ensemble d'instructions qui est compris dans chaque code d'instruction de lecture, et qui indique l'ensemble d'instructions suivant à exécuter pendant l'exécution du programme. Chaque ensemble d'instructions comprend, pour chaque instruction de langage intermédiaire classée selon un contenu de traitement, un ensemble de codes d'instruction qui sont utilisés lors de l'exécution de l'instruction. En outre, l'ensemble d'instructions suivant indiqué au sein de chaque code d'instruction pour chaque ensemble d'instructions est sélectionné parmi certains ensembles d'instructions spécifiques.
(JA)
複数の命令セットを備え、コードサイズを削減するマイクロプロセッサを提供する。 マイクロプロセッサは、複数の命令セットを備え、プログラムの実行時に、読み込んだ命令コードに含まれる次に実行すべき命令セットを示す命令セット切り替えビットに基づいて、命令セットの切り替えを行いながら、プログラムを実行する。各命令セットは、処理内容に応じて分類した中間言語命令毎に、命令を実行する際に使用する命令コードを集めた集合からなる。そして、命令セット毎に、命令コード内で選択可能な次の命令セットが限定されている。
国際事務局に記録されている最新の書誌情報