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1. (WO2019044546) アクティブマトリクス基板および表示装置
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国際公開番号: WO/2019/044546 国際出願番号: PCT/JP2018/030540
国際公開日: 07.03.2019 国際出願日: 17.08.2018
IPC:
G09G 3/36 (2006.01) ,G02F 1/133 (2006.01) ,G02F 1/1368 (2006.01) ,G09G 3/20 (2006.01)
G 物理学
09
教育;暗号方法;表示;広告;シール
G
静的手段を用いて可変情報を表示する表示装置の制御のための装置または回路
3
陰極線管以外の可視的表示器にのみ関連した,制御装置または回路
20
マトリックス状に配置された個々の要素の組み合わせによりその集合を構成することによって多数の文字の集合,例.1頁,を表示するためのもの
34
独立の光源よりの光の制御によるもの
36
液晶を用いるもの
G 物理学
02
光学
F
光の強度,色,位相,偏光または方向の制御,例.スイッチング,ゲーテイング,変調または復調のための装置または配置の媒体の光学的性質の変化により,光学的作用が変化する装置または配置;そのための技法または手順;周波数変換;非線形光学;光学的論理素子;光学的アナログ/デジタル変換器
1
独立の光源から到達する光の強度,色,位相,偏光または方向の制御のための装置または配置,例.スィッチング,ゲーテイングまたは変調;非線形光学
01
強度,位相,偏光または色の制御のためのもの
13
液晶に基づいたもの,例.単一の液晶表示セル
133
構造配置;液晶セルの作動;回路配置
G 物理学
02
光学
F
光の強度,色,位相,偏光または方向の制御,例.スイッチング,ゲーテイング,変調または復調のための装置または配置の媒体の光学的性質の変化により,光学的作用が変化する装置または配置;そのための技法または手順;周波数変換;非線形光学;光学的論理素子;光学的アナログ/デジタル変換器
1
独立の光源から到達する光の強度,色,位相,偏光または方向の制御のための装置または配置,例.スィッチング,ゲーテイングまたは変調;非線形光学
01
強度,位相,偏光または色の制御のためのもの
13
液晶に基づいたもの,例.単一の液晶表示セル
133
構造配置;液晶セルの作動;回路配置
136
半導体の層または基板と構造上組み合された液晶セル,例.集積回路の一部を構成するセル
1362
アクティブマトリックスセル
1368
スイッチング素子が三端子の素子であるもの
G 物理学
09
教育;暗号方法;表示;広告;シール
G
静的手段を用いて可変情報を表示する表示装置の制御のための装置または回路
3
陰極線管以外の可視的表示器にのみ関連した,制御装置または回路
20
マトリックス状に配置された個々の要素の組み合わせによりその集合を構成することによって多数の文字の集合,例.1頁,を表示するためのもの
出願人:
シャープ株式会社 SHARP KABUSHIKI KAISHA [JP/JP]; 大阪府堺市堺区匠町1番地 1, Takumi-cho, Sakai-ku, Sakai City, Osaka 5908522, JP
発明者:
山本 薫 YAMAMOTO Kaoru; --
代理人:
奥田 誠司 OKUDA Seiji; JP
優先権情報:
2017-16415629.08.2017JP
発明の名称: (EN) ACTIVE MATRIX SUBSTRATE AND DISPLAY DEVICE
(FR) SUBSTRAT À MATRICE ACTIVE ET DISPOSITIF D'AFFICHAGE
(JA) アクティブマトリクス基板および表示装置
要約:
(EN) An active matrix substrate is provided with a demultiplexer circuit provided on the periphery. Each simple circuit in the demultiplexer circuit distributes a display signal from one signal output line to n source bus lines (n is an integer of 2 or greater). Each simple circuit includes n branch lines and n switching TFTs for individually controlling the on and off of electrical connections between the branch lines and the source bus lines. The demultiplexer circuit includes a plurality of booster circuits capable of increasing the voltage applied to the gate electrode of the switching TFT. Each booster circuit includes: a set-and-reset unit that performs a set operation for pre-charging a node connected to a gate electrode and a reset operation for resetting the potential of the node at mutually different times; and a booster unit that boosts the potential of the node pre-charged by the set operation.
(FR) L'invention concerne un substrat de matrice active pourvu d'un circuit démultiplexeur disposé à la périphérie. Chaque circuit unitaire du circuit démultiplexeur distribue un signal d'affichage d'une ligne de sortie de signal vers n lignes de bus source (n étant un entier supérieur ou égal à 2). Chaque circuit simple comprend n lignes de dérivation et n transistors TFT de commutation permettant de commander individuellement l'activation et la désactivation de connexions électriques, entre les lignes de dérivation et les lignes de bus source. Le circuit démultiplexeur comprend une pluralité de circuit survolteurs, susceptibles d'amplifier la tension appliquée à l'électrode de grille des TFT de commutation. Chaque circuit survolteur comprend : une unité d'initialisation et de réinitialisation, qui effectue une opération d'initialisation, permettant de précharger un nœud connecté à une électrode de grille, et une opération de réinitialisation, permettant de réinitialiser le potentiel du nœud à des instants mutuellement différents; et une unité d'amplification, qui amplifie le potentiel du nœud préchargé par l'opération d'initialisation.
(JA) アクティブマトリクス基板は、周辺領域に配置されたデマルチプレクサ回路を備える。デマルチプレクサ回路の各単位回路は、1本の信号出力線からn本(nは2以上の整数)のソースバスラインに表示信号を分配する。各単位回路は、n本の分岐配線と、分岐配線とソースバスラインとの電気的な接続を個別にオン/オフ制御するn個のスイッチングTFTとを含む。デマルチプレクサ回路は、スイッチングTFTのゲート電極に印加される電圧を昇圧し得る複数個のブースト回路を含む。各ブースト回路は、ゲート電極に接続されたノードをプリチャージするセット動作およびノードの電位をリセットするリセット動作を互いに異なるタイミングで行うセット・リセット部と、セット動作によってプリチャージされたノードの電位を昇圧するブースト動作を行うブースト部とを含む。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)