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1. (WO2018189620) ニューラルネットワーク回路
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国際公開番号: WO/2018/189620 国際出願番号: PCT/IB2018/052250
国際公開日: 18.10.2018 国際出願日: 02.04.2018
IPC:
G06N 3/063 (2006.01)
G 物理学
06
計算;計数
N
特定の計算モデルに基づくコンピュータ・システム
3
生物学的モデルに基づくコンピュータ・システム
02
ニューラル・ネットワーク・モデルを用いるもの
06
物理的な実現,すなわち,ニューラル・ネットワーク,ニューロン,ニューロン構成要素のハードウェア実装
063
電子的手段を用いるもの
出願人:
株式会社半導体エネルギー研究所 SEMICONDUCTOR ENERGY LABORATORY CO., LTD. [JP/JP]; 神奈川県厚木市長谷398 398, Hase, Atsugi-shi, Kanagawa 2430036, JP
発明者:
岡本佑樹 OKAMOTO, Yuki; JP
上妻宗広 KOZUMA, Munehiro; JP
黒川義元 KUROKAWA, Yoshiyuki; JP
池田隆之 IKEDA, Takayuki; JP
優先権情報:
2017-08035514.04.2017JP
発明の名称: (EN) NEURAL NETWORK CIRCUIT
(FR) CIRCUIT DE RÉSEAU NEURONAL
(JA) ニューラルネットワーク回路
要約:
(EN) The purpose of the present invention is to provide a neural network circuit having a novel configuration. This neural network circuit comprises pluralities of arithmetic circuits, each arithmetic circuit having a register, a memory, a multiplication circuit, and an addition circuit. Each memory outputs weight data that varies with different context signals. In each arithmetic circuit, the multiplication circuit multiplies input data retained in the register by weight data and outputs the resulting data. The addition circuit of each arithmetic circuit performs a multiply-accumulate operation by adding the output data of the multiplication circuit of the arithmetic circuit to the data resulting from a multiply-accumulate operation performed by the addition circuit of another arithmetic circuit. Thus, the data resulting from a multiply-accumulate operation performed by the addition circuit of each arithmetic circuit is output to the addition circuit of another arithmetic circuit. In this way, a multiply-accumulate operation is performed on different weight data and different input data.
(FR) L'objectif de l'invention est de fournir un circuit de réseau neuronal ayant une nouvelle configuration. Ce circuit de réseau neuronal comprend des pluralités de circuits arithmétiques, chaque circuit arithmétique comprenant un registre, une mémoire, un circuit de multiplication et un circuit d'addition. Chaque mémoire génère des données de poids qui varient avec différents signaux de contexte. Dans chaque circuit arithmétique, le circuit de multiplication multiplie les données d'entrée conservées dans le registre par les données de poids et génère les données résultantes. Le circuit d'addition de chaque circuit arithmétique effectue une opération de multiplication-accumulation en ajoutant les données de sortie du circuit de multiplication du circuit arithmétique aux données résultant d'une opération de multiplication-accumulation effectuée par le circuit d'addition d'un autre circuit arithmétique. Ainsi, les données résultant d'une opération de multiplication-accumulation effectuée par le circuit d'addition de chaque circuit arithmétique sont transmises au circuit d'addition d'un autre circuit arithmétique. De cette façon, une opération de multiplication-accumulation est effectuée sur différentes données de poids et différentes données d'entrée.
(JA) 要約書 新規な構成のニューラルネットワーク回路を提供すること。 レジスタ、メモリ、乗算回路および加算回路を有する複数の演算回路を複数設ける。メモリは、コンテキスト 信号の切り替えに応じて異なる重みデータを出力する。乗算回路は、重みデータと、レジスタに保持される 入力データと、の乗算データとを出力する。加算回路は、別の演算回路における加算回路で得られた積和 演算で得られるデータに、得られた乗算データを加算することで積和演算を行う。得られた積和演算のデー タは、別の演算回路における加算回路に出力することで、異なる重みデータおよび入力データの積和演算 を行う構成とする。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)