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1. (WO2018173472) ニューラルネットワーク回路

Pub. No.:    WO/2018/173472    International Application No.:    PCT/JP2018/002285
Publication Date: Fri Sep 28 01:59:59 CEST 2018 International Filing Date: Fri Jan 26 00:59:59 CET 2018
IPC: G06G 7/60
G06N 3/063
Applicants: DENSO CORPORATION
株式会社デンソー
Inventors: OTSUKA, Shigeki
大塚 茂樹
KATAEVA, Irina
カタエヴァ イリナ
Title: ニューラルネットワーク回路
Abstract:
メモリスタを記憶素子とする記憶部を備え、活性化関数としてランプ関数を使用する。差動増幅回路は、記憶素子を介して流れる電流を電圧に変換するI/V変換増幅回路のうち、対を成す2つの出力について差動演算を行い、その演算結果はA/DコンバータによりA/D変換される。そして、出力判定部は、差動増幅回路の入力信号を参照し、ランプ関数の極性の正負に応じて差動増幅回路の出力信号の値が活性領域に属するか不活性領域に属するかを判定し、その判定結果に基づき差動増幅回路及びA/Dコンバータを動作状態と待機状態とに切り換える。