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1. (WO2018163985) 走査線駆動回路およびこれを備えた表示装置
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国際公開番号: WO/2018/163985 国際出願番号: PCT/JP2018/007958
国際公開日: 13.09.2018 国際出願日: 02.03.2018
IPC:
G09G 3/36 (2006.01) ,G02F 1/133 (2006.01) ,G09G 3/20 (2006.01) ,G11C 19/28 (2006.01)
G 物理学
09
教育;暗号方法;表示;広告;シール
G
静的手段を用いて可変情報を表示する表示装置の制御のための装置または回路
3
陰極線管以外の可視的表示器にのみ関連した,制御装置または回路
20
マトリックス状に配置された個々の要素の組み合わせによりその集合を構成することによって多数の文字の集合,例.1頁,を表示するためのもの
34
独立の光源よりの光の制御によるもの
36
液晶を用いるもの
G 物理学
02
光学
F
光の強度,色,位相,偏光または方向の制御,例.スイッチング,ゲーテイング,変調または復調のための装置または配置の媒体の光学的性質の変化により,光学的作用が変化する装置または配置;そのための技法または手順;周波数変換;非線形光学;光学的論理素子;光学的アナログ/デジタル変換器
1
独立の光源から到達する光の強度,色,位相,偏光または方向の制御のための装置または配置,例.スィッチング,ゲーテイングまたは変調;非線形光学
01
強度,位相,偏光または色の制御のためのもの
13
液晶に基づいたもの,例.単一の液晶表示セル
133
構造配置;液晶セルの作動;回路配置
G 物理学
09
教育;暗号方法;表示;広告;シール
G
静的手段を用いて可変情報を表示する表示装置の制御のための装置または回路
3
陰極線管以外の可視的表示器にのみ関連した,制御装置または回路
20
マトリックス状に配置された個々の要素の組み合わせによりその集合を構成することによって多数の文字の集合,例.1頁,を表示するためのもの
G 物理学
11
情報記憶
C
静的記憶
19
情報がステップ形式で移動するデジタル記憶装置,例.シフト・レジスター
28
半導体素子を用いるもの
出願人:
シャープ株式会社 SHARP KABUSHIKI KAISHA [JP/JP]; 大阪府堺市堺区匠町1番地 1, Takumi-cho, Sakai-ku, Sakai City, Osaka 5908522, JP
発明者:
田川 晶 TAGAWA, Akira; --
岩瀬 泰章 IWASE, Yasuaki; --
竹内 洋平 TAKEUCHI, Yohei; --
渡部 卓哉 WATANABE, Takuya; --
代理人:
島田 明宏 SHIMADA, Akihiro; JP
川原 健児 KAWAHARA, Kenji; JP
奥田 邦廣 OKUDA, Kunihiro; JP
河本 悟 KAWAMOTO, Satoru; JP
優先権情報:
2017-04563110.03.2017JP
発明の名称: (EN) SCANNING LINE DRIVE CIRCUIT AND DISPLAY DEVICE EQUIPPED WITH SAME
(FR) CIRCUIT D'ATTAQUE DE LIGNE DE BALAYAGE ET DISPOSITIF D'AFFICHAGE ÉQUIPÉ DUDIT CIRCUIT
(JA) 走査線駆動回路およびこれを備えた表示装置
要約:
(EN) A scanning line drive circuit 10 constructed from a cascade of single circuits 11 operates in accordance with eight-phases of clock signals CK1 through CK8 that vary between a high-level voltage VGH and a low-level voltage VSS1. A single circuit 11 comprises: a transistor M10B that includes a drain terminal connected to a clock terminal CK, a gate terminal connected to a node Na, and a source terminal connected to a second output terminal Q for outputting a signal to single circuits in other blocks; a transistor M9 that applies a low-level voltage VSS2 to the node Na in accordance with the potential at a reset terminal R; and a transistor M14B that applies a low-level voltage VSS3 to the second output terminal Q in accordance with the potential at a Node Nb. The low-level voltage satisfies VSS1 > VSS2 > VSS3. Thereby, the present invention provides a scanning line drive circuit that can be controlled more easily using a depletion type transistor.
(FR) Selon l’invention, un circuit d'attaque de ligne de balayage (10), construit à partir d'une cascade de circuits uniques (11), fonctionne selon huit phases de signaux d'horloge CK1 à CK8 qui varient entre une tension de haut niveau VGH et une tension de faible niveau VSS1. Un circuit unique (11) comprend : un transistor M10B qui comprend une borne de drain connectée à une borne d'horloge CK, une borne de grille connectée à un nœud Na et une borne de source connectée à une seconde borne de sortie Q pour transférer un signal à des circuits uniques dans d'autres blocs ; un transistor M9 qui applique une tension de faible niveau VSS2 au nœud Na en fonction du potentiel au niveau d'un terminal de réinitialisation R ; et un transistor M14B qui applique une tension de faible niveau VSS3 à la seconde borne de sortie Q en fonction du potentiel au niveau d'un nœud Nb. La tension de faible niveau satisfait VSS1 > VSS2 > VSS3. Ainsi, l’invention concerne un circuit d'attaque de ligne de balayage qui peut être commandé plus facilement à l'aide d'un transistor de type à appauvrissement.
(JA) 走査線駆動回路10は、単位回路11を多段接続した構成を有し、ハイレベル電圧VGHとローレベル電圧VSS1との間で変化する8相のクロック信号CK1~CK8に従い動作する。単位回路11は、クロック端子CKに接続されたドレイン端子と、ノードNaに接続されたゲート端子と、他段の単位回路に対する信号を出力するための第2出力端子Qに接続されたソース端子とを有するトランジスタM10Bと、リセット端子Rの電位に応じてノードNaにローレベル電圧VSS2を印加するトランジスタM9と、ノードNbの電位に応じて第2出力端子Qにローレベル電圧VSS3を印加するトランジスタM14Bとを含む。ローレベル電圧はVSS1>VSS2>VSS3を満たす。これにより、デプレッション型トランジスタを用いた、従来よりも容易に制御できる走査線駆動回路を提供する。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)