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1. (WO2018116716) 半導体装置、半導体装置の製造方法、及び、電子機器
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国際公開番号: WO/2018/116716 国際出願番号: PCT/JP2017/041518
国際公開日: 28.06.2018 国際出願日: 17.11.2017
IPC:
H01L 21/336 (2006.01) ,H01L 21/76 (2006.01) ,H01L 21/762 (2006.01) ,H01L 29/786 (2006.01)
H 電気
01
基本的電気素子
L
半導体装置,他に属さない電気的固体装置
21
半導体装置または固体装置またはそれらの部品の製造または処理に特に適用される方法または装置
02
半導体装置またはその部品の製造または処理
04
少なくとも一つの電位障壁または表面障壁,例.PN接合,空乏層,キャリア集中層,を有する装置
18
不純物,例.ドーピング材料,を含むまたは含まない周期律表第IV族の元素またはA↓I↓I↓IB↓V化合物から成る半導体本体を有する装置
334
ユニポーラ型の装置の製造のための多段階工程
335
電界効果トランジスタ
336
絶縁ゲートを有するもの
H 電気
01
基本的電気素子
L
半導体装置,他に属さない電気的固体装置
21
半導体装置または固体装置またはそれらの部品の製造または処理に特に適用される方法または装置
70
1つの共通基板内または上に形成された複数の固体構成部品または集積回路からなる装置またはその特定部品の製造または処理;集積回路装置またはその特定部品の製造
71
グループ21/70で限定された装置の特定部品の製造
76
構成部品間の分離領域の形成
H 電気
01
基本的電気素子
L
半導体装置,他に属さない電気的固体装置
21
半導体装置または固体装置またはそれらの部品の製造または処理に特に適用される方法または装置
70
1つの共通基板内または上に形成された複数の固体構成部品または集積回路からなる装置またはその特定部品の製造または処理;集積回路装置またはその特定部品の製造
71
グループ21/70で限定された装置の特定部品の製造
76
構成部品間の分離領域の形成
762
誘電体領域
H 電気
01
基本的電気素子
L
半導体装置,他に属さない電気的固体装置
29
整流,増幅,発振またはスイッチングに特に適用される半導体装置であり,少なくとも1つの電位障壁または表面障壁を有するもの;少なくとも1つの電位障壁または表面障壁,例.PN接合空乏層またはキャリア集中層,を有するコンデンサーまたは抵抗器;半導体本体または電極の細部整流,増幅,発振またはスイッチングに特に適用される半導体装置であり,少なくとも1つの電位障壁または表面障壁を有するもの;少なくとも1つの電位障壁または表面障壁,例.PN接合空乏層またはキャリア集中層,を有するコンデンサーまたは抵抗器;半導体本体または電極の細部(31/00~47/00,51/05が優先;半導体本体または電極以外の細部23/00;1つの共通基板内または上に形成された複数の固体構成部品からなる装置27/00
66
半導体装置の型
68
整流,増幅またはスイッチされる電流を流さない電極に電流のみまたは電位のみを与えることにより制御できるもの
76
ユニポーラ装置
772
電界効果トランジスタ
78
絶縁ゲートによって生じる電界効果を有するもの
786
薄膜トランジスタ
出願人:
ソニーセミコンダクタソリューションズ株式会社 SONY SEMICONDUCTOR SOLUTIONS CORPORATION [JP/JP]; 神奈川県厚木市旭町四丁目14番1号 4-14-1, Asahi-cho, Atsugi-shi, Kanagawa 2430014, JP
発明者:
柳澤 佑輝 YANAGISAWA Yuki; JP
代理人:
山本 孝久 YAMAMOTO Takahisa; JP
吉井 正明 YOSHII Masaaki; JP
優先権情報:
2016-24827221.12.2016JP
発明の名称: (EN) SEMICONDUCTOR DEVICE, SEMICONDUCTOR DEVICE MANUFACTURING METHOD, AND ELECTRONIC APPARATUS
(FR) DISPOSITIF SEMICONDUCTEUR, PROCÉDÉ DE FABRICATION D'UN DISPOSITIF SEMICONDUCTEUR, ET APPAREIL ÉLECTRONIQUE
(JA) 半導体装置、半導体装置の製造方法、及び、電子機器
要約:
(EN) A semiconductor device formed from an SOI substrate comprising a substrate, a BOX layer formed on the substrate, and an SOI layer formed on the BOX layer. In at least a part of the BOX layer disposed in a non-active region adjacent to an active region, a part or all of the BOX layer is removed. The BOX layer in a part in which the SOI layer forming the active region is disposed is configured such that a deformation for applying stress to the SOI layer remains therein.
(FR) L'invention concerne un dispositif semiconducteur formé à partir d'un substrat SOI comprenant un substrat, une couche BOX formée sur le substrat, et une couche SOI formée sur la couche BOX. Dans au moins une partie de la couche BOX disposée dans une région non active adjacente à une région active, tout ou partie de la couche BOX est retirée. La couche BOX se trouvant dans une partie dans laquelle la couche SOI formant la région active est disposée, est configurée de telle sorte qu'une déformation permettant d'appliquer une contrainte à la couche SOI reste à l'intérieur de celle-ci.
(JA) 基板と、基板上に形成されたBOX層と、BOX層上に形成されたSOI層とから成るSOI基板を用いて形成された半導体装置であって、アクティブ領域に隣接する非アクティブ領域に配置されたBOX層のうち少なくとも一部において、BOX層の一部あるいは全てが除去されており、アクティブ領域を形成するSOI層が配置される部分のBOX層は、SOI層に応力を加えるための変形が残留するように構成されている。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)