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1. (WO2018047244) 表示装置
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国際公開番号:    WO/2018/047244    国際出願番号:    PCT/JP2016/076214
国際公開日: 15.03.2018 国際出願日: 06.09.2016
IPC:
G09G 3/20 (2006.01), G09G 3/36 (2006.01)
出願人: SAKAI DISPLAY PRODUCTS CORPORATION [JP/JP]; 1, Takumi-cho, Sakai-ku, Sakai-shi, Osaka 5908522 (JP)
発明者: SHIMIZU, Yoshiyuki; (JP)
代理人: SAMEJIMA, Mutsumi; (JP).
KAWABATA, Junichi; (JP)
優先権情報:
発明の名称: (EN) DISPLAY DEVICE
(FR) DISPOSITIF D'AFFICHAGE
(JA) 表示装置
要約: front page image
(EN)A display device (1) includes a display panel (10), a first gate drive circuit (11), a second gate drive circuit (12), a first gate slope formation unit (21), and a second gate slope formation unit (22). A plurality of pixels (3) is arranged in a matrix in the display panel. A plurality of gate lines (GL) for selecting pixel groups arranged along rows (X) is arranged along columns (Y) in the matrix. The first gate drive circuit supplies each gate line with a first gate drive signal from each end of the plurality of gate lines. The second gate drive circuit supplies each gate line with a second gate drive signal from each opposite end of the plurality of gate lines. The first gate slope formation unit forms a declining gate slope in the signal waveform of the first gate drive signal. The second gate slope formation unit forms a gate slope of the second gate drive signal independently of the first gate slope formation unit.
(FR)La présente invention concerne un dispositif d'affichage (1) qui comprend un panneau d'affichage (10), un premier circuit d'attaque de grille (11), un second circuit d'attaque de grille (12), une première unité de formation de pente de grille (21) et une seconde unité de formation de pente de grille (22). Une pluralité de pixels (3) est agencée dans une matrice dans le panneau d'affichage. Une pluralité de lignes de grille (GL) destinée à sélectionner des groupes de pixels agencés le long de rangées (X) est agencée le long des colonnes (Y) dans la matrice. Le premier circuit d'attaque de grille fournit à chaque ligne de grille un premier signal d'attaque de grille à partir de chaque extrémité de la pluralité de lignes de grille. Le second circuit d'attaque de grille fournit à chaque ligne de grille un second signal d'attaque de grille à partir de chaque extrémité opposée de la pluralité de lignes de grille. La première unité de formation de pente de grille forme une pente de grille déclinante dans la forme d'onde de signal du premier signal d'attaque de grille. La seconde unité de formation de pente de grille forme une pente de grille du second signal d'attaque de grille indépendamment de la première unité de formation de pente de grille.
(JA)表示装置(1)は、表示パネル(10)と、第1のゲート駆動回路(11)と、第2のゲート駆動回路(12)と、第1のゲートスロープ形成部(21)と、第2のゲートスロープ形成部(22)とを備える。表示パネルには、複数の画素(3)がマトリックス状に配置され、マトリックスの行方向(X)に並ぶ画素群を選択するゲート線(GL)がマトリックスの列方向(Y)に複数、並置される。第1のゲート駆動回路は、複数のゲート線のそれぞれの一端から各ゲート線に第1のゲート駆動信号を供給する。第2のゲート駆動回路は、複数のゲート線のそれぞれの他端から各ゲート線に第2のゲート駆動信号を供給する。第1のゲートスロープ形成部は、第1のゲート駆動信号の信号波形における立ち下がりのスロープであるゲートスロープを形成する。第2のゲートスロープ形成部は、第1のゲートスロープ形成部とは独立して、第2のゲート駆動信号のゲートスロープを形成する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)