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1. (WO2018042767) バス制御回路、半導体集積回路、回路基板、情報処理装置およびバス制御方法
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国際公開番号: WO/2018/042767 国際出願番号: PCT/JP2017/017601
国際公開日: 08.03.2018 国際出願日: 09.05.2017
IPC:
G06F 13/36 (2006.01) ,G06F 12/00 (2006.01)
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
13
メモリ,入力/出力装置または中央処理ユニットの間の情報または他の信号の相互接続または転送
14
相互接続または転送のための接続要求
36
共通バスまたはバスシステムに対するアクセスのためのもの
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
12
メモリ・システムまたはアーキテクチャ内でのアクセシング,アドレシングまたはアロケーティング(情報記憶一般G11)
出願人:
株式会社ソシオネクスト SOCIONEXT INC. [JP/JP]; 神奈川県横浜市港北区新横浜二丁目10番23 2-10-23, Shin-Yokohama, Kohoku-ku, Yokohama-shi, Kanagawa 2220033, JP
発明者:
大谷 敬之 OTANI, Takayuki; JP
上方 輝彦 KAMIGATA, Teruhiko; JP
川崎 貴之 KAWASAKI, Takashi; JP
仁茂田 永一 NIMODA, Eiichi; JP
代理人:
青木 篤 AOKI, Atsushi; JP
伊坪 公一 ITSUBO, Koichi; JP
河野 努 KAWANO, Tsutomu; JP
宮本 哲夫 MIYAMOTO, Tetsuo; JP
優先権情報:
2016-16997131.08.2016JP
発明の名称: (EN) BUS CONTROL CIRCUIT, SEMICONDUCTOR INTEGRATED CIRCUIT, CIRCUIT SUBSTRATE, INFORMATION PROCESSING DEVICE, AND BUS CONTROL METHOD
(FR) CIRCUIT DE COMMANDE DE BUS, CIRCUIT INTÉGRÉ À SEMI-CONDUCTEUR, SUBSTRAT DE CIRCUIT, DISPOSITIF DE TRAITEMENT D'INFORMATIONS ET PROCÉDÉ DE COMMANDE DE BUS
(JA) バス制御回路、半導体集積回路、回路基板、情報処理装置およびバス制御方法
要約:
(EN) Provided is a bus control circuit that: mutually converts a first exclusive command of a first bus specification, which corresponds to exclusive access and which has a first format, with a second exclusive command of the first bus specification, the second exclusive command having a second format adapted to a second bus specification not corresponding to exclusive access; and propagates the exclusive commands of the first and second bus specifications. The bus control circuit includes: an exclusive command converting circuit that, during conversion of the first exclusive command to the second exclusive command, receives the first exclusive command, converts the first exclusive command to the second exclusive command, and then outputs the second exclusive command; an exclusive command generating circuit that, during conversion from the second exclusive command to the first exclusive command, receives the second exclusive command and generates the first exclusive command; an exclusive response issuing circuit that, during conversion from the second exclusive command to the first exclusive command, issues exclusive response information regarding the second exclusive command; and an exclusive response receiving circuit that, during conversion of the first exclusive command to the second exclusive command, receives the exclusive response information regarding the second exclusive command.
(FR) La présente invention concerne un circuit de commande de bus, lequel circuit de commande de bus : convertit mutuellement une première commande exclusive d'une première spécification de bus, qui correspond à un accès exclusif et qui possède un premier format, avec une seconde commande exclusive de la première spécification de bus, la seconde commande exclusive possédant un second format adapté à une seconde spécification de bus ne correspondant pas à un accès exclusif ; et répand les commandes exclusives des première et seconde spécifications de bus. Le circuit de commande de bus comprend : un circuit de conversion de commande exclusive qui, pendant la conversion de la première commande exclusive en la seconde commande exclusive, reçoit la première commande exclusive, convertit la première commande exclusive en la seconde commande exclusive, et délivre ensuite la seconde commande exclusive ; un circuit de génération de commande exclusive qui, pendant la conversion de la seconde commande exclusive à la première commande exclusive, reçoit la seconde commande exclusive et génère la première commande exclusive ; un circuit d'émission de réponse exclusive qui, pendant la conversion de la seconde commande exclusive en la première commande exclusive, émet des informations de réponse exclusive concernant la seconde commande exclusive ; et un circuit de réception de réponse exclusive qui, pendant la conversion de la première commande exclusive en la seconde commande exclusive, reçoit les informations de réponse exclusive concernant la seconde commande exclusive.
(JA) 第1フォーマットを有する、排他アクセスに対応した第1バス仕様の第1排他コマンドと、排他アクセスに対応しない第2バス仕様に適合した第2フォーマットを有する、第1バス仕様の第2排他コマンドを相互に変換して、第1および第2バス仕様間の排他コマンドの伝搬を行うバス制御回路であって、第1排他コマンドから第2排他コマンドへの変換のときに、第1排他コマンドを受け取り、第2排他コマンドに変換して出力する排他コマンド変換回路と、第2排他コマンドから第1排他コマンドへの変換のときに、第2排他コマンドを受け取って第1排他コマンドを生成する排他コマンド生成回路と、第2排他コマンドから第1排他コマンドへの変換のときに、第2排他コマンドに対する排他応答情報を発行する排他応答発行回路と、第1排他コマンドから第2排他コマンドへの変換のときに、第2排他コマンドに対する排他応答情報を受け取る排他応答受信回路と、を有する。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)