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1. (WO2017037902) 半導体システムおよび計算方法
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2017/037902    国際出願番号:    PCT/JP2015/075001
国際公開日: 09.03.2017 国際出願日: 02.09.2015
IPC:
G06F 15/80 (2006.01)
出願人: HITACHI, LTD. [JP/JP]; 6-6, Marunouchi 1-chome, Chiyoda-ku, Tokyo 1008280 (JP)
発明者: AKAI, Akihito; (JP).
YOSHIMURA, Chihiro; (JP).
HAYASHI, Masato; (JP).
OKUYAMA, Takuya; (JP).
YAMAOKA, Masanao; (JP).
AOKI, Hidetaka; (JP)
代理人: TSUTSUI & ASSOCIATES; 3F, Shinjuku Gyoen Bldg., 3-10, Shinjuku 2-chome, Shinjuku-ku, Tokyo 1600022 (JP)
優先権情報:
発明の名称: (EN) SEMICONDUCTOR SYSTEM AND COMPUTING METHOD
(FR) SYSTÈME À SEMI-CONDUCTEUR ET PROCÉDÉ DE CALCUL
(JA) 半導体システムおよび計算方法
要約: front page image
(EN)A low-cost and easily manufacturable semiconductor system and a computation method are provided which can perform, with an optimal partition method, computation of a large-scale and complex interaction model such as an Ising model. In a semiconductor system 104, a controller 106 is provided with a spin data storage unit 112, a problem data storage unit 111, a register 108, an address generating unit 123, an expansion unit 125, and a data summing unit 126. In the registers 108, an address in the spin data storage unit 112 and the problem data storage unit 111 for indicating a boundary when partitioning problem data to be processed is configured. The data summing unit 126 receives the spin values stored in the memory cells of multiple semiconductor chips 116, and stores these in the spin data storage unit 112 on the basis of a correspondence relation.
(FR)L'invention concerne un système à semi-conducteur pouvant être fabriqué facilement et à faible coût ainsi qu'un procédé de calcul, qui peuvent, avec un procédé de partitionnement optimal, calculer un modèle d'interaction complexe à grande échelle tel qu'un modèle d'Ising. Dans un système à semi-conducteur (104), un contrôleur (106) est doté d'une unité de mémorisation de données à spin (112), d'une unité de mémorisation de données de problème (111), d'un registre (108), d'une unité de génération d'adresse (123), d'une unité d'expansion (125) et d'une unité d'addition de données (126). Dans le registre (108), une adresse dans l'unité de mémorisation de données à spin (112) et l'unité de mémorisation de données de problème (111) servant à indiquer une limite lors du partitionnement de données de problème à traiter est configurée. L'unité d'addition de données (126) reçoit les valeurs de spin mémorisées par les cellules de mémoire de plusieurs puces à semi-conducteur (116), et les place dans l'unité de mémorisation de données à spin (112) sur la base d'une relation de correspondance.
(JA)例えばイジングモデルなどのような大規模かつ複雑な相互作用モデルの計算を最適な分割方法で行うことができ、安価かつ容易に製造可能な半導体システムおよび計算方法である。半導体システム104において、コントローラ106は、スピンデータ格納部112と、問題データ格納部111と、レジス108と、アドレス生成部123と、展開部125と、データ集計部126とを備える。レジス108には、処理対象とする問題データの分割する際の境界を指定するためのスピンデータ格納部112および問題データ格納部111のアドレスが設定される。データ集計部126は、複数の半導体チップ116のメモリセルに格納された各スピンの値を受信し、対応関係に基づきスピンデータ格納部112へ格納する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)