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1. (WO2017002368) 半導体装置
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2017/002368    国際出願番号:    PCT/JP2016/003133
国際公開日: 05.01.2017 国際出願日: 30.06.2016
IPC:
H01L 21/822 (2006.01), H01L 21/8234 (2006.01), H01L 27/04 (2006.01), H01L 27/088 (2006.01), H01L 29/78 (2006.01)
出願人: PANASONIC INTELLECTUAL PROPERTY MANAGEMENT CO., LTD. [JP/JP]; 1-61, Shiromi 2-chome, Chuo-ku, Osaka-shi, Osaka 5406207 (JP)
発明者: OTA, Tomonari; (--).
SOTA, Shigetoshi; (--).
YASUDA, Eiji; (--).
IMAMURA, Takeshi; (--).
IMAI, Toshikazu; (--).
OKAWA, Ryosuke; (--).
YOSHIDA, Kazuma; (--).
HIRAKO, Masaaki; (--).
AHN, Dohwan;
代理人: KAMATA, Kenji; (JP)
優先権情報:
2015-132819 01.07.2015 JP
発明の名称: (EN) SEMICONDUCTOR DEVICE
(FR) DISPOSITIF À SEMI-CONDUCTEUR
(JA) 半導体装置
要約: front page image
(EN)A chip-size package-type semiconductor device (1) is provided with a plurality of electrodes connected to two kinds of potentials at most. In discretionary combinations of a first electrode (51) connected to a first potential, and a second electrode (52) connected to a second potential, said first electrode and said second electrode being among the electrodes, the closest points of respective first electrode (51) and second electrode (52) are on a straight line (44) diagonal to a chip side. The first electrode (51) and the second electrode (52) may be provided within a strip-shaped region (45) having a width equal to or less than a predetermined value w in plan view.
(FR)L'invention concerne un dispositif à semi-conducteur (1) du type à boîtier à puce, qui est pourvu d'une pluralité d'électrodes connectées à au plus deux types de potentiels. Dans des combinaisons arbitraires d'une première électrode (51) connectée à un premier potentiel et d'une seconde électrode (52) connectée à un second potentiel, ladite première électrode et ladite seconde électrode faisant partie des électrodes, les points les plus proches de la première électrode (51) et de la seconde électrode (52) respectives se trouvent sur une ligne droite (44) en diagonale par rapport à un côté de puce. La première électrode (51) et la seconde électrode (52) peuvent être situées à l'intérieur d'une région en forme de bande (45) ayant une largeur inférieure ou égale à une valeur prédéterminée w en vue plane.
(JA)チップサイズパッケージ型の半導体装置(1)であって、高々2種類の電位に接続される複数の電極を備え、複数の電極のうち、第1電位に接続される第1電極(51)と第2電位に接続される第2電極(52)との任意の組み合わせについて、第1電極(51)と第2電極(52)との最近接点同士がチップ辺に対して傾いた直線(44)上にある。第1電極(51)及び第2電極(52)の各々は、上面視で、幅が一定値w以下の帯状領域(45)内に設けられていてもよい。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)