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1. (WO2014123199) 電力変換回路の横流電流抑制制御装置
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2014/123199    国際出願番号:    PCT/JP2014/052798
国際公開日: 14.08.2014 国際出願日: 06.02.2014
IPC:
H02M 7/493 (2007.01), H02J 3/38 (2006.01), H02M 7/48 (2007.01)
出願人: MEIDENSHA CORPORATION [JP/JP]; 1-1, Osaki 2-chome, Shinagawa-ku, Tokyo 1416029 (JP)
発明者: OI, Kazunobu; (JP)
代理人: KOBAYASHI, Hiromichi; c/o Shiga Patent Office, Ekisaikai Bldg., 1-29, Akashi-cho, Chuo-ku, Tokyo 1040044 (JP)
優先権情報:
2013-020991 06.02.2013 JP
発明の名称: (EN) CROSS-CURRENT SUPPRESSION CONTROL DEVICE FOR POWER CONVERSION CIRCUIT
(FR) DISPOSITIF DE COMMANDE DE SUPPRESSION DE COURANTS CONTRAIRES POUR UN CIRCUIT DE CONVERSION DE PUISSANCE
(JA) 電力変換回路の横流電流抑制制御装置
要約: front page image
(EN)A power conversion device having inverter units connected in parallel, wherein not only cross-current caused by gate signal timing, but also cross-current caused by switching element characteristics errors as well as gate signal delay interference caused by, e.g., a physical configuration as a result of the distance or shape of a transmission circuit are suppressed. A specified gain is multiplied by a proportional amp (P), using as the cross-current the deviation between an inverter unit output current command value (IinvUdet/N) and an inverter unit output current detection value (IinvUNdet). Integral amps (I1-I4) are provided each time each switching element is turned ON or OFF, and the cross-current generated after the switching elements have turned ON or turned OFF is integral-amp processed and updated. The outputs of the proportional amp (P) and the integral amps (I1-I4) are added and a rising gate delay command value (DelayrefU) and a falling gate delay command value (DelayrefD) are output.
(FR)L'invention porte sur un dispositif de conversion de puissance ayant des unités d'onduleur connectées en parallèle, non seulement des courants contraires provoqués par une temporisation de signal de grille, mais également des courants contraires provoqués par des erreurs de caractéristiques d'élément de commutation ainsi qu'un brouillage de retard de signal de grille provoqué, par exemple, par une configuration physique résultant de la distance ou de la forme d'un circuit d'émission, étant supprimés. Un gain spécifié est multiplié par un amplificateur proportionnel (P), en utilisant en tant que courants contraires l'écart entre une valeur d'instruction de courant de sortie d'unité d'onduleur (IinvUdet/N) et une valeur de détection de courant de sortie d'unité d'onduleur (IinvUNdet). Des amplificateurs intégrés (I1-I4) sont fournis à chaque fois que chaque élément de commutation est passant ou bloqué, et les courants contraires générés après que les éléments de commutation sont passants ou bloqués sont traités par amplificateur intégré et mis à jour. Les sorties de l'amplificateur proportionnel (P) et des amplificateurs intégrés (I1-I4) sont additionnées et une valeur d'instruction de retard de grille montante (DelayrefU) et une valeur d'instruction de retard de grille descendante (DelayrefD) sont délivrées en sortie.
(JA)インバータユニットを並列接続した電力変換装置において、ゲート信号のタイミン グに起因する横流電流だけでなく、スイッチング素子の特性誤差や、伝送回路の距離 や形状による物理的構成等に起因するゲート信号の遅延外乱に起因する横流電流を抑 制する。 比例アンプPにより、インバータユニット出力電流指令値IinvUdet/Nと インバータユニット出力電流検出値IinvUNdetとの偏差を横流電流として指 定ゲインを乗算する。積分アンプI1~I4は、各スイッチング素子のターンON, ターンOFFごとに設けられ、スイッチング素子がターンONまたはターンOFFし た後に生じた横流電流を積分アンプ処理して更新する。比例アンプPと積分アンプI 1~I4との出力を加算して、立ち上がりのゲート遅延指令値DelayrefUと 立ち下がりのゲート遅延指令値DelayrefDを出力する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)