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1. (WO2013046548) メモリ制御システム及び電力制御方法
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2013/046548    国際出願番号:    PCT/JP2012/005630
国際公開日: 04.04.2013 国際出願日: 05.09.2012
予備審査請求日:    25.02.2013    
IPC:
G06F 12/00 (2006.01), G06F 1/26 (2006.01), G06F 1/32 (2006.01)
出願人: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (米国を除く全ての指定国).
MUROYAMA, Takashi; (米国のみ).
TAKAHASHI, Akira; (米国のみ)
発明者: MUROYAMA, Takashi; .
TAKAHASHI, Akira;
代理人: NII, Hiromori; c/o NII Patent Firm, 6F, Tanaka Ito Pia Shin-Osaka Bldg.,3-10, Nishi Nakajima 5-chome, Yodogawa-ku, Osaka-city, Osaka 5320011 (JP)
優先権情報:
2011-213442 28.09.2011 JP
発明の名称: (EN) MEMORY CONTROL SYSTEM AND POWER CONTROL METHOD
(FR) SYSTÈME DE COMMANDE DE MÉMOIRE ET PROCÉDÉ DE COMMANDE DE PUISSANCE
(JA) メモリ制御システム及び電力制御方法
要約: front page image
(EN)Among a plurality of memories, prescribed conditions relating to the condition of use of the memories may be satisfied and some memories may be unused. A memory control system (100) comprises: a plurality of I/O circuits; and a power control circuit (160) that performs power consumption reduction processing by controlling individual I/O circuits so as to reduce the power consumption of an I/O circuit in question that is connected with such an unused memory, compared to the power consumption of the I/O circuits other than this I/O circuit in question.
(FR)Parmi une pluralité de mémoires, les conditions prescrites relatives à la condition d'utilisation des mémoires peuvent être remplies et certaines mémoires peuvent être inutilisées. Un système de commande de mémoire (100) comprend : une pluralité de circuits E/S ; et un circuit de commande de puissance (160) qui exécute un processus de réduction de consommation d'énergie en contrôlant les circuits E/S individuels de façon à réduire la consommation d'énergie d'un circuit E/S en question qui est connecté à une telle mémoire inutilisée, en comparaison à la consommation d'énergie des circuits E/S autres que le circuit E/S en question.
(JA) メモリ制御システム(100)は、複数のI/O回路と、メモリの使用状態に関する所定条件が満たされた場合であって、かつ、複数のメモリのうち不使用のメモリが存在する場合、該不使用のメモリに接続される前記I/O回路である対象I/O回路の消費電力を、前記複数のI/O回路のうち該対象I/O回路以外のI/O回路の消費電力より低くするよう前記対象I/O回路を制御する消費電力低減処理を行う電力制御回路(160)とを備える。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)