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1. (WO2012008066) デインタリーブ装置および方法ならびにデータ伝送システムおよび方法
国際事務局に記録されている最新の書誌情報

国際公開番号: WO/2012/008066 国際出願番号: PCT/JP2011/000091
国際公開日: 19.01.2012 国際出願日: 12.01.2011
IPC:
H03M 13/27 (2006.01)
H 電気
03
基本電子回路
M
符号化,復号化または符号変換一般
13
誤りの検出または誤りの訂正のための符号化,復号化または符号変換;符号理論の基本的仮定;符号化の限界式;誤り確率の評価方法;通信路モデル;符号のシミュレーションまたは試験
27
インターリーブ技術を用いるもの
出願人:
パナソニック株式会社 PANASONIC CORPORATION [JP/JP]; 大阪府門真市大字門真1006番地 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501, JP (AllExceptUS)
石井竜次 ISHII, Tatsuji; null (UsOnly)
発明者:
石井竜次 ISHII, Tatsuji; null
代理人:
前田弘 MAEDA, Hiroshi; 大阪府大阪市中央区本町2丁目5番7号 大阪丸紅ビル Osaka-Marubeni Bldg.,5-7,Hommachi 2-chome, Chuo-ku, Osaka-shi, Osaka 5410053, JP
優先権情報:
2010-15805412.07.2010JP
発明の名称: (EN) DE-INTERLEAVING DEVICE AND METHOD, AND DATA TRANSMISSION SYSTEM AND METHOD
(FR) DISPOSITIF ET PROCÉDÉ DE DÉSENTRELACEMENT ET SYSTÈME ET PROCÉDÉ DE TRANSMISSION DE DONNÉES
(JA) デインタリーブ装置および方法ならびにデータ伝送システムおよび方法
要約:
(EN) A variable-length input data block is de-interleaved by using one memory without an additional storage means. Disclosed is a de-interleaving device for de-interleaving an interleaved input data block by storing data of an original data block comprising R×C' (C' is a given divisor of R×C) number of data in a matrix having R number of columns and C number of rows with priority given to data in the rows and by reading the aforementioned data with priority given to data in the columns. Specifically disclosed is a de-interleaving device provided with: a memory (11) capable of storing R×C number of data; a write address generating unit (12) for generating a write address on the basis of a first incremental value; a read address generating unit (13) for generating a read address for data other than the (n×R)+1th data on the basis of the first incremental value and for generating a read address for the (n×R)+1th data on the basis of a second incremental value; and a memory interface unit (14) for sequentially reading data from the read address and for sequentially writing data of the input data block to the write address.
(FR) Un bloc de données d'entrée à longueur variable est désentrelacé par utilisation d'une mémoire sans moyen de stockage supplémentaire. L'invention concerne un dispositif de désentrelacement permettant de désentrelacer un bloc de données d'entrée entrelacé en stockant des données d'un bloc de données initial comprenant R×C' (C' est un diviseur donné de R×C) données dans une matrice comprenant R colonnes et C lignes, la priorité étant conférée à des données se trouvant dans les lignes, et en lisant les données précitées en considérant de manière prioritaire les données contenues dans les colonnes. L'invention concerne plus précisément un dispositif de désentrelacement comprenant : une mémoire (11) capable de stocker R×C données ; une unité génératrice d'adresse d'écriture (12) permettant de générer une adresse d'écriture sur la base d'une première valeur incrémentielle ; une unité génératrice d'adresse de lecture (13) destinée à générer une adresse de lecture pour des données autres que la (n×R)+1-ème donnée sur la base de la première valeur incrémentielle et à générer une adresse de lecture de la (n×R)+1-ème donnée sur la base d'une seconde valeur incrémentielle, et une unité d'interface de mémoire (14) permettant de lire séquentiellement des données à l'adresse de lecture et d'écrire séquentiellement des données du bloc de données d'entrée à l'adresse d'écriture.
(JA)  追加の記憶手段なしで1個のメモリを用いて可変長の入力データブロックをデインタリーブする。R行×C列のマトリクスにR×C'個(ただし、C'はR×Cの任意の約数である)のデータからなる原データブロックのデータを列優先で格納して行優先で読み出すことでインタリーブされた入力データブロックをデインタリーブするデインタリーブ装置は、R×C個のデータを格納可能なメモリ(11)と、第1の増分値に基づいてライトアドレスを生成するライトアドレス生成部(12)と、第1の増分値に基づいて第(n×R)+1番目以外のリードアドレスを生成する一方、第2の増分値に基づいて第(n×R)+1番目のリードアドレスを生成するリードアドレス生成部(13)と、リードアドレスからデータを順次読み出すとともに、ライトアドレスに入力データブロックのデータを順次書き込むメモリインタフェース部(14)とを備えている。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)
また、:
US20130132705EP2595320CN102959874JPWO2012008066