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1. (WO2011114394) 仮想マルチプロセッサシステム
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2011/114394    国際出願番号:    PCT/JP2010/004771
国際公開日: 22.09.2011 国際出願日: 27.07.2010
IPC:
G06F 9/48 (2006.01)
出願人: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (米国を除く全ての指定国).
TAKEUCHI, Akira; (米国のみ)
発明者: TAKEUCHI, Akira;
代理人: MAEDA, Hiroshi; Osaka-Marubeni Bldg. 5-7, Hommachi 2-chome Chuo-ku, Osaka-shi Osaka 5410053 (JP)
優先権情報:
2010-062245 18.03.2010 JP
発明の名称: (EN) VIRTUAL MULTI-PROCESSOR SYSTEM
(FR) SYSTÈME MULTIPROCESSEUR VIRTUEL
(JA) 仮想マルチプロセッサシステム
要約: front page image
(EN)In a virtual multi-processor system, a plurality of logic processors (101) are provided. Furthermore, a logic processor control unit (102) is provided for assigning time slices to each logic processor (101) and controlling the logic processors (101) to which the time slices have been assigned so that execution is performed in order on a time-shared basis. In addition, if a request for interrupt processing occurs, control is performed at an external interrupt control unit (106) so that a logic processor (101) that has a time slice wherein interrupt processing is possible and that is immediately to execute executes the interrupt processing.
(FR)L'invention concerne un système multiprocesseur virtuel qui comprend une pluralité de processeurs logiques (101). Il existe en outre une unité de commande de processeur logique (102) pour attribuer des créneaux temporels à chaque processeur logique (101) et commander les processeurs logiques (101) auxquels ont été attribués les créneaux temporels de sorte que l'exécution se déroule dans l'ordre selon le principe du temps partagé. De plus, s'il se produit une demande de traitement d'interruption, une commande est effectuée sur une unité de commande d'interruption externe (106) de sorte que le processeur logique (101) qui dispose d'un créneau temporel au sein duquel le traitement de l'interruption est possible et qui peut immédiatement l'exécuter exécute le traitement de l'interruption.
(JA)仮想マルチプロセッサシステムにおいて、複数の論理プロセッサ(101)を設ける。また、各論理プロセッサ(101)にタイムスライスを割当てて、タイムスライスを割り当てた論理プロセッサ(101)が時分割で順番に実行を行うよう制御する論理プロセッサ制御部(102)とを設ける。そして、割込み処理の要求が発生した場合に、割込み処理が可能なタイムスライスを有し、かつ直近に実行を行う論理プロセッサ(101)が、割込み処理を実行するように、外部割込み制御部(106)で制御する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)