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1. (WO2011046089) シミュレーション方法、システム及びプログラム
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2011/046089    国際出願番号:    PCT/JP2010/067772
国際公開日: 21.04.2011 国際出願日: 08.10.2010
IPC:
G06F 11/28 (2006.01)
出願人: INTERNATIONAL BUSINESS MACHINES CORPORATION [US/US]; New Orchard Road, Armonk, New York 10504 (US) (米国を除く全ての指定国).
SHIMIZU Shuichi [JP/JP]; (JP) (米国のみ).
KOMATSU Hideaki [JP/JP]; (JP) (米国のみ).
KAJITANI Kohichi [JP/JP]; (JP) (米国のみ)
発明者: SHIMIZU Shuichi; (JP).
KOMATSU Hideaki; (JP).
KAJITANI Kohichi; (JP)
代理人: UENO Takeshi; c/o Yamato site, IBM Japan Ltd., 1623-14, Shimotsuruma, Yamato-shi, Kanagawa 2428502 (JP)
優先権情報:
2009-238954 16.10.2009 JP
発明の名称: (EN) SIMULATION METHOD, SYSTEM, AND PROGRAM
(FR) PROCÉDÉ, SYSTÈME ET PROGRAMME DE SIMULATION
(JA) シミュレーション方法、システム及びプログラム
要約: front page image
(EN)Provided is a V-PILS by which reproducibility of a simulation operation can be achieved while reasonably maintaining a operation speed. A peripheral scheduler starts concurrent operation of all peripheral emulators, identifies a peripheral emulator (peripheral P) which is scheduled to reach a separation of a process earliest on the basis of the process separation time of the set respective peripheral emulators, executes each processor emulator and each plant simulator until the separation time, and synchronizes data between the peripheral P and the processor emulator and the peripheral P and the plant simulator.
(FR)L'invention concerne un V-PILS permettant de reproduire une opération de simulation tout en conservant une vitesse d'opération raisonnable. Un ordonnanceur périphérique lance le fonctionnement simultané de tous les émulateurs de périphériques, identifie un émulateur de périphérique (périphérique P) qui est planifié pour atteindre une séparation de processus le plus précocement sur la base de la durée de séparation du processus des émulateurs de périphériques respectifs sélectionnés, lance chaque émulateur de processeur et chaque simulateur d'installation jusqu'au moment de la séparation, et synchronise les données entre le périphérique P et l'émulateur de processeur et entre le périphérique P et le simulateur d'installation.
(JA) 動作速度を妥当に維持しつつ、シミュレーション動作の再現性を実現することを可能ならしめる、V-PILSを提供する。 ペリフェラル・スケジューラは、全てのペリフェラル・エミュレータの並列動作を開始し、設定された個々のペリフェラル・エミュレータの処理の区切りタイミングに基づき、最も早く処理の区切りを迎える予定のペリフェラル・エミュレータ(ペリフェラルP)を見出し、当該区切りの時間に達する時点まで、各プロセッサ・エミュレータと、各プラント・シミュレータの実行を進め、ペリフェラルP と、プロセッサ・エミュレータ及びプラント・シミュレータの間でデータを同期させる。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)