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1. (WO2011013365) シンボルレート検出器及び受信装置
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2011/013365    国際出願番号:    PCT/JP2010/004793
国際公開日: 03.02.2011 国際出願日: 28.07.2010
IPC:
H04L 27/38 (2006.01), H04L 27/00 (2006.01)
出願人: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (米国を除く全ての指定国).
SOGA, Shigeru; (米国のみ)
発明者: SOGA, Shigeru;
代理人: MAEDA, Hiroshi; Osaka-Marubeni Bldg.,5-7,Hommachi 2-chome, Chuo-ku, Osaka-shi, Osaka 5410053 (JP)
優先権情報:
2009-178180 30.07.2009 JP
発明の名称: (EN) SYMBOL RATE DETECTOR AND RECEIVER DEVICE
(FR) DÉTECTEUR DE TAUX DE SYMBOLES ET DISPOSITIF RÉCEPTEUR
(JA) シンボルレート検出器及び受信装置
要約: front page image
(EN)Provided is a symbol rate detector that minimizes the circuit size, and detects the symbol rate of a digital modulation signal in a short period of time. The symbol rate detector has a nonlinear processing unit that implements nonlinear processing to the digital modulation signal, and outputs the post-nonlinear-processing digital modulation signal; and a phase-locked loop that applies a phase-lock to the aforementioned post-nonlinear-processing digital modulation signal. The aforementioned phase-locked loop has an oscillator that generates a signal having a frequency that is in accordance with the detected symbol rate; a complex multiplier that multiplies the aforementioned post-nonlinear-processing digital modulation signal and a signal generated by the aforementioned oscillator, and outputs the multiplication result; and a loop filter that smoothes the aforementioned multiplication result, and outputs the smoothed multiplication result as the aforementioned detected symbol rate.
(FR)La présente invention se rapporte à un détecteur de taux de symboles qui réduit la taille d'un circuit et détecte le taux de symboles d'un signal de modulation numérique sur une courte période de temps. Le détecteur de taux de symboles comprend un module de traitement non linéaire qui exécute un traitement non linéaire sur le signal de modulation numérique et délivre en sortie le signal de modulation numérique après exécution du traitement non linéaire. Le détecteur de taux de symboles comprend également une boucle à verrouillage de phase qui applique un verrouillage de phase sur le signal de modulation numérique après exécution du traitement non linéaire susmentionné. La boucle à verrouillage de phase susmentionnée comprend : un oscillateur qui génère un signal dont la fréquence est conforme au taux de symboles détecté ; un multiplicateur complexe qui multiplie le signal de modulation numérique après exécution du traitement non linéaire susmentionné et un signal généré par l'oscillateur susmentionné, et qui délivre en sortie le résultat de la multiplication ; et un filtre à boucle qui lisse le résultat de la multiplication susmentionné, et qui délivre en sortie le résultat de la multiplication lissé au taux de symboles détecté susmentionné.
(JA) 回路規模を抑え、短時間でデジタル変調信号のシンボルレートを検出する。シンボルレート検出器であって、デジタル変調信号に非線形処理を行い、非線形処理後のデジタル変調信号を出力する非線形処理部と、前記非線形処理後のデジタル変調信号に位相同期する位相同期ループとを有する。前記位相同期ループは、検出シンボルレートに応じた周波数の信号を生成する発振器と、前記非線形処理後のデジタル変調信号と前記発振器で生成された信号とを乗算し、乗算結果を出力する複素乗算器と、前記乗算結果を平滑化し、平滑化された前記乗算結果を前記検出シンボルレートとして出力するループフィルタとを有する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)