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1. (WO2010131528) 受信装置および復調方法
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2010/131528    国際出願番号:    PCT/JP2010/055814
国際公開日: 18.11.2010 国際出願日: 31.03.2010
IPC:
H04L 7/02 (2006.01), H03L 7/08 (2006.01), H03L 7/24 (2006.01)
出願人: NEC CORPORATION [JP/JP]; 7-1, Shiba 5-chome, Minato-ku, Tokyo 1088001 (JP) (米国を除く全ての指定国).
NOGUCHI, Hidemi [JP/JP]; (JP) (米国のみ).
ABE, Junichi [JP/JP]; (JP) (米国のみ).
YAMASE, Tomoyuki [JP/JP]; (JP) (米国のみ).
AMAMIYA, Yasushi [JP/JP]; (JP) (米国のみ)
発明者: NOGUCHI, Hidemi; (JP).
ABE, Junichi; (JP).
YAMASE, Tomoyuki; (JP).
AMAMIYA, Yasushi; (JP)
代理人: MIYAZAKI, Teruo; 8th Floor, 16th Kowa Bldg., 9-20, Akasaka 1-chome, Minato-ku, Tokyo 1070052 (JP)
優先権情報:
2009-114503 11.05.2009 JP
発明の名称: (EN) RECEIVING DEVICE AND DEMODULATION METHOD
(FR) DISPOSITIF DE RÉCEPTION ET PROCÉDÉ DE DÉMODULATION
(JA) 受信装置および復調方法
要約: front page image
(EN)Disclosed is a receiving device with which increases in circuit areas and cost, which are required for appropriate sampling, can be prevented. An A/D converter (2) converts a coherent signal serving as an analog signal into a digital signal by sampling in synchronization with a sampling clock signal. A DSP (3) demodulates the digital signal converted by the A/D converter (2), and calculates a phase of the sampling clock signal at which the error rate of the digital signal is minimized on the basis of the demodulated digital signal. A sampling clock extracting circuit (4) extracts a clock signal at the symbol rate of the coherent signal from the coherent signal. A phase adjusting circuit (5) adjusts the phase of the clock signal extracted by the sampling clock extracting circuit (4) to the phase calculated by the DSP (3), and generates the clock signal of which phase was adjusted as the sampling clock signal.
(FR)L'invention porte sur un dispositif de réception avec lequel des augmentations de superficie de circuit et de coût, qui sont requises pour un échantillonnage approprié, peuvent être empêchées. Un convertisseur A/N (2) convertit un signal cohérent servant de signal analogique en un signal numérique par échantillonnage en synchronisme avec un signal d'horloge d'échantillonnage. Un processeur de signal numérique (DSP) (3) démodule le signal numérique converti par le convertisseur A/N (2), et calcule une phase du signal d'horloge d'échantillonnage au niveau de laquelle le taux d'erreur du signal numérique est minimisé sur la base du signal numérique démodulé. Un circuit d'extraction d'horloge d'échantillonnage (4) extrait un signal d'horloge à la fréquence de symbole du signal cohérent à partir du signal cohérent. Un circuit d'ajustement de phase (5) ajuste la phase du signal d'horloge extrait par le circuit d'extraction d'horloge d'échantillonnage (4) à la phase calculée par le DSP (3), et génère le signal d'horloge dont la phase a été ajustée en tant que signal d'horloge d'échantillonnage.
(JA) 適切なサンプリングを行うためには、回路面積およびコストが増大するという問題を解決する受信装置を提供する。 A/D変換器2は、アナログ信号であるコヒーレント信号を、サンプリング・クロック信号に同期してサンプリングすることでデジタル信号に変換する。DSP3は、A/D変換器2が変換したデジタル信号を復調し、その復調したデジタル信号に基づいて、デジタル信号の誤り率が最小となるサンプリング・クロック信号の位相を算出する。サンプリング・クロック抽出回路4は、コヒーレント信号から、コヒーレント信号のシンボル・レートのクロック信号を抽出する。位相調整回路5は、サンプリング・クロック抽出回路4が抽出したクロック信号の位相を、DSP3が算出した位相に調整し、その位相を調整したクロック信号をサンプリング・クロック信号として生成する。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)