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1. (WO2009093360) 回路シミュレータおよび回路シミュレーション方法
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2009/093360    国際出願番号:    PCT/JP2008/069020
国際公開日: 30.07.2009 国際出願日: 21.10.2008
IPC:
G06F 17/50 (2006.01), H01L 21/8238 (2006.01), H01L 27/092 (2006.01), H01L 29/00 (2006.01)
出願人: NEC CORPORATION [JP/JP]; 7-1, Shiba 5-chome, Minato-ku, Tokyo, 1088001 (JP) (米国を除く全ての指定国).
TANOMURA, Masahiro [JP/JP]; (JP) (米国のみ).
MARUHASHI, Kenichi [JP/JP]; (JP) (米国のみ).
SHIMAWAKI, Hidenori [JP/JP]; (JP) (米国のみ)
発明者: TANOMURA, Masahiro; (JP).
MARUHASHI, Kenichi; (JP).
SHIMAWAKI, Hidenori; (JP)
代理人: MIYAZAKI, Teruo; 8th Floor, 16th Kowa Bldg., 9-20, Akasaka 1-chome, Minato-ku, Tokyo, 1070052 (JP)
優先権情報:
2008-013616 24.01.2008 JP
発明の名称: (EN) CIRCUIT SIMULATOR AND CIRCUIT SIMULATION METHOD
(FR) SIMULATEUR DE CIRCUIT ET MÉTHODE DE SIMULATION DE CIRCUIT
(JA) 回路シミュレータおよび回路シミュレーション方法
要約: front page image
(EN)A circuit simulator is characterized by comprising a transistor input section for inputting a model parameter of a transistor, an output power simulation section for calculating output power with reference to the transistor model parameter supplied from the transistor input section, a life simulation section for calculating life with reference to the transistor model parameter, a display section for displaying the contour map of the output power supplied from the output power simulation section and the life supplied from the life simulation section on a load impedance, and a load impedance extracting section for extracting a desired load impedance with reference to the output power and life displayed on the load impedance displayed by the display section.
(FR)L'invention porte sur un simulateur de circuit caractérisé en ce qu'il comprend: une section de saisie servant à introduire un paramètre de modèle de transistor, une section de simulation de puissance de sortie servant à calculer la puissance de sortie en fonction dudit paramètre, une section de simulation de la durée de vie dudit paramètre, une section d'affichage d'une carte des contours de ladite puissance de sortie et de ladite durée de vie pour une résistance de charge donnée, et une section d'extraction de la résistance de charge désirée en fonction de la puissance de sortie et de ladite durée de vie.
(JA) 本発明の回路シミュレータは、トランジスタのモデルパラメータを入力するためのトランジスタ入力部と、前記トランジスタ入力部から供給されたトランジスタモデルパラメータを参照して、出力電力を計算する出力電力シミュレーション部と、前記トランジスタモデルパラメータを参照して、寿命を計算する寿命シミュレーション部と、前記出力電力シミュレーション部から供給された出力電力と前記寿命シミュレーション部から供給された寿命との等高線図を、負荷インピーダンス上に表示する表示部と、前記表示部で負荷インピーダンス上に表示された出力電力と寿命を参照して、所望の負荷インピーダンスを抽出する負荷インピーダンス抽出部と、を有することを特徴とする。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)