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1. (WO2008142857) 半導体集積回路
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2008/142857    国際出願番号:    PCT/JP2008/001222
国際公開日: 27.11.2008 国際出願日: 16.05.2008
IPC:
H01L 21/822 (2006.01), H01L 27/04 (2006.01), H03H 11/04 (2006.01), H03L 7/093 (2006.01)
出願人: PANASONIC CORPORATION [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (米国を除く全ての指定国).
NOMASAKI, Daisuke; (米国のみ).
OKA, Koji; (米国のみ).
OZEKI, Toshiaki; (米国のみ)
発明者: NOMASAKI, Daisuke; .
OKA, Koji; .
OZEKI, Toshiaki;
代理人: HAYASE, Kenichi; HAYASE & CO. Patent Attorneys, 4F The Sumitomo Building No.2 4-7-28, Kitahama, Chuo-ku, Osaka-shi Osaka 5410041 (JP)
優先権情報:
2007-129951 16.05.2007 JP
発明の名称: (EN) SEMICONDUCTOR INTEGRATED CIRCUIT
(FR) CIRCUIT INTÉGRÉ SEMI-CONDUCTEUR
(JA) 半導体集積回路
要約: front page image
(EN)A semiconductor integrated circuit is characterized in that it comprises analog macros each having a comb capacitor (10), each comb capacitor (10) is composed of comb-shaped electrodes (11, 12), the comb tooth portions (13) of the electrode (11) and the comb tooth portions (14) of the electrode (12) are so interdigitized that the comb tooth portions (13) and the comb tooth portions (14) are alternated and parallel to one another, and the tooth portion intervals (S) are varied according to the absolute accuracy indicating the difference between the actual capacitance and the ideal capacitance or the relative accuracy indicating the differencebetween the capacitances of the adjacent comb capacitors. A high-accuracy analog macro comprising a comb capacitor whose high capacitance accuracy is ensured and a semiconductor integrated circuit comprising highly-integrated analog macros are provided.
(FR)Le circuit intégré semi-conducteur selon la présente invention est caractérisé en ce qu'il comprend des macros analogiques ayant chacune un condensateur peigne (10), chaque condensateur peigne (10) étant composé d'électrodes en forme de peigne (11, 12), les parties de dent de peigne (13) de l'électrode (11) et les parties de dent de peigne (14) de l'électrode (12) sont imbriquées les unes dans les autres de telle sorte que les parties de dent de peigne (13) et les parties de dent de peigne (14) sont alternées et parallèles les unes par rapport aux autres, et les intervalles de partie de dent (S) varient en fonction de la précision absolue indiquant la différence entre la capacité réelle et la capacité idéale, ou en fonction de la précision relative indiquant la différence entre les capacités des condensateurs peignes adjacents. La présente invention fournit une macro analogique de haute précision comprenant un condensateur peigne dont la précision de capacité élevée est garantie et un circuit intégré semi-conducteur comprenant des macros analogiques hautement intégrées.
(JA) 本発明にかかる半導体集積回路は、櫛形容量(10)を備えるアナログマクロを複数搭載し、櫛形容量(10)は、櫛形形状の電極(11)及び電極(12)を有し、電極(11)の櫛歯部(13)と電極(12)の櫛歯部(14)とが交互に平行に並ぶように、電極(11)の櫛歯部(13)と電極(12)の櫛歯部(14)とが噛み合わされて形成され、実際の容量値と理想の容量値との誤差を示す絶対精度、または、近接する櫛形容量間の容量値の差を示す相対精度に応じて、その櫛歯部間隔Sが異なることを特徴とする。  高い容量精度を確保した櫛形容量を備える高精度なアナログマクロ、及び高集積なアナログマクロを搭載する半導体集積回路を提供することができる。
指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)