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1. (WO2008123047) 不揮発性メモリ回路
国際事務局に記録されている最新の書誌情報

国際公開番号: WO/2008/123047 国際出願番号: PCT/JP2008/054910
国際公開日: 16.10.2008 国際出願日: 17.03.2008
IPC:
G11C 16/02 (2006.01) ,G11C 16/04 (2006.01) ,G11C 16/06 (2006.01)
G 物理学
11
情報記憶
C
静的記憶
16
消去可能でプログラム可能なリードオンリメモリ
02
電気的にプログラム可能なもの
G 物理学
11
情報記憶
C
静的記憶
16
消去可能でプログラム可能なリードオンリメモリ
02
電気的にプログラム可能なもの
04
閾値が可変なトランジスタを用いるもの,例.FAMOS
G 物理学
11
情報記憶
C
静的記憶
16
消去可能でプログラム可能なリードオンリメモリ
02
電気的にプログラム可能なもの
06
周辺回路,例.メモリへの書込み用
出願人:
ミツミ電機株式会社 MITSUMI ELECTRIC CO., LTD. [JP/JP]; 〒2068567 東京都多摩市鶴牧2丁目11番地2 Tokyo 11-2, Tsurumaki 2-chome, Tama-shi, Tokyo 2068567, JP (AllExceptUS)
籾井 政人 MOMII, Masato [JP/JP]; JP (UsOnly)
発明者:
籾井 政人 MOMII, Masato; JP
代理人:
池田 憲保 IKEDA, Noriyasu; 〒1000011 東京都千代田区内幸町一丁目2番2号 日比谷ダイビル Tokyo Hibiya Daibiru Bldg. 2-2, Uchisaiwaicho 1-chome Chiyoda-ku, Tokyo 1000011, JP
優先権情報:
2007-08426428.03.2007JP
発明の名称: (EN) NONVOLATILE MEMORY CIRCUIT
(FR) CIRCUIT MÉMOIRE NON VOLATILE
(JA) 不揮発性メモリ回路
要約:
(EN) Provided is a nonvolatile memory circuit by which a module area can be reduced even with a small memory capacity. A nonvolatile memory circuit (50) is composed of a plurality of memory cell blocks (50-1 to 50-52), a power-on-reset circuit (64), and a power-on-precharge circuit (66). Each of the memory cell blocks (50-1 to 50-52) is provided with a plurality of memory cells (51-1 to 51-52) for storing data of 1 bit; a plurality of data latch circuits (52-1 to 52-52), which hold data read out from the memory cells when data is being read, and hold operation mode information for the memory cells when data is being written; and a plurality of switching circuits (53-1 to 53-52 and 54-1 to 54-52), which read out data of 1 bit for the memory cells when data is being read, and perform erasing/writing operation switching based on the operation mode information when data is being written.
(FR) L'invention concerne un circuit mémoire non volatile grâce auquel on peut réduire une surface de module même comportant une petite capacité mémoire. Un circuit mémoire non volatile (50) est composé d'une pluralité de blocs de cellules mémoire (50 - 1 à 50 - 52), d'un circuit de réinitialisation à la mise sous tension (64) et d'un circuit de précharge à la mise sous tension (66). Chacun des blocs de cellules mémoire (50 - 1 à 50 - 52) est doté d'une pluralité de cellules mémoire (50 - 1 à 50 - 52) permettant de stocker des données de 1 bit, d'une pluralité de circuits de verrouillage de données (52 - 1 à 52 - 52), qui maintient les données lues depuis les cellules mémoire lorsque les données sont lues et qui maintient les informations sur le mode de fonctionnement pour les cellules mémoire lorsque les données sont écrites, ainsi qu'une pluralité de circuits de commutation (53 - 1 à 53 - 52 et 54 - 1 à 54 - 52) qui lisent les données de 1 bit depuis les cellules mémoire lorsque les données sont lues et effectuent une commutation de fonctionnement d'effacement/écriture sur la base des informations du mode de fonctionnement lorsque les données sont écrites.
(JA)  メモリ容量が小さくてもモジュール面積を低減できる不揮発性メモリ回路を提供する。複数のメモリセルブロック(50-1~50-52)と、パワーオンリセット回路(64)と、パワーオンプリチャージ回路(66)とから構成される不揮発性メモリ回路(50)において、複数のメモリセルブロック(50-1~50-52)は、それぞれ、1ビットのデータを記憶するための複数のメモリセル(51-1~51-52)と、リード時には複数のメモリセルから読み出されたデータを保持し、ライト時には複数のメモリセルに対する動作モード情報を保持する複数のデータラッチ回路(52-1~52-52)と、リード時には複数のメモリセルに対して各々1ビットのデータの読出しを行い、ライト時には動作モード情報に基づいて消去・書込みの動作切替を行う複数の切替回路(53-1~53-52,54-1~54-52)とを有する。
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指定国: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)