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World Intellectual Property Organization
1. (WO2007083743) 表示装置および電子機器

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2007/083743    国際出願番号:    PCT/JP2007/050791
国際公開日: 26.07.2007 国際出願日: 19.01.2007
G09G 3/36 (2006.01), G02F 1/133 (2006.01), G02F 1/1345 (2006.01), G09G 3/20 (2006.01)
出願人: SONY CORPORATION [JP/JP]; 1-7-1, Konan, Minato-ku, Tokyo (JP) (米国を除く全ての指定国).
MURASE, Masaki [JP/JP]; (JP) (米国のみ).
ITO, Daisuke [JP/JP]; (JP) (米国のみ).
TONOGAI, Masaaki [JP/JP]; (JP) (米国のみ).
KIDA, Yoshitoshi [JP/JP]; (JP) (米国のみ).
NAKAJIMA, Yoshiharu [JP/JP]; (JP) (米国のみ)
発明者: MURASE, Masaki; (JP).
ITO, Daisuke; (JP).
TONOGAI, Masaaki; (JP).
KIDA, Yoshitoshi; (JP).
NAKAJIMA, Yoshiharu; (JP)
代理人: SATOH, Takahisa; Sohshin International Patent Office, Toranomon Denki Building 2F 8-1, Toranomon 2-chome, Minato-ku, Tokyo 1050001 (JP)
2006-013126 20.01.2006 JP
(JA) 表示装置および電子機器
要約: front page image
(EN)Provided is a display device capable of amplifying the same input voltage as the IC power voltage by using low temperature polysilicon having a high threshold voltage and large irregularities. An electronic device using the display device is also disclosed. The display device has MCK level shifters (171-1, 171-2) of the format requiring periodical reset operation; a logical circuit (173) for outputting a signal for inputting a reset pulse for MCK level shifters (171-1, 171-2) having a cycle of an N horizontal period while shifting its phase by an M horizontal period (M < N) with respect to the respective level shifters (171-1, 171-2) by using the level-shifted horizontal synchronization signal Hsync; and a function for selecting, as a final output signal, a circuit which has not performed a reset operation among the L MCK level shifters (171-1, 171-2) for each M horizontal period and outputting the level-shifted master clock LSMCK.
(FR)L'invention porte sur un afficheur pouvant amplifier la même tension d’entrée que celle de l’alimentation du circuit intégré en utilisant du polysilicium à basse température présentant une tension de seuil élevée et de larges irrégularités. L'invention porte également sur un dispositif électronique utilisant ledit afficheur. L’afficheur comporte: des décaleurs de niveau MCK (171-1, 171-2) d’un format demandant des opérations périodiques de RàZ, un circuit logique (173) émettant un signal d’entrée d’une impulsion de RàZ des décaleurs de niveau MCK (171-1, 171-2) présentant un cycle de N périodes horizontales tout en de déphasant d’une période horizontale M (M < N) par rapport aux décaleurs de niveau (171-1, 171-2) en utilisant un signal Hsync de synchronisation à décalage horizontal de niveau; et une fonction de sélection en tant que signal final de sortie un circuit n’ayant pas effectué d’opération de RàZ parmi les déphaseurs de niveau L MCK (171-1, 171-2) pour chacune des M périodes horizontales, et émettant l’horloge principale LSMCK décalée en niveau.
(JA) 高いしきい値電圧を持ち、バラツキが大きい低温ポリシリコンを使用して、ICの電源電圧と同じ入力電圧を増幅することができる表示装置およびそれ用いた電子機器であって、定期的にリセット動作が必要な形式のMCK用レベルシフタ171-1、171-2と、レベルシフトされた水平同期信号Hsyncを使用して、N水平期間の周期を持つMCKレベルシフタ171-1,171-2用のリセットパルスを、各レベルシフタ171-1,171-2に対してM水平期間(但し、M<N)位相をずらして入力する信号を出力する論理回路173と、最終出力信号としてM水平期間毎にL個のMCKレベルシフタ171-1,171-2の出力の内、リセット動作を行っていない回路を選択して、レベルシフトされたマスタクロックLSMCKを出力する機能とを有する。
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)