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1. (WO2006035572) データインタリーブ装置
国際事務局に記録されている最新の書誌情報

国際公開番号: WO/2006/035572 国際出願番号: PCT/JP2005/016221
国際公開日: 06.04.2006 国際出願日: 05.09.2005
予備審査請求日: 28.07.2006
IPC:
H03M 13/27 (2006.01) ,G06F 13/28 (2006.01) ,G11B 20/10 (2006.01)
H 電気
03
基本電子回路
M
符号化,復号化または符号変換一般
13
誤りの検出または誤りの訂正のための符号化,復号化または符号変換;符号理論の基本的仮定;符号化の限界式;誤り確率の評価方法;通信路モデル;符号のシミュレーションまたは試験
27
インターリーブ技術を用いるもの
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
13
メモリ,入力/出力装置または中央処理ユニットの間の情報または他の信号の相互接続または転送
14
相互接続または転送のための接続要求
20
入力/出力バスに対するアクセスのためのもの
28
バーストモード転送を用いるもの,例.ダイレクトメモリアクセス,サイクルスチール
G 物理学
11
情報記憶
B
記録担体と変換器との間の相対運動に基づいた情報記録
20
記録または再生方法に特徴のない信号処理;そのための回路
10
デジタル記録または再生
出願人:
松下電器産業株式会社 MATSUSHITA ELECTRIC INDUSTRIAL CO., LTD. [JP/JP]; 〒5718501 大阪府門真市大字門真1006番地 Osaka 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501, JP (AllExceptUS)
妹尾 大吾 SENOO, Daigo; null (UsOnly)
発明者:
妹尾 大吾 SENOO, Daigo; null
代理人:
前田 弘 MAEDA, Hiroshi; 〒5410053 大阪府大阪市中央区本町2丁目5番7号 大阪丸紅ビル Osaka Osaka-Marubeni Bldg., 5-7, Hommachi 2-chome, Chuo-ku, Osaka-shi, Osaka 541-0053, JP
優先権情報:
2004-28485729.09.2004JP
発明の名称: (EN) DATA INTERLEAVE DEVICE
(FR) DISPOSITIF D’ENTRELACEMENT DE DONNÉES
(JA) データインタリーブ装置
要約:
(EN) In a data interleave device, an SRAM division circuit (800) judges whether the address information for releasing interleaving transmitted from a DMA device is in the first half (SRAM 700, 710) or in the second half (SRAM 720, 730) of the storage area SRAM (700-730) and divides the information into one of them. Moreover, a DMA device (100) transmits a pair of addresses and data corresponding to one of the addresses is written into the first storage area (SRAM 700 or 720) according to a division different from the aforementioned division. Simultaneously with this, the data corresponding to the other address is written into the second storage area (SRAM 710 or 730). A DMA device (200) transmitting an address for extracting the interleave data corresponds to an SRAM division circuit (810) and similarly, simultaneous processing of the first half and the second half area in the storage area SRAM is performed and simultaneous processing of the first and the second storage area is performed. Accordingly, it is possible to improve the processing speed without increasing the frequency.
(FR) L'invention concerne un dispositif d’entrelacement de données contenant un circuit de division de SRAM (800) qui juge si les informations d’adresse pour libérer l’entrelacement transmis par un dispositif DMA sont dans la première moitié (SRAM 700, 710) ou dans la deuxième moitié (SRAM 720, 730) de la zone de stockage SRAM (700-730) et divise les informations en l’une d’elle. En outre, un dispositif DMA (100) transmet une paire d’adresses et des données correspondant à l’une des adresses sont écrites dans la première zone de stockage (SRAM 700 ou 720) selon une division différente de celle précédemment évoquée. Simultanément, les données correspondant à l’autre adresse sont écrites dans la deuxième zone de stockage (SRAM 710 ou 730). Un dispositif DMA (200) transmettant une adresse pour l’extraction des données d’entrelacement correspond à un circuit de division SRAM (810) et, de façon similaire, un traitement simultané de la première et de la deuxième moitié de zone dans la zone de stockage SRAM est réalisé et un traitement simultané de la première et de la deuxième zone de stockage est réalisé. En accord, il est possible d’augmenter la vitesse de traitement sans augmenter la fréquence.
(JA)  データインターリーブ装置において、DMA装置100が発信するインターリーブを解くためのアドレス情報が、記憶領域SRAM700~730の前半(SRAM700、710)か後半(SRAM720、730)の何れであるかをSRAM振分回路800により判断し、振分ける。また、DMA装置100は2つずつのアドレスを発信し、一方のアドレスに対応するデータは上記とは別の分割による第1の記憶領域(SRAM700及び720の何れか)に書込まれ、同時に、他方のアドレスに対応するデータは第2の記憶領域(SRAM710及び730の何れか)に書込まれる。インターリーブデータを引抜くためのアドレスを発信するDMA装置200にはSRAM振分回路810が対応し、同様に、記憶領域SRAMにおける前半及び後半領域の同時処理と第1及び第2の記憶領域の同時処理とを行う。従って、周波数を増加することなく処理速度が向上する。
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指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)
また、:
JPWO2006035572US20070266187CN101032085JP4197034