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1. (WO2006035500) データ記憶システムおよびメモリカード
国際事務局に記録されている最新の書誌情報

国際公開番号: WO/2006/035500 国際出願番号: PCT/JP2004/014228
国際公開日: 06.04.2006 国際出願日: 29.09.2004
予備審査請求日: 29.09.2004
IPC:
G05F 3/06 (2006.01) ,G06F 3/08 (2006.01) ,G06F 13/16 (2006.01) ,G06F 13/38 (2006.01) ,G06K 17/00 (2006.01) ,G06F 12/00 (2006.01)
G 物理学
05
制御;調整
F
電気的変量または磁気的変量の調整システム
3
自己調整特性を有する一つの非制御素子,または複数の素子から成る組合せであって自己調整特性を有するものによって,電気的変量を調整する非反作用系
02
電流または電圧の調整
04
交流のもの
06
飽和および非飽和のインダクタ装置を組み合わせて使用するもの,例.共振回路と組み合わされているもの
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
3
計算機で処理しうる形式にデータを変換するための入力装置;処理ユニットから出力ユニットへデータを転送するための出力装置,例.インタフェース装置
06
記録担体からのデジタル入力または記録担体へのデジタル出力
08
個別的な記録担体たとえばせん孔カードからのデジタル入力またはこのような記録担体へのデジタル出力
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
13
メモリ,入力/出力装置または中央処理ユニットの間の情報または他の信号の相互接続または転送
14
相互接続または転送のための接続要求
16
メモリバスに対するアクセスのためのもの
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
13
メモリ,入力/出力装置または中央処理ユニットの間の情報または他の信号の相互接続または転送
38
情報転送,例.バス上での
G 物理学
06
計算;計数
K
データの認識;データの表示;記録担体;記録担体の取扱い
17
メイングループ1/00から15/00の2つ以上のメイングループに包含される装置を共動させるための方法または装置,例.移送および読取り動作と共動する自動カードファイル
G 物理学
06
計算;計数
F
電気的デジタルデータ処理
12
メモリ・システムまたはアーキテクチャ内でのアクセシング,アドレシングまたはアロケーティング(情報記憶一般G11)
出願人:
株式会社ルネサステクノロジ RENESAS TECHNOLOGY CORP. [JP/JP]; 〒1006334 東京都千代田区丸の内二丁目4番1号 Tokyo 4-1, Marunouchi 2-chome, Chiyoda-ku, Tokyo 1006334, JP (AllExceptUS)
鈴木 慎一 SUZUKI, Shinichi [JP/JP]; JP (UsOnly)
発明者:
鈴木 慎一 SUZUKI, Shinichi; JP
代理人:
筒井 大和 TSUTSUI, Yamato; 〒1600023 東京都新宿区西新宿8丁目1番1号 アゼリアビル3階 筒井国際特許事務所 Tokyo Tsutsui & Associates 6th Floor, Kokusai Chusei Kaikan 14, Gobancho Chiyoda-ku, Tokyo 1020076, JP
優先権情報:
発明の名称: (EN) DATA STORAGE SYSTEM AND MEMORY CARD
(FR) SYSTEME DE STOCKAGE DE DONNEES ET CARTE MEMOIRE
(JA) データ記憶システムおよびメモリカード
要約:
(EN) In an illustrative case of updating the memory content at a target end, which is now, for example, 5A'h, to 5B'h via data transmission from an initiator to the target, the initiator transmits, to the target, data of 01'h indicating whether an updating is to be performed per bit (a bit to be updated is '1' and a bit not to be updated is '0'). When receiving the data of 01'h, the target retrieves, from among the data of its own memory contents, and reverses the data of the bit (in this case, the last bit) corresponding to a bit to be updated, and then restores the data as reversed.
(FR) Dans un cas explicatif de mise à jour du contenu de mémoire au niveau d’une extrémité cible, qui est dans ce cas, par exemple, de 5A'h à 5B'h par l’intermédiaire d’une émission de données d’un initiateur vers la cible, l’initiateur émet, vers la cible, des données de 01'h indiquant si une mise à jour doit être effectuée par bit (un bit à mettre à jour vaut « 1 » et un bit à ne pas mettre à jour vaut « 0 »). Lors de la réception des données de 01'h, la cible récupère, parmi les données de ses propres contenus de mémoire, et inverse les données du bit (dans ce cas, le dernier bit) correspondant à un bit à mettre à jour, et ensuite restaure les données telles qu’inversées.
(JA)  例えば、ターゲット側のメモリ内容を5A’hとして、イニシエータからターゲットに向けたデータ転送により、当該メモリ内容を5B’hに更新する場合を例とすると、イニシエータは、ターゲットに向けて、更新有りのビットを‘1’、更新無しのビットを‘0’とする各ビット毎の更新有無を示すデータ01’hを送信し、ターゲットは、01’hのデータを受けて、自身のメモリ内容のデータの中から更新有りのビットに該当するビット(ここでは最後のビット)のデータを反転して再格納する。
front page image
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
国際公開言語: 日本語 (JA)
国際出願言語: 日本語 (JA)