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1. (WO2006033298) 入力回路
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2006/033298    国際出願番号:    PCT/JP2005/017136
国際公開日: 30.03.2006 国際出願日: 16.09.2005
IPC:
H03K 19/0175 (2006.01), H03K 5/08 (2006.01), H03K 17/30 (2006.01)
出願人: ROHM CO., LTD. [JP/JP]; 21, Saiin Mizosaki-cho, Ukyo-ku, Kyoto-shi, Kyoto 6158585 (JP) (米国を除く全ての指定国).
FUJIMURA, Takashi [JP/JP]; (JP) (米国のみ)
発明者: FUJIMURA, Takashi; (JP)
代理人: FUKAMI, Hisao; Fukami Patent Office Nakanoshima Central Tower 22nd Floor 2-7, Nakanoshima 2-chome, Kita-ku Osaka-shi, Osaka 5300005 (JP)
優先権情報:
2004-277889 24.09.2004 JP
発明の名称: (EN) INPUT CIRCUIT
(FR) CIRCUIT D'ENTREE
(JA) 入力回路
要約: front page image
(EN)An input circuit capable of judging a three-valued external signal without requiring troublesome voltage regulation while reducing power consumption when on standby. The input circuit comprises four resistor elements (3-6) connected in series between different fixed potentials, an input terminal (2) connected with the junction of two resistor elements (4, 5), a switching transistor (7) being turned on/off by the voltage at the junction of two resistor elements (5, 6), a current supply circuit (8) outputting a supply current when the switching transistor (7) is turned on but not outputting the supply current when it is turned off, a constant voltage generation circuit (9) outputting a constant voltage by receiving the supply current, a constant voltage output buffer circuit (10) for bringing the output into high impedance state when the switching transistor (7) is turned off and outputting a predetermined voltage to the junction of two resistor elements (3, 4) by receiving the constant voltage when the switching transistor (7) is turned on, a switching transistor (11) being turned on/off by the voltage across the resistor element (4), and a combination circuit (12) outputting a judgment signal based on the combination of on/off of two switching transistors (7, 11).
(FR)L'invention concerne un circuit d'entrée capable d'évaluer un signal externe à trois valeurs sans régulation de tension source de complications, tout en réduisant la consommation d'énergie à l'état de veille. Ce circuit d'entrée comprend quatre éléments résistants (3-6) connectés en série entre différents potentiels fixes, une borne d'entrée (2) connectée à la jonction de deux éléments résistants (4, 5), un transistor de commutation (7) allumé/éteint par la tension à la jonction de deux éléments résistants (5, 6), un circuit d'alimentation électrique (8) fournissant du courant lorsque le transistor de commutation (7) est allumé, mais ne fournissant pas de courant lorsque ce transistor est éteint, un circuit générateur de tension constante (9) fournissant une tension constante en recevant du courant, un circuit tampon de sortie de tension constante (10) destiné à mettre la sortie en état de haute impédance lorsque le transistor de commutation (7) est éteint et à fournir une tension prédéterminée à la jonction de deux éléments résistants (3, 4) en recevant la tension constante lorsque le transistor de commutation (7) est éteint, un transistor de commutation (11) étant allumé/éteint par la tension aux bornes de l'élément résistant (4), et un circuit de combinaison (12) fournissant un signal d'évaluation sur la base de la combinaison de marche/arrêt de deux transistors de commutation (7, 11).
(JA) 煩雑な電圧調整をすることなく3値の外部信号を判別することができ、かつ、スタンバイ状態における消費電力を低減することが可能な入力回路を提供する。入力回路は、異なる固定電位間に直列に設けられた4個の抵抗素子(3~6)と、2個の抵抗素子(4,5)の接続点に接続される入力端子(2)と、2個の抵抗素子(5,6)の接続点の電圧によりオン・オフされるスイッチングトランジスタ(7)と、スイッチングトランジスタ(7)がオンのとき供給電流を出力し、オフのとき出力しない電流供給回路(8)と、供給電流を受けて定電圧を出力する定電圧発生回路(9)と、スイッチングトランジスタ(7)がオフのとき出力をハイインピーダンス状態とし、オンのとき定電圧を受けて2個の抵抗素子(3,4)の接続点に所定電圧を出力する定電圧出力バッファ回路(10)と、抵抗素子(4)の両端間の電圧によりオン・オフされるスイッチングトランジスタ(11)と、2個のスイッチングトランジスタ(7,11)のオン・オフの組み合わせに基づいて判別信号を出力する組み合わせ回路(12)とを備える。
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)