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1. (WO2005106834) アクティブマトリクス型表示装置
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2005/106834    国際出願番号:    PCT/JP2004/006352
国際公開日: 10.11.2005 国際出願日: 30.04.2004
IPC:
G09G 3/30 (2006.01)
出願人: FUJI PHOTO FILM CO., LTD. [JP/JP]; 210, Nakanuma, Minami-Ashigara-shi, Kanagawa 2500123 (JP) (米国を除く全ての指定国).
ISHIZUKA, Atsuo [JP/JP]; (JP) (米国のみ).
YAMAGUCHI, Hisashi [JP/JP]; (JP) (米国のみ).
HASHIMOTO, Yasunobu [JP/JP]; (JP) (米国のみ)
発明者: ISHIZUKA, Atsuo; (JP).
YAMAGUCHI, Hisashi; (JP).
HASHIMOTO, Yasunobu; (JP)
代理人: NAKAJIMA, Jun; TAIYO, NAKAJIMA & KATO, Seventh Floor, HK-Shinjuku Bldg., 3-17, Shinjuku 4-chome, Shinjuku-ku, Tokyo 1600022 (JP)
優先権情報:
発明の名称: (EN) ACTIVE-MATRIX DISPLAY
(FR) AFFICHAGE MATRICIEL ACTIF
(JA) アクティブマトリクス型表示装置
要約: front page image
(EN)A display is disclosed which comprises a plurality of scanning lines (Wscan, Escan) which are selected sequentially, a plurality of data lines (Data) to which a write current (Idata) according to luminance information is supplied according to selection of the scanning lines, and a plurality of pixels (PX) arranged on their intersections. Each pixel comprises a light-emitting device (OLED), a drive transistor (TFT4), a capacitor (C) which is connected to the gate (Nd) of the drive transistor and stores write date, a first transistor (TFT1) which conducts during a write period when the scanning line is scanned and connects the date line and the drain of the drive transistor, and a second transistor (TFT2) which conducts during the write period and short-circuits the gate and drain of the drive transistor. This structure enables to drive the light-emitting device with a drive current which is equivalent to the write current without being affected by variations in transistor characteristics.
(FR)L'invention concerne un affichage comprenant une pluralité de lignes de balayage (Wscan, Escan) qui sont sélectionnées de manière séquentielle, une pluralité de lignes de données (Data) recevant, selon la sélection des lignes de balayage, un courant d'écriture (ldata) en fonction des informations de luminance, et une pluralité de pixels (PX) disposés en leurs intersections. Chaque pixel comprend un dispositif électroluminescent (OLED), un transistor d'attaque (TFT4), un condensateur (C) qui est connecté à la grille (Nd) du transistor d'attaque et stocke la date d'écriture, un premier transistor (TFT1) qui est conducteur pendant une période d'écriture, lorsque la ligne de balayage est balayée, et connecte la ligne de date et le drain du transistor d'attaque, et un second transistor (TFT2) qui est conducteur pendant la période d'écriture et met en court-circuit la grille et le drain du transistor d'attaque. Cette structure permet d'exciter le dispositif électroluminescent avec un courant d'excitation équivalent au courant d'écriture quelles que soient les variations de caractéristiques de transistor.
(JA)not available
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)