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1. (WO2005078579) プログラム変換装置およびプログラム変換方法
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2005/078579    国際出願番号:    PCT/JP2005/001670
国際公開日: 25.08.2005 国際出願日: 04.02.2005
IPC:
G06F 9/45 (2006.01)
出願人: MATSUSHITA ELECTRIC INDUSTRIAL CO., LTD. [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi Osaka 5718501 (JP) (米国を除く全ての指定国).
KAWABATA, Teruo; (米国のみ).
OGAWA, Hajime; (米国のみ).
HEISHI, Taketo; (米国のみ).
YAMAMOTO, Yasuhiro; (米国のみ).
MICHIMOTO, Shohei; (米国のみ)
発明者: KAWABATA, Teruo; .
OGAWA, Hajime; .
HEISHI, Taketo; .
YAMAMOTO, Yasuhiro; .
MICHIMOTO, Shohei;
代理人: NII, Hiromori; c/o NII Patent Firm 6F, Tanaka Ito Pia Shin-Osaka Bldg. 3-10, Nishi Nakajima 5-chome Yodogawa-ku, Osaka-city Osaka 5320011 (JP)
優先権情報:
2004-035430 12.02.2004 JP
発明の名称: (EN) PROGRAM CONVERSION DEVICE AND PROGRAM CONVERSION METHOD
(FR) DISPOSITIF DE CONVERSION DE PROGRAMME ET PROCÉDÉ DE CONVERSION DE PROGRAMME
(JA) プログラム変換装置およびプログラム変換方法
要約: front page image
(EN)A compiler improving the processing speed during program execution without issuing an instruction which may cause interlock is a compiler for a processor having an instruction which may cause interlock during execution. The compiler causes a computer to function: as a loop structure conversion unit (186) for causing an input program to divide the loop of x count into a loop of y count and performing dual loop conversion with the loop of y count as an inner loop and the loop of x/y count as an outer loop; and as an instruction optimal arrangement unit (187) for arranging an instruction which may cause interlock in the program after the dual loop conversion.
(FR)Un compileur améliorant la vitesse de traitement pendant une exécution de programme sans lancer d’instruction risquant de provoquer des nœuds, est un compileur pour processeur possédant une instruction risquant de provoquer des nœuds pendant l’exécution. Le compileur lance l’exploitation d’un ordinateur : comme unité de conversion de structure en boucle (186) pour conduire un programme de saisie à diviser la boucle de x décomptes en une boucle de y décomptes et pour réaliser une conversion en double boucle avec la boucle de y décomptes faisant office de boucle interne et la boucle de x/y décomptes faisant office de boucle externe ; et comme unité de disposition optimale des instructions (187) pour aménager une instruction risquant de provoquer des nœuds dans le programme après la conversion en double boucle.
(JA) インターロックを引き起こす可能性のある命令を無駄に発行せずに、プログラム実行時の処理速度を向上させるコンパイラは、実行時にインターロックを起こす可能性のある命令を備えたプロセッサ向けのコンパイラであって、入力プログラムに対し、ループ回数がx回のループをループ回数がy回のループに分割し、前記ループ回数がy回のループを内側ループとし、ループ回数がx/y回のループを外側ループとする二重ループ変換を行うループ構造変換部(186)と、前記二重ループ変換後のプログラムに対して、インターロックを起こす可能性のある命令の配置を行う命令最適配置部(187)としてコンピュータを機能させることを特徴とする。                                                                                 
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)