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1. (WO2004064251) 可変利得増幅回路及び無線機
国際事務局に記録されている最新の書誌情報   

Translation翻訳: 原文 > 日本語
国際公開番号:    WO/2004/064251    国際出願番号:    PCT/JP2004/000181
国際公開日: 29.07.2004 国際出願日: 14.01.2004
IPC:
H03G 1/00 (2006.01), H03G 3/00 (2006.01)
出願人: MATSUSHITA ELECTRIC INDUSTRIAL CO., LTD. [JP/JP]; 1006, Oaza Kadoma Kadoma-shi, Osaka 571-8501 (JP) (米国を除く全ての指定国).
UDAGAWA, Masaharu; (米国のみ)
発明者: UDAGAWA, Masaharu;
代理人: OGURI, Shohei; Eikoh Patent Office 13th Floor, ARK Mori Building 12-32, Akasaka 1-chome Minato-ku, Tokyo 107-6013 (JP)
優先権情報:
2003-6171 14.01.2003 JP
発明の名称: (EN) VARIABLE GAIN AMPLIFIER CIRCUIT AND RADIO MACHINE
(FR) CIRCUIT AMPLIFICATEUR DE GAIN VARIABLE ET MACHINE RADIO
(JA) 可変利得増幅回路及び無線機
要約: front page image
(EN)A variable gain amplifier circuit in which current decreases when the voltage gain is lowered and the distortion characteristic substantially hardly deteriorate. The bases of bipolar transistors (Q1, Q3, Q5; Q2, Q4, Q6) constituting grounded emitter circuits are interconnected commonly. Switches (SW2, SW1, SW0) are provided to the emitter sides of the bipolar transistors. By switching the switches (SW2, SW1, SW0), the potentials of the emitter sides are made a ground potential gnd to select a grounded emitter amplifier circuit with a different voltage gain to control the voltage gain. The corrector currents I0 and the emitter resistances Re of the grounded emitter amplifier circuits are different from one another, and the ratio between the collector currents I0 is in inverse proportion to the ratio between the emitter resistances Re. As a result, the collector current I0 of each grounded emitter amplifier circuit decreases as the voltage grain is lowered, and the distortion characteristic substantially hardly deteriorate.
(FR)L'invention concerne un circuit amplificateur de gain variable dans lequel le courant diminue lorsque le gain de tension est abaissé et la caractéristique de distorsion ne se dégrade sensiblement pas. Les bases des transistors bipolaires (Q1, Q3, Q5; Q2, Q4, Q6) constituant des circuits émetteurs mis à la terre sont reliés entre eux de façon classique. Des commutateurs (SW2, SW1, SW0) sont disposés sur les côtés émetteurs des transistors bipolaires. Par commutation des commutateurs (SW2, SW1, SW0), les potentiels des côtés émetteurs sont mis à la terre afin de choisir un circuit amplificateur d'émetteur mis à la terre avec un gain de tension différent en vue de commander le gain de tension. Les courants correcteurs (I0) et les résistances d'émetteur (Re) des circuits amplificateurs d'émetteur mis à la terre sont différents les uns des autres, et le rapport entre les courants collecteurs (I0) équivaut à une proportion inverse du rapport entre les résistances d'émetteur (Re). Le courant collecteur (I0) de chaque circuit amplificateur d'émetteur mis à la terre diminue donc à mesure que le gain de tension est abaissé, et la caractéristique de distorsion ne se dégrade sensiblement pas.
(JA) 本発明の課題は、電圧利得を下げたときに電流が減少し、かつ歪み特性の劣化が実質的にない可変利得増幅回路を提供することである。 複数のエミッタ接地増幅回路を構成するバイポーラトランジスタQ1、Q3、Q5及びQ2、Q4、Q6のベースを共通とし、バイポーラトランジスタのエミッタ側にそれぞれスイッチSW2、SW1、SW0を設けて構成する。スイッチSW2、SW1、SW0を切り替えてエミッタ側を接地電位gndにすることにより、電圧利得の異なるエミッタ接地増幅回路を選択して電圧利得を制御する。また、各エミッタ接地増幅回路の間でコレクタ電流I0とエミッタ抵抗Reをそれぞれ異なる値とし、コレクタ電流I0の比がエミッタ抵抗Reの比に反比例するように設定することにより、電圧利得を下げたときにコレクタ電流I0が減り、かつ歪み特性の劣化を実質的になくすことができる。
指定国: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
アフリカ広域知的所有権機関(ARIPO) (BW, GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
ユーラシア特許庁(EAPO) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
欧州特許庁(EPO) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
アフリカ知的所有権機関(OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
国際公開言語: Japanese (JA)
国際出願言語: Japanese (JA)